本帖最后由 电巢直播 于 2021-7-1 15:54 编辑 4 x6 Q' R% p. H
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6月29日直播间答疑
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6月29号 (周二) 《FPGA on Board FPGA设计仿真及验证》
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) g% X+ {+ [$ D" Q0 @8 w5 @7 x4 I7 @网友:1、FPGA后仿真,花费时间比较多,是否可以不做? 老师:FPGA后仿真确实花费时间比较多,业界现在有其他的解决方案,就是RTL和网表做等效性比对,如果比对通过了可以不做后仿真。 4 p& j! t+ [7 v
/ b4 n) G% o# D4 [& y网友:2、FPGA约束多了,是否综合仿真比较难? 老师:FPGA约束多了,综合会难些收敛。前仿真和和约束不相关。后仿真和设计规模大小相关。
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网友:3、 QuestaSim 和 ModelSim的区别 老师:QuestaSim相当是ModelSim的升级版,QuestaSim的性能、容量和功能会强大很多。 * [$ B2 `3 x4 j% \0 c
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网友:4、CDC使用的主要场景是什么 能在Windows下使用吗? 老师:Questa CDC可以在Windows下运行,主要用来做多异步时钟域检查,检查设计中跨时钟域是否有做同步逻辑。
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+ L7 Y! C% f! z9 L$ n; V7 u网友:5、Lint检查在FPGA开发的什么阶段用?主要用来做什么? 老师:Lint主要用来做RTL设计的语法以及代码风格等检查,我们建议在写完RTL后直接使用Lint来做初步的检查。 6 _/ O- {( }- y1 l
$ V5 v Q* J: p8 |7 u网友:6、 代码覆盖率达到100%,是不是说明验证已经100%完成? 老师:代码覆盖率只是验证充分性的一个必要考核指标,不是充分条件。所以业界现在需要结合功能覆盖率以及特性表、测试计划testplan等来统计分析验证的完整性。
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网友:7、形式验证和功能验证的区别在哪? 老师:目前还是以功能验证为主,形式验证为辅。功能验证就是我们常说的仿真验证,需要搭建testbench和编写测试用例;而形式验证一般是用编写断言来告诉工具设计的期望值是什么,让工具来证明设计与期望值是否符合。
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3 `& \: A4 s9 G9 i5 T& O/ r2 E5 B网友:8、 FPGA用厂家工具仿真好,还是第三方如西门子EDA工具好? 老师:目前西门子EDA的仿真工具,在性能、容量以及整体解决方案的完整性有突出的优势。 ; x# `9 ~* }# ~. f" h+ u' U' u" |2 b
" N- w/ k! @2 _网友:9、 MENTOR与其他仿真工具优势主要有哪些? 老师:目前西门子EDA的仿真工具的主要优势就是和FPGA的厂家有更好的合作,能更好地体现在仿真里库的兼容性以及仿真速度上。
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# ?( r% S0 u/ d, @5 H网友:10、功能仿真,综合后仿真,时序仿真一般发现问题概率多少? 老师:这个概率,因应设计复杂性、工程师经验水平和使用EDA工具的多少而不同。 目前还是功能仿真为主,功能仿真做得越充分则产品隐藏的问题越少。然后通过后仿真来保证布局布线后的时序是正确,这样可以让FPGA在实验室里的调试变得更顺利。
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网友:11、西门子工具仿真SystemC如何? 老师:我们的QuestaSim不仅支持SystemC的仿真,同时具有强大的SystemC代码调试功能。
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