请问 TI的dsp和ddr2接口的参考

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     里面有要求曼哈顿距离  请问有经验的前辈  这个约束应该如何设置
; P+ m- U7 a% T; ?1 |我知道Manhattan距离在allergo如何看。先看下 Manhattan distance，用show element，find下选择nets或者clines，对话框中有曼哈顿距离；设置约束的时候再ECS下设置就可以了。
然后是如何设置呢
) [: a( D- c6 h. d; H# U' iParameter                                                      Min           Typ    Max                     Unit
; [# k$ L  Z: g. v4 m) N4 eCK/ADDR_CTRL   nominal trace length     CACLM-50 CACLM CACLM+50              Mils
: M# z  p6 C# u/ O& Q7 Q! _" S6 [
6 B( k/ @. m6 Y% S, [, H$ A) }/ uCACLM is the longest Manhattan distance of the CK and ADDR_CTRL net classes.
请问这个规则在约束里怎么实现？
5 m( q6 W: S$ b& a5 v! Z4 B参考资料    ti  ddr2布线指南
* {. t5 z) X. }& k( ]http://focus.ti.com.cn/cn/lit/an/spraac5g/spraac5g.pdf

mcu200689

说下我的观点共同交流，曼哈顿距离和实际布线的距离是不一样的吧，CK和ADDR_CTRL都布好线后就可以看到最长的线了，根据最长的线确定约束就可以了啊

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那请问 你的A。B。C长度关系是如何确定的  
, c( q5 @# k8 `, I+ r! h! N: r$ p我在参考中看到
ADDR_CTRL A to B/A to C Skew Length Mismatch 100 Mils
ADDR_CTRL B to C Skew Length Mismatch 100 Mils
而在之前
DDR2 CK and ADDR_CTRL Routing
Figure 6 shows the topology of the routing for the CK and ADDR_CTRL net classes. The route is a balanced T as it is intended that the length of segments B and C be equal. In addition, the length of A  should be maximized.
5 I+ S* q, k% r' _3 @% C我感觉应该是Y型拓扑，而且每个分支都相同
请问你是如何做的？

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说下我的看法
曼哈顿距离是DX和dy的距离之和
布线长度是 total etch langth
6 }  M" ]& ^4 f$ _& ~
3 |& F$ }! q0 q6 Z: P: _0 d8 Z我画的限制在2500 和2600之间

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0 n6 c$ v' v, J# a( U呵呵 不好意思
8 \( ~9 m/ {. \4 T  P这个是ti的DDR2接口的参考指南
0 ]+ J3 K7 U+ I我在上面贴出来了一个pdf地址