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! @' h1 P+ s$ _/ k7 o2 N2.编辑2 L3 h% ~; z4 \+ c1 {, t
了解原理图原件设计的基本原则# l; u' h% H8 {% W9 K+ R" A
手动绘制- O1 \( y) K* {: Q3 s1 b
Component 属性设置; J) n: g3 U' ]; s/ O/ D
3 原理图库更新
, M$ ]. H2 }* {" Q' h( {- s' i 更新到库
: B! V" P' ^" `8 X: |# v3 y( {4、多引脚元器件设计1 |. y1 `/ g6 |# u
检查
+ v" P% w9 i) }' Z& m1 \% y, E' Z8 N6 \# H1 [! f
最近参考了一些书籍和文档，初步学习了一下基本元件封装以及元件库的绘制，现在把我初步了解的学习经验分享给大家。有什么不对的地方，还恳请大家指正。我也会随着后续的学习来不断地更新……4 {5 X @1 e3 H' t8 C9 o4 i, e
, H+ X4 {1 [( O1.新建4 U, Y2 ~/ r# E7 q2 ^
1 k4 s! x% a0 k- b- d
- 可以直接新建一个 .SchLib文件
- 可以在 PCB工程可以添加库文件，Schematic Library、PCB Library 文件
- 可以在Integrated Library工程中添加库文件
5 }9 k3 y% t' N2 B
! Y( A; p4 {: V$ H& @9 {) q( r6 f/ e1 a. H* v, u9 T
2.编辑" u9 g" J' J& N6 U
了解原理图原件设计的基本原则
: _0 c! l: {$ Q( r$ f- 注意电器意义和非电器意义，一般引脚是电气意义的，内部是没有电气意义的。
- 引脚的热点朝外，用于连接的
- Display name ***\ 就是出现上划线，表示低电平有效
- 绘制Component是 尽量放在中心位置，这样使用时便于定位放置
- 原理虽然是示意图，不考虑实际的引脚间距，但是绘制的时候，（栅格大小，引脚间距）尽量统一标准，不然有时对不齐，不美观6 O; G7 M8 L) S# ^* E( s4 g& k
! G7 I; H2 ^1 d
' }! V$ h6 d% H0 K手动绘制
+ ^1 w! |) e6 U& i8 N/ ^
$ ]& X: x" ~+ d w- ?使用Place工具 绘制元件在原理图上的形状和引线
I- Y5 e* q, D. ?1 H" p5 K% a$ s* q g0 R. W1 |# u
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Component 属性设置
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Tools–>Component Properties+ w6 m+ d! J9 i7 O* B
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R" _# l3 {/ c$ i. i
3 原理图库更新" t+ J- j7 U4 D& g: ~
+ ^. f Y' w# n* l- [0 Q/ P
- 自己绘制元件，补充同一类别的原理图库
- 从其他原理图库(SchLib)中粘贴的元件，（可以从SchLib/PCBLib复制，因为可编辑，不能从InitLibz中，不可编辑）; B8 c E" {7 R' D' U/ O; _) X
( a: \8 P; {% w, r8 M- 从一个库中打开，一个一个直接复制粘贴到另一个库中
- 从左侧的SCH Library 器件列表中可以选中多个，复制到另一个库中
- 利用Tools–>移动/复制元器件到某一个库中
2 i8 R! x' d" E- e4 r" k3 o1 Q& a
5 v! U. _4 d( e( P7 O0 F M$ b1 D8 {( M6 B9 N
3、 从原理图(Schdoc)直接生成一个SchLib. Design–>Make Schematic Library/Integrated Library 再 通过方法2的 原理图库复制的方法
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4、从集成库(InitLib) 因为集成库中的元件不可编辑，所以，先把集成库中想要的元件放到原理图上，然后用方法3进行5 E$ A& E# A+ `# _* D( L
1 M/ s {5 f0 V3 V0 z8 J3 }0 }
7 e: ^* d* |5 T- ~" g' d2 q更新到库
) W. ^. [: \, V6 k8 D( \2 b
" Z! M% B. r4 Q5 G! @0 [% @- 首先可以更新库文件
- 然后把库文件更新到原理图中:) e B8 T/ C1 F% G
比如发现某个库文件中的器件需要修改，修改后，update Schematic Library 就会在原理图中更新 O2 t5 ]- y9 }! `
或者在原理图中 Tools–>Updata form Library
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. r" C" L) M) }0 B3 T
4、多引脚元器件设计
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4 D/ t1 |8 N$ M% k! B1 根据芯片手册或者元件Report 自动生成7 x7 o5 b* Q5 q4 l% W
# x4 G. e1 ?) ? g
首先 建立能自动匹配的表格 主要参数4 j+ K8 B9 R4 P7 A$ E* @; P, p* H& [- ~
$ l8 z' X) x3 t$ q2 {
) }/ S3 @/ M) {0 x- V: {7 m% ]5 d% p, x1 t$ i1 X: _: \
根据表格，自动新建一个元件
+ W. E+ `. y$ w; E2 i
. ]. R; i6 W* e+ C3 K然后进行匹配 0 E4 M* f1 J% M) ^. i
选择右下角 SCH–>SCHLIB List–切换到编辑状态， ' S( f; \3 w, W }7 L& r
复制表格—>Smart Grid Insert–就可以看到匹配的引脚端子–>注意热点方向，
2 R* Z- D5 E# B" \3 J- K再画一个矩形框就行。3 s5 @4 G5 q5 R* e! O4 \, d0 Y) q3 c8 c
1 l! L! |9 C1 F+ I7 i
& S. p* h9 r( R) e5 Z- L* w8 Q
2、如果一个器件引脚比较多，或者比较大，可分根据功能分块画，画成Component PartA/PartB4 z& D5 q9 b) y" b) J" U
+ ^/ l/ `& p8 R7 O6 \
检查
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Reports–>Component Rule Check—>主要检查Footprint/Pin Number/Missing Pins in Sequence是否缺省，是否有重复$ C# S& C0 f. b( f3 O2 X
2 r7 a( Q4 b I1 o& M" ]( v, X+ u% W8 `6 Q' l& i: [$ I
检查+ l% C, F' r, U
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Reports–>Component Rule Check 2 K8 {* z% R$ n* v' T m
0 w0 H9 \! x: }9 i% z3 N1 |6 r主要检查Footprint/Pin Number/Missing Pins in Sequence是否缺省，是否有重复
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发表于 2021-4-21 14:08
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