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[毕业设计] 高效低功耗低并行度 LDPC 编码方法

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发表于 2021-2-22 14:53 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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要:低密度奇偶校验码(LDPC)是最接近香农极限的纠错码之一,具有优良的性能且被国际通信标准组织广泛8 s2 K. Z6 B8 N4 I+ w
采纳为信道编码。CCSDS 推荐使用 LDPC 码作为近地空间和深空探测的信道编码方案。该文提出高效,低功耗,) b/ P# c# |1 C/ D9 ^4 m
低并行度的 LDPC 编码方法。该方法通过采用插“0”和改变循环矩阵的结构实现了对 CCSDS 标准中推荐的校验0 \5 l$ c! R/ k( }2 U% u  D) Z
矩阵子矩阵大小为奇数的 LDPC 码的低并行度编码。通过分析编码过程,提出了只对输入信息中的“1”有效信息0 i- p! U1 K3 ?+ L4 \* T$ V
位进行编码的方案,减少了编码中移位寄存器的移位次数,大幅度地降低了编码器功耗。文中采用 FPGA 实现了% I# U5 c$ {+ w6 k6 l8 g
(8176, 7154)78LDPC 码的编码器,结果显示在硬件开销略有增加的情况下,编码功耗大幅度下降,编码速率接近7 q" O8 l9 s3 F! l" l
低并行度编码方案。( Z' I- X  q; G" E) R
关键词:差错控制编码;低并行度;低功耗;QC-LDPCVLSI 设计# d* u8 w. t# f5 m. r
1 引言
9 A- q9 K# ]- I7 o1962 年,MIT GALLAGER 首次提出了低
6 j  y6 R: x8 C% W密度奇偶校验码[1](LDPC ),但是受限于编译码算8 e5 Z- Q: |3 C" P, E5 q
法的复杂性和当时的集成电路制造水平,5 n3 k, A% A6 }6 Q  z( [% S* \
GALLAGER 博士的发现没有引起人们的重视。直4 x! x6 n. O" I* I( A
1993 年,法国学者 BERROU 等人[2]提出了具有9 l6 o9 j  z1 c  M/ [- E! c
接近 Shannon 极限的 Turbo 码之后。剑桥大学的
& M& h( X6 e0 c& M  i1 t5 A! aMACKAY 等 人 [3] 重新对 GALLAGER 提出的" p' E! d/ L  g1 b$ S8 @- q
) T  w1 i1 p- S! {
* s0 j2 [% w0 c$ u! w2 n2 k' z* ?

- b, s9 s& }; Y2 m0 P, N: W& \) ^" ^5 s7 v! F
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发表于 2021-2-22 15:44 | 只看该作者
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