做SI仿真的时候，软件会考虑过孔的影响吗?

keepwalking · 发表于 2020-12-30 15:55

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比如做DDR等等仿真的时候，stackup设置里，pad stack不用管，就能仿真。
但是powerdc仿真电源的时候，就要设置，不设置，会报错提示设置孔的plating thickness。

问题来了。做DDR等SI仿真的时候，软件会把过孔的影响考虑进去吗？

dzkcool · 发表于 2020-12-30 16:27

设置了就会考虑，不设置就不会考虑

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[Cadence Sigrity] 做SI仿真的时候，软件会考虑过孔的影响吗?