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[Cadence Sigrity] 做SI仿真的时候,软件会考虑过孔的影响吗?

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1#
发表于 2020-12-30 15:55 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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比如做DDR等等仿真的时候,stackup设置里,pad stack不用管,就能仿真。
: E2 d6 K% {6 d; j; @- Z但是powerdc仿真电源的时候,就要设置,不设置,会报错提示设置孔的plating thickness。/ L. _+ V( d) {
3 M  k( I" M) r# i. W$ R! i
问题来了。做DDR等SI仿真的时候,软件会把过孔的影响考虑进去吗?
7 x4 j* r' x! o9 x" r+ h- Y' i
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    2#
    发表于 2020-12-30 16:27 | 只看该作者
    设置了就会考虑,不设置就不会考虑
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