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[Cadence Sigrity] DDR仿真,眼图,sigrity

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该用户从未签到

16#
发表于 2022-9-6 17:14 | 只看该作者
a422877308 发表于 2022-8-10 17:36* v$ J2 e9 h, h, P' V6 b
通常来讲,控制器端的眼图(读)要比DRAM颗粒端的眼图(写)质量要好。这主要是PDN的影响,控制器端的PDN往 ...
9 X' X) W6 u: f, C. D4 k+ c
控制器端的PDN差一些,眼图要好?2 a" A! E+ X' c$ u

该用户从未签到

17#
发表于 2022-9-14 21:55 | 只看该作者
1120359104 发表于 2022-9-6 17:14
/ @4 J+ e! o- |5 x! x  m" ~8 o控制器端的PDN差一些,眼图要好?

  D5 n- _+ g+ T  t: F( g, f+ w( M什么理解水平呀

该用户从未签到

18#
发表于 2022-11-9 09:17 | 只看该作者
你可爱的老爷 发表于 2020-12-16 20:09. Q6 E- i: K. w0 Z' {
速率不一像 采样叠加的眼图大小就不一样,眼图看整正常睁开 基本就没有问题

  Z* L" L8 N. J1 P1 l9 z6 v# A' n, k7 x/ ^DDR3的clk单根波形是这样是啥原因呀
* f/ ~$ X) F! Q1 ^

ddr.jpg (37.66 KB, 下载次数: 0)

ddr.jpg

点评

波形负责很小,对比幅值1.4v的那个是CKE的  详情 回复 发表于 2022-11-9 09:18

该用户从未签到

19#
发表于 2022-11-9 09:18 | 只看该作者
1120359104 发表于 2022-11-9 09:17
4 R! j3 W2 D* W0 F5 {* ODDR3的clk单根波形是这样是啥原因呀

  m; J5 W  s' E8 R波形负责很小,对比幅值1.4v的那个是CKE的
! W. J5 I' ?* I" m0 d, v/ P
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