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[仿真讨论] DQS与CLK的training

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  • TA的每日心情
    开心
    2022-1-4 15:56
  • 签到天数: 87 天

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    1#
    发表于 2020-12-8 15:45 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    对于DDR4有一个write leveling的功能,所以芯片内部会有training来达到它们匹配的延时,然后PCB板上再做差分内部等长就可以了,不需要DQS与CLK等长,但是为什么板上做了等长,测试出来的结果还有问题,测试结果如图,多谢
    - A$ V" C% {# z) M# v

    该用户从未签到

    2#
    发表于 2020-12-8 16:46 | 只看该作者
    帮你顶一下
  • TA的每日心情
    开心
    2022-1-4 15:56
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    [LV.6]常住居民II

    3#
     楼主| 发表于 2020-12-10 11:01 | 只看该作者
    有好心人出来帮忙回答一下呢,谢谢
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