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[Cadence Sigrity] 求助:一对LVDS差分线仿真

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  • TA的每日心情
    慵懒
    2023-1-31 15:12
  • 签到天数: 491 天

    [LV.9]以坛为家II

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    1#
    发表于 2020-11-12 13:41 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    初学仿真,一对LVDS差分信号的反射,有如下问题:1.把连接器端设置驱动端,mcu设置成接收端,会提醒与模型设置不符。(模型为NC,设置NC时会报错没有驱动/接收端)
    3 g" Z8 A% ]7 s  z5 n; z8 ^2.一个HSD连接器传输过来的LVDS信号,另一个脚的连线拓扑也会显示在LVDS信号拓扑中。
    % f5 U8 ]( d/ H4 r2 h3.差分的拓扑也很奇怪,不像是成对信号的。
    & Q; A$ q3 V! p6 ~! V1 g* A6 g
    5 X8 J  S7 G& N0 K2 V; w+ \2 m2 p
    ( C) t/ B/ f/ y各位路过,能说两句就说两句吧,仿真好难
    3 B& L  q9 H  V" T; t

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    lvds信号.jpg

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    拓扑.jpg

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    ERROR.jpg
  • TA的每日心情
    开心
    2024-2-21 15:59
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    [LV.8]以坛为家I

    推荐
    发表于 2020-11-13 09:21 | 只看该作者
    你用的这个其实不是Sigrity,而是Cadence老的仿真工具,建议用Sigrty的PowerSI提取PCB上的链路模型后,到SystemSI中搭链路仿真,具体方法可以参考电巢学堂的视频课程《信号完整性仿真实训营》

    点评

    我去试一试,谢谢杜老师~  详情 回复 发表于 2020-11-13 10:09

    该用户从未签到

    3#
    发表于 2020-11-12 19:31 | 只看该作者
    你这个确实有点奇怪。

    点评

    是的啊,蒙了~  详情 回复 发表于 2020-11-13 10:10
  • TA的每日心情
    慵懒
    2023-1-31 15:12
  • 签到天数: 491 天

    [LV.9]以坛为家II

    5#
     楼主| 发表于 2020-11-13 10:09 | 只看该作者
    本帖最后由 nene 于 2020-11-13 10:12 编辑
    1 S' h0 \; }  R/ L+ A
    dzkcool 发表于 2020-11-13 09:21
    + w- _7 n5 H; g# t你用的这个其实不是Sigrity,而是Cadence老的仿真工具,建议用Sigrty的PowerSI提取PCB上的链路模型后,到Sy ...

    3 ^2 y4 K2 v, y3 v我去试一试,谢谢杜老师~,顺便问一下,这个自带的仿真工具已经不能用来做仿真了吗?
    * G) V/ _$ f, r; s

    点评

    当然能做啊  详情 回复 发表于 2022-4-21 15:48
  • TA的每日心情
    慵懒
    2023-1-31 15:12
  • 签到天数: 491 天

    [LV.9]以坛为家II

    6#
     楼主| 发表于 2020-11-13 10:10 | 只看该作者
    yxlk 发表于 2020-11-12 19:31
    9 _: ^) w- j; }4 ]. N' G& _你这个确实有点奇怪。
    + f7 S' D0 g" q1 i3 _) k
    是的啊,蒙了~

    该用户从未签到

    7#
    发表于 2020-11-13 10:27 | 只看该作者
    谢谢楼主分享
    9 i# Q2 Z& {' R+ n7 V7 v7 z4 N% z

    该用户从未签到

    8#
    发表于 2022-4-21 15:48 | 只看该作者
    nene 发表于 2020-11-13 10:094 E1 u5 ]. b6 p8 x; l  v: S
    我去试一试,谢谢杜老师~,顺便问一下,这个自带的仿真工具已经不能用来做仿真了吗?

    - s) s2 S9 K. p) ~( F当然能做啊% x; z/ d* n2 {  j
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