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[仿真讨论] 有关叠层问题请教大神。

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1#
发表于 2020-11-11 16:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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四层板(机顶盒)叠层情况如下:1 `: b% g; }! E- c  u7 F
top          signal  (主芯片、大部分元件)
) ~& |, ~; {! o# ~% j1 W' y1 Qin2           GND; V6 c7 `/ C  L! P
in3           POWER
6 ]7 ~% @  s/ |$ i/ zbottom    signal    (小部分元件)
; M  J! P# P& [; ~% U5 y这里第二层完整的地保证了顶层信号线的阻抗连续,确保了信号的完整性;( @% i" H6 H1 K8 [, w0 O7 F
但是第三层的POWER有没有什么影响?请教大神,非常感谢!5 U0 ~3 M  m1 f5 M% P
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    [LV.8]以坛为家I

    推荐
    发表于 2020-11-11 17:36 | 只看该作者
    注意底层高速、时钟等信号不要跨第三层分割。

    该用户从未签到

    2#
    发表于 2020-11-11 16:32 | 只看该作者
    如果你的信号速率不是特别高,没有太大影响。

    该用户从未签到

    3#
    发表于 2020-11-11 16:33 | 只看该作者
    且一般四层板的叠层都是这么弄的。
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