基于FPGA的NoC验证平台的构建

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半导体工艺技术进入深亚微米时代后，基于总线系统芯片SoC(Svstem on Chip)的体系结构在物理设计、通信带宽以及功耗等方面无法满足未来多IP体系发展的需求。片上网络NoC(Netwotlk on Chip)是一种新的系统芯片体系结构，其思想是将计算机网络技术移植到系统芯片设计中来，从体系结构上彻底解决总线架构带来的问题。

　　研究人员从拓扑结构、路由算法、交换策略以及流控机制等多个方面对NoC进行研究，但是如何构建NoC验证平台，快速得到NoC的性能也一直是NoC研究的重点。

　　在过去的几年里，一些研究机构提出了对于NoC不同抽象层次的验证方法的研究，一般的NoC验证是基于软件的仿真和建模，如：用C、C++、SvstEMC进行系统级建模仿真，这样验证很灵活，但在仿真时间上却开销很大。本文提出的基于FPGA的NoC验证平台在仿真速度方面是一般基于HDL的软件仿真的16 000倍，而基于PC机编写的NoC软件更增强了该平台的灵活性和实用性。

wuke8

一般的NoC验证是基于软件的仿真和建模，如：用C、C++、SvstEMC进行系统级建模仿真，这样验证很灵活，但在仿真时间上却开销很大。

骁染0

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