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[Cadence Sigrity] 问个理论问题,PCIE4.0的频谱有效带宽可能在30Ghz,那么为什么看insertion loss在8G...

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该用户从未签到

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1#
发表于 2020-8-12 00:12 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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问个理论问题,PCIE4.0的频谱有效带宽可能在30Ghz,那么为什么看insertion loss在8G(协议有标识),而不是在有效带宽频率点看insertion loss。
9 s# e9 E' k& k1 R# [# x$ r

该用户从未签到

2#
发表于 2020-8-12 09:05 | 只看该作者
楼主别急,帮你问问,你也可以@版主试试哦!
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    2023-5-15 15:14
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    3#
    发表于 2020-8-12 09:05 | 只看该作者
    PCIE4.0我们公司也用
  • TA的每日心情
    开心
    2025-3-7 15:07
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    4#
    发表于 2020-8-12 09:55 | 只看该作者
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    5#
    发表于 2020-9-9 07:43 | 只看该作者
    主要能量在8g 附近吧,其他是谐波分量,可有可无,我觉得

    “来自电巢APP”

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