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[求助类] EMC晶振铺地问题?无源晶振,有源晶振铺铜有区别吗?

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1#
发表于 2020-7-28 21:45 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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EMC晶振铺地问题?无源晶振,有源晶振铺铜有区别吗?
7 ~* {5 |8 S8 d6 ~7 q# [- K% s

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2#
发表于 2020-7-29 08:07 | 只看该作者
可以看下这个帖子
6 i) H; |% s- I) B; a5 d2 }8 X9 R晶体和晶振的区别与联系及EMC的处理2 |( f& o& D4 J" _; c' d
https://www.eda365.com/forum.php?mod=viewthread&tid=345443&fromuid=362945# r8 \9 G% `7 B" [% u
(出处: EDA365电子论坛网)7 }' I& x  i1 b1 u' B0 g% u

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4#
发表于 2020-7-29 09:51 | 只看该作者
晶振和晶体都不要包地,容易接受静电辐射,引发晶振电路故障,从而导致工作中断重启等现象。贴片的按照正常做法即可,当作正常的零部件。插件类阵脚附近建议不要走线。

点评

我们公司目前做法晶振全部包地,打地孔,按您说的会有ESD风险,请问不包地的话会有辐射风险吗?然后还有什么需要注意的~  详情 回复 发表于 2020-7-30 15:11
收到,谢谢  详情 回复 发表于 2020-7-29 16:54

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5#
 楼主| 发表于 2020-7-29 16:54 | 只看该作者
littleant 发表于 2020-7-29 09:51
3 w1 s& M  Q: S6 T0 x+ L# i晶振和晶体都不要包地,容易接受静电辐射,引发晶振电路故障,从而导致工作中断重启等现象。贴片的按照正常 ...

0 N0 w- e% C; Z6 y收到,谢谢: Z, Q& \8 }1 s$ k6 N3 e
% N( V* [# W# `) Q

$ m1 L0 e+ y; M% ^
+ q/ Y6 k( k# h7 z  n

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6#
发表于 2020-7-30 15:11 | 只看该作者
littleant 发表于 2020-7-29 09:51, l8 v$ y( n& ^5 ~7 I5 E
晶振和晶体都不要包地,容易接受静电辐射,引发晶振电路故障,从而导致工作中断重启等现象。贴片的按照正常 ...

% E: ~: @: L% Z% |: C我们公司目前做法晶振全部包地,打地孔,按您说的会有ESD风险,请问不包地的话会有辐射风险吗?然后还有什么需要注意的~
+ `8 y9 J, I: s3 W7 B9 q

点评

不会有辐射风险。详细见答疑部分。  详情 回复 发表于 2020-7-31 13:16

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7#
发表于 2020-7-31 13:16 | 只看该作者
被我折服 发表于 2020-7-30 15:11
% t$ _7 J) m, K, m我们公司目前做法晶振全部包地,打地孔,按您说的会有ESD风险,请问不包地的话会有辐射风险吗?然后还有 ...
6 {9 e" F% Z7 i! |2 w1 x# C  J
不会有辐射风险。详细见答疑部分。; |- `4 c$ Z' ^: B" @

点评

老师,听说晶振尽量与接口/板边保持1000Mil有这回事吗? 另外如果因为空间限制,晶振离接口只有100Mil,怎么处理,包地会不会好点?  详情 回复 发表于 2020-9-27 14:40

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8#
发表于 2020-9-27 14:40 | 只看该作者
littleant 发表于 2020-7-31 13:16% e/ G+ q$ V( ~
不会有辐射风险。详细见答疑部分。

0 z, b, U) R% w7 e# B! }老师,听说晶振尽量与接口/板边保持1000Mil有这回事吗?/ l: q4 s% W$ l' X- K8 A1 P% ~
! y$ W, P7 G; R! R
另外如果因为空间限制,晶振离接口只有100Mil,怎么处理,包地会不会好点?
8 M3 H* q' s2 S3 `; a& f  {; B

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9#
发表于 2020-10-19 21:42 | 只看该作者
快速傅里叶变换(fft\ifft)C语言实现

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10#
发表于 2021-2-4 14:40 | 只看该作者
真的是各家说各家的

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11#
发表于 2021-2-6 16:26 | 只看该作者
66666666666666

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12#
发表于 2021-2-19 21:17 | 只看该作者
谢谢分享

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