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[求助类] EMC晶振铺地问题?无源晶振,有源晶振铺铜有区别吗?

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1#
发表于 2020-7-28 21:45 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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EMC晶振铺地问题?无源晶振,有源晶振铺铜有区别吗?$ e2 A4 u, I9 ~1 C$ I+ c7 O3 K

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2#
发表于 2020-7-29 08:07 | 只看该作者
可以看下这个帖子
+ o2 R, i: E5 s  k2 U晶体和晶振的区别与联系及EMC的处理
4 Q/ i3 v) U; h0 X) Vhttps://www.eda365.com/forum.php?mod=viewthread&tid=345443&fromuid=362945
! E. s, B7 q1 C2 u6 F3 s(出处: EDA365电子论坛网)8 g& D* P" E, W

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4#
发表于 2020-7-29 09:51 | 只看该作者
晶振和晶体都不要包地,容易接受静电辐射,引发晶振电路故障,从而导致工作中断重启等现象。贴片的按照正常做法即可,当作正常的零部件。插件类阵脚附近建议不要走线。

点评

我们公司目前做法晶振全部包地,打地孔,按您说的会有ESD风险,请问不包地的话会有辐射风险吗?然后还有什么需要注意的~  详情 回复 发表于 2020-7-30 15:11
收到,谢谢  详情 回复 发表于 2020-7-29 16:54

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5#
 楼主| 发表于 2020-7-29 16:54 | 只看该作者
littleant 发表于 2020-7-29 09:51
! Y6 x2 @1 W0 z( x晶振和晶体都不要包地,容易接受静电辐射,引发晶振电路故障,从而导致工作中断重启等现象。贴片的按照正常 ...
4 ?4 g) t/ x7 u0 S" ?
收到,谢谢
; ~% k: V3 _0 F' Z9 @( P( n8 s
- i4 o4 _0 T- ^
) \4 t9 d* e0 o4 j% T4 Q" a+ T- \" c+ L) P: M# X+ c

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6#
发表于 2020-7-30 15:11 | 只看该作者
littleant 发表于 2020-7-29 09:511 ]1 d6 y, Q; R! w; @
晶振和晶体都不要包地,容易接受静电辐射,引发晶振电路故障,从而导致工作中断重启等现象。贴片的按照正常 ...
% @5 z4 A4 {3 N/ F& `# G
我们公司目前做法晶振全部包地,打地孔,按您说的会有ESD风险,请问不包地的话会有辐射风险吗?然后还有什么需要注意的~5 j1 M8 o" B* x7 I" t: g

点评

不会有辐射风险。详细见答疑部分。  详情 回复 发表于 2020-7-31 13:16

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7#
发表于 2020-7-31 13:16 | 只看该作者
被我折服 发表于 2020-7-30 15:11
0 Y5 u' ^2 A4 J1 Z我们公司目前做法晶振全部包地,打地孔,按您说的会有ESD风险,请问不包地的话会有辐射风险吗?然后还有 ...
& A8 g# M1 n5 W4 V3 x5 i! j. |5 l  `
不会有辐射风险。详细见答疑部分。
, E- Y- w* Z0 }  G4 @+ w1 b

点评

老师,听说晶振尽量与接口/板边保持1000Mil有这回事吗? 另外如果因为空间限制,晶振离接口只有100Mil,怎么处理,包地会不会好点?  详情 回复 发表于 2020-9-27 14:40

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8#
发表于 2020-9-27 14:40 | 只看该作者
littleant 发表于 2020-7-31 13:16
; L6 c% W+ L/ i) k( K( d不会有辐射风险。详细见答疑部分。
# m/ V3 `' a! c$ U) t  t, x( Z
老师,听说晶振尽量与接口/板边保持1000Mil有这回事吗?
" i) O( y' B: B, d( f3 z
. o1 G2 f- N. [; J- G7 z另外如果因为空间限制,晶振离接口只有100Mil,怎么处理,包地会不会好点?; r' k7 w! W, s) E$ g) ]$ x

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9#
发表于 2020-10-19 21:42 | 只看该作者
快速傅里叶变换(fft\ifft)C语言实现

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10#
发表于 2021-2-4 14:40 | 只看该作者
真的是各家说各家的

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11#
发表于 2021-2-6 16:26 | 只看该作者
66666666666666

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12#
发表于 2021-2-19 21:17 | 只看该作者
谢谢分享

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