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原理图常见错误
! p6 G+ `* }6 m. Z
( v! W& t# j* f+ l8 q（1）ERC报告管脚没有接入信号：* V/ S1 T8 z- R
?# I0 o5 L# h4 ^4 K
a. 创建封装时给管脚定义了I/O属性；6 w+ O" M0 q% `9 j' ^ `; ]$ b% N
# r& x$ ~, P! t* _( m" O) [b.创建元件或放置元件时修改了不一致的grid属性，管脚与线没有连上；8 r: G5 _1 ^2 ^1 q2 K+ Q& P# v" E
# D( ^5 _: f$ ^1 U3 Nc. 创建元件时pin方向反向，必须非pin name端连线。7 m1 i2 {% }3 c; E+ [
# i3 V' W8 G# O4 ]( ^3 x& dd.而最常见的原因，是没有建立工程文件，这是初学者最容易犯的错误。: w4 O2 o% c, k6 _* V1 V
, W+ L! K& t! `* I/ P6 F$ l
2）元件跑到图纸界外：没有在元件库图表纸中心创建元件。3 y# G7 ]7 P$ [- x8 p' }! G
: M" x( m/ X: n) F
3）创建的工程文件网络表只能部分调入pcb：生成netlist时没有选择为global。% r6 k9 m) U% ?3 u" ]4 Z( j
+ D9 z$ N# o. |. s9 v+ I: Q4）当使用自己创建的多部分组成的元件时，千万不要使用annotate.! n! T8 S' S- Z- [
6 b* p) K3 U0 c+ H! f; h4 n# I
0 x& s: L) H# I* `% V0 V; }
% y* A' B4 d! K* y6 B, ~
PCB常见错误# n X: c8 |0 G* K" q( r
5 @7 l' C; }$ L: [! \7 T0 P
（1）网络载入时报告NODE没有找到
& O3 c3 Y- k- X( q
/ s, r4 x8 m: ?2 Na. 原理图中的元件使用了pcb库中没有的封装；
. A8 x. B! j( b1 Z( Q/ U4 T- v. C1 V ?4 ?! M9 q& z6 A
b. 原理图中的元件使用了pcb库中名称不一致的封装；
! J& v9 l" `2 x" M# ?- W! s( W) I2 ?+ q- m3 [. S$ t5 V& G
c. 原理图中的元件使用了pcb库中pin number不一致的封装。& V4 v+ ^( R' f! ?; A) q
5 J% o. z9 d* d& b. L( v
如三极管：sch中pin number 为e,b,c, 而pcb中为1，2，3。# i- }. @ H7 g# s- h( m b
; N: j6 ?9 {, a A
（2）打印时总是不能打印到一页纸上+ J+ |; ], ^* R- u7 B
/ P9 |, U& R5 w; K& R
a. 创建pcb库时没有在原点；+ {; b( J) C1 n P/ B
! N* c. U7 o' A! G+ O
b. 多次移动和旋转了元件，pcb板界外有隐藏的字符。选择显示所有隐藏的字符，缩小pcb, 然后移动字符到边界内。
4 N$ B# n9 n7 i) f- K4 \
0 |% S" j9 L5 W! j* O/ l（3）DRC报告网络被分成几个部分：
8 l/ o1 c- B6 O" \! v/ v; M- p
; t$ z% D+ R! s7 C4 r5 b; S" I' n表示这个网络没有连通，看报告文件，使用选择CONNECTED COPPER查找。: x$ R% H+ H. j
J g6 p) i9 N
如果作较复杂得设计，尽量不要使用自动布线。% z, E' |' {3 M" G' I5 O
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发表于 2020-7-20 11:24
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