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verlog 的小问题 assign {a,b}=c+d; 这是什么意思

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1#
发表于 2020-7-15 10:23 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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assign {a,b}=c+d;
  y$ H9 s. I5 L5 [' ?这句话的意思是不是就是  a=b=c+d?8 i+ s% h0 R5 _% u  Q$ Q0 @) Q+ @
我是新手 还望指教
7 u0 e9 T1 f  w, C6 T

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2#
发表于 2020-7-15 10:23 | 只看该作者
{}是拼接符号,
0 V) ^7 Y. S0 }0 @5 P/ S( J$ Ha,b都是位信号,用这个操作符就表示两个bit位。
9 T8 A  b& P3 w  K% w. O& pab     c      d& ?2 B- G* l& i/ J4 @/ H2 G# m: j
10  = 1 + 1

点评

这样啊 ,我懂了  详情 回复 发表于 2020-7-15 10:24

该用户从未签到

3#
 楼主| 发表于 2020-7-15 10:24 | 只看该作者
wuke8 发表于 2020-7-15 10:23+ V) j, |3 H7 O* _! C
{}是拼接符号,4 J% y3 T5 [, H& r! X
a,b都是位信号,用这个操作符就表示两个bit位。
: D3 L- c& y6 G- V! f0 {ab     c      d

1 _" d0 W$ Y; K" J% j3 {( m# P这样啊 ,我懂了
' k: Y4 ^, w# ?( j$ W
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