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[Cadence Sigrity] DDR仿真第8期从power si提取参数到system si仿真波形差别那么大?

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发表于 2020-6-1 23:35 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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杜老师DDR 第八期:自己从Power si提取参数到,ystem si PCB导入.CKT文件。其他IBIS模型,VRM,VTT都不变。仿真的数据波形幅度很低,明显有问题;模型参数文件名字:531_power_si_save
/ ^. U4 M+ v5 t' @对比模型参数和课程上的也差别不大,求大神帮忙看看?2 }- Q6 q  |4 q+ l" y6 s  A
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531_power_si_save.rar

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    [LV.8]以坛为家I

    2#
    发表于 2020-6-2 08:28 | 只看该作者
    本帖最后由 dzkcool 于 2020-6-2 08:30 编辑 . I$ {  I& W- f  M' U, g

    4 e1 j5 {/ \) {) k4 C6 c3 i; B1 Z0 k十有八九是S参数提取的问题,或者是SystemSI中设置不正确,可以对照公众号中的操作指引查一下哪个步骤不对,或者回头看下回放公众号文章链接:https://mp.weixin.qq.com/s/VWf9M7njmRgY3EaJQGPo5A/ p! T; d6 ~/ _- O! V  n8 _& v

    点评

    System SI换成您那边提供的PCB S参数模型就是正确的。我觉得设置应该没问题,提取S参数可能有点问题,昨晚提取了很多次都是错误的。也没发现提取那里有问题,并且SPD我都没改,直接用的您设置的,跑完了直接保存。老  详情 回复 发表于 2020-6-2 11:06

    该用户从未签到

    3#
     楼主| 发表于 2020-6-2 11:06 | 只看该作者
    dzkcool 发表于 2020-6-2 08:28, F  {" V* F2 {/ A. U
    十有八九是S参数提取的问题,或者是SystemSI中设置不正确,可以对照公众号中的操作指引查一下哪个步骤不对 ...
    ! c( {, c0 G" C. w$ L  H# T
    System SI换成您那边提供的PCB S参数模型就是正确的。我觉得设置应该没问题,提取S参数可能有点问题,昨晚提取了很多次都是错误的。也没发现提取那里有问题,并且SPD我都没改,直接用的您设置的,跑完了直接保存。老师可以看看附件S参数那里有问题嘛,谢谢!& U' X) m4 i% I4 K4 l
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    [LV.8]以坛为家I

    4#
    发表于 2020-6-2 11:18 | 只看该作者
    我看你用的是2018,换成2019试试

    点评

    跟版本无关,解决了。很久之前就卡这里了。  详情 回复 发表于 2020-6-2 23:09

    该用户从未签到

    5#
     楼主| 发表于 2020-6-2 23:09 | 只看该作者
    dzkcool 发表于 2020-6-2 11:18
    ! a) S. q1 A# p. L. W2 B% |- @2 b* g: R5 }我看你用的是2018,换成2019试试
    ' A- s1 U2 n, \! Y; D
    跟版本无关,解决了。很久之前就卡这里了。/ y' A: p, a$ a$ x. R1 g0 S5 L

    点评

    咋解决的 也谢谢心得,帮助后面的人解决问题  详情 回复 发表于 2021-4-9 13:25

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    6#
    发表于 2021-4-9 13:25 | 只看该作者
    hyxs714154 发表于 2020-6-2 23:09
    $ y) @" C8 x6 M4 h9 Z跟版本无关,解决了。很久之前就卡这里了。

    : J/ E  q/ Y! C# J8 [咋解决的  也谢谢心得,帮助后面的人解决问题

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    7#
    发表于 2021-4-20 18:01 | 只看该作者
    您好,请问DDR3仿真怎么加上VTT上拉电阻,谢谢!
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