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[Cadence Sigrity] 请教:等长设置的最大误差问题

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1#
发表于 2010-7-6 09:22 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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如果跑80-125M的速率,且最长线与最短线相差880mil,这种情况不考虑等长可以吗?8 ~+ M4 o% A% ^  M
请教" ^, z! e! K% [& W( B! ^
望大家给点意见,谢谢

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2#
发表于 2010-7-6 20:14 | 只看该作者
将880mil近似等效成时间,看看占时序的百分比大不大,如果你是做一个功能实验板,应该没什么问题。如果是要严格性能要求的板卡,则必须较小这个误差。

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3#
 楼主| 发表于 2010-7-6 20:47 | 只看该作者
回复 2# joshuafu & B. G  j: N; T. Y9 b
5 P* ^" b! a* Y+ T6 e2 a3 m2 t
$ a! L8 N: N$ Q2 F3 b2 r
    是DAC的数据线
" j# f; w0 c! q8 J3 O$ ?/ v是不是根据公式t=L/v,v=c/(E的根号) 其中(E为介电常数,c为光速,L长度,v是速率 )这里的L=880mil,E=3.66,带入算的t=0.2ns左右,对80-125M的速率的延迟有影响吗?

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4#
发表于 2010-9-10 16:05 | 只看该作者
关键在于你的始终或者控制线与数据线相差多少,能否满足建立保持时间
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