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请教问题（fpga）

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cwfang

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1#
发表于 2010-5-31 09:53 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
现在想要设计一个原理图，ad输入，da输出。/ @: V$ W) D; C7 @
其中ad芯片输出的是lvds信号（500M），给一个高速FPGA（信号的频率会降到250M)，然后高速fpga给一个大容量的fpga，接着信号（250M)又给另一个高速fpga。然后输出lvds信号（500M）给da芯片。  R9 V/ F, p  b; J  w, h8 q
, O6 E1 _  o+ J' @
现在想问的是高速fpga输出的是lvds信号还是普通的ttl信号好实现？

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cwfang

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2#
 楼主| 发表于 2010-6-1 11:17 | 只看该作者
回复 1# cwfang 4 c% Y3 n  t8 m) o

3 h1 o% v( K/ l% i& W& S
4 H7 `4 d9 h  n+ x! Y9 a- D    这个问题怎么没人响应呢

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weign

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3#
发表于 2010-6-1 21:20 | 只看该作者
信号降到250M,你是打算做拼字处理吗?给一个大容量FPGA,接着又给另一个高速FPGA...看不明白,为什么不直接使用一个大容量的FPGA呢?如virtex5系列...5 f7 d3 [! ?1 J. @1 b- @
+ b; c$ V+ ]% V2 e9 N8 h8 ]
使用lvds电平....

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cwfang

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4#
 楼主| 发表于 2010-6-2 08:26 | 只看该作者
回复 3# weign
' E4 z$ a$ E7 m3 ^( Z0 A. P- |# Z* e7 k& J: P

% u* ]( q9 e( z8 x  I% [    高速FPGA只用来处理信号，不占用内部资源。而大容量FPGA相当于一个RAM。如果只用一个大容量的FPGA，我们已经做了一板了，只能达到200M。用的芯片是stratix2的片子

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uestczgm

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5#
发表于 2010-6-2 20:38 | 只看该作者
那么高频率自然用lvds了

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weign

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6#
发表于 2010-6-2 23:34 | 只看该作者
回复 4# cwfang . O; A0 G. ^, L9 @
  s$ C5 j) L% d6 B4 [& Q  F* W
7 g$ N; o* f7 Y: O) f+ b/ ^( V
   感觉很浪费...altera的片子只用过cyclone3,跑过400MHz,没问题...

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cwfang

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7#
 楼主| 发表于 2010-6-3 08:14 | 只看该作者
回复 6# weign * C$ C" H' F" D$ W' w
% |; i$ U+ H( _; v6 B/ x, y
) ]* X% }# `2 W4 T* E  w
    IO的速率能达到，没问题的。只是内部处理的时候，速度达不到

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weign

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8#
发表于 2010-6-3 19:40 | 只看该作者
回复 7# cwfang
. u# F; Z6 X5 R- B- K0 _3 A" x$ U+ p4 P2 J- d( e) |
+ z, }: [4 r% j; J
   我是做硬件的,FPGA代码偶尔才写...尝试使用片内总线做高速互联,数据分模块同步处理,再在模块中使用流水线式处理,注意单位模块cash的算法...不知道这个提议是否有帮助

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cwfang

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9#
 楼主| 发表于 2010-6-3 20:44 | 只看该作者
回复 8# weign
$ M0 G& W4 H7 V# k* O! n' G+ x* J" }( ^7 ]& y5 f

0 G; @! a) x$ ~5 ]- i0 `   恩， 谢谢哦！

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