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请教问题(fpga)

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1#
发表于 2010-5-31 09:53 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
现在想要设计一个原理图,ad输入,da输出。8 ^7 k/ g9 h" ~8 |
其中ad芯片输出的是lvds信号(500M),给一个高速FPGA(信号的频率会降到250M),然后高速fpga给一个大容量的fpga,接着信号(250M)又给另一个高速fpga。然后输出lvds信号(500M)给da芯片。
6 t* C0 ^) N" D
# }" i2 n, F( Z. {; k* N/ Y; N现在想问的是高速fpga输出的是lvds信号还是普通的ttl信号好实现?

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2#
 楼主| 发表于 2010-6-1 11:17 | 只看该作者
回复 1# cwfang
3 @4 q. W/ h% K1 P3 P1 G! a, H) \
+ [7 H6 ~7 h3 A4 Y4 E9 |" c
) |4 L6 E" D1 w  e& c# d    这个问题怎么没人响应呢

该用户从未签到

3#
发表于 2010-6-1 21:20 | 只看该作者
信号降到250M,你是打算做拼字处理吗?给一个大容量FPGA,接着又给另一个高速FPGA...看不明白,为什么不直接使用一个大容量的FPGA呢?如virtex5系列...( I9 e% O0 ~0 U: q1 c' L/ K. r- A

  N  _/ m% A/ h6 Q, I8 f使用lvds电平....

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4#
 楼主| 发表于 2010-6-2 08:26 | 只看该作者
回复 3# weign . Y5 {9 G! Q5 h

; a8 w8 G7 f8 v7 v7 t% [+ [
# j, }# R9 j1 S0 B    高速FPGA只用来处理信号,不占用内部资源。而大容量FPGA相当于一个RAM。如果只用一个大容量的FPGA,我们已经做了一板了,只能达到200M。用的芯片是stratix2的片子

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5#
发表于 2010-6-2 20:38 | 只看该作者
那么高频率自然用lvds了

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6#
发表于 2010-6-2 23:34 | 只看该作者
回复 4# cwfang
$ p  \: b/ Z) E3 h! b8 A/ ?( D% w' @, y* n+ R. }5 M

5 f; X2 t5 H, s& f   感觉很浪费...altera的片子只用过cyclone3,跑过400MHz,没问题...

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7#
 楼主| 发表于 2010-6-3 08:14 | 只看该作者
回复 6# weign
8 D) o/ ~: i" ]/ q8 K" J+ M
6 Y- l+ F! H$ V% [1 J! i: g# K9 `
    IO的速率能达到,没问题的。只是内部处理的时候,速度达不到

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8#
发表于 2010-6-3 19:40 | 只看该作者
回复 7# cwfang 4 G; I/ Y! l5 `( n5 P* }/ n) X+ t" S* b

: _, ]& R- l9 |" u5 X# t+ o: n  m, p  A/ r* U8 a) g4 G
   我是做硬件的,FPGA代码偶尔才写...尝试使用片内总线做高速互联,数据分模块同步处理,再在模块中使用流水线式处理,注意单位模块cash的算法...不知道这个提议是否有帮助

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9#
 楼主| 发表于 2010-6-3 20:44 | 只看该作者
回复 8# weign
+ `0 {6 ~4 u# i
8 l- @3 O' ~: U$ P9 |1 _; `- P
% ~( m$ U3 ]& S; G9 B' K1 c   恩, 谢谢哦!
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