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[求助类] 在进行EMC测试时有哪些规范需要我们注意?

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1#
发表于 2020-3-25 09:19 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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电磁干扰的三要素是干扰源、干扰传输途径、干扰接收器。EMC就围绕这些问题进行研究。最基本的干扰抑制技术是屏蔽、滤波、接地。它们主要用来切断干扰的传输途径。广义的电磁兼容控制技术包括抑制干扰源的发射和提高干扰接收器的敏感度,但已延伸到其他学科领域。

  在印制电路板设计阶段对电磁兼容考虑将减少电路在样机中发生电磁干扰,问题的种类包括公共阻抗耦合、串扰、高频载流导线产生的辐射和通过由互连布线和印制线形成的回路拾取噪声等,那么在进行EMC测试时具体有哪些规范需要我们注意?


- X" N2 D' x! B5 C: _5 D- ]' z

该用户从未签到

2#
发表于 2020-3-25 12:30 | 只看该作者
在高速逻辑电路里,这类问题特别脆弱,原因很多:
$ v: o, r3 J: a' g( [" U, d0 a1 v( G% S& U  `* I1 N
  1、电源与地线的阻抗随频率增加而增加,公共阻抗耦合的发生比较频繁;
' r4 g! X& l# |' m6 I# n+ `# D7 i0 r: H% _! `$ V4 X
  2、信号频率较高,通过寄生电容耦合到步线较有效,串扰发生更容易;/ O( `( O' T" e# H

9 }1 D$ E: e! S$ p5 C$ o% z  3、信号回路尺寸与时钟频率及其谐波的波长相比拟,辐射更加显著。$ ~4 x. W! `# ~3 e3 F! `

/ p  ]  x4 N+ `6 }  4、引起信号线路反射的阻抗不匹配问题。
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