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电路图导入到线路图时,报错了!求解

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1#
发表于 2020-3-12 21:06 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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电路图DRC正常,然后导入到线路图时,报错了!求解啊5 Z9 D0 n4 d% E1 T9 e
2 d- s+ k! d9 ^$ N; a
$ d  r, o7 H0 i) S9 T

3 l: b& Y. E- Q! [

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2#
发表于 2020-3-13 10:43 | 只看该作者
点击执行试试,这里报错不一定真的错

点评

请问下他报错那里是指的什么意思?  详情 回复 发表于 2020-3-13 11:54

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3#
发表于 2020-3-13 11:54 | 只看该作者
yihafewu 发表于 2020-3-13 10:431 W0 X& z6 T& R4 [( N1 ~" x  F* h
点击执行试试,这里报错不一定真的错
+ A* D1 K$ W7 l" H( F+ J9 Z
请问下他报错那里是指的什么意思?
" ]/ C) d0 w; c" h; j

点评

楼主在原理图里设置了几个差分对,每个差分对都有两个网络,但是在导入PCB前,PCB里是没有这些网络的, 所以软件告诉我们它没办法来分配差分对。 但是点击执行后, 随着前面步骤的完成,PCB中就有这些网络  详情 回复 发表于 2020-3-13 13:14

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4#
发表于 2020-3-13 13:14 | 只看该作者
陈献谋 发表于 2020-3-13 11:54' A9 R% _  Y6 g8 g: f
请问下他报错那里是指的什么意思?
: g5 s( J' C  E0 s, h
楼主在原理图里设置了几个差分对,每个差分对都有两个网络,但是在导入PCB前,PCB里是没有这些网络的,
2 @3 H5 s0 R: t/ N8 \* a$ {  E4 r. h所以软件告诉我们它没办法来分配差分对。" m$ e/ ]6 j+ L7 ?! y% `0 t/ N' d

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4 S! d" U, ?  r2 L# Z2 m3 a- `  c; A" ^, d' z) P* D: m1 |
但是点击执行后,& s" }  H0 y- o' Q) L
随着前面步骤的完成,PCB中就有这些网络了,
; B2 V9 v5 t& Y, h5 P就可以完成差分对的分配了。4 r% b6 |8 j& G! Y

点评

EDA软件背后逻辑研究这么透,厉害👍  详情 回复 发表于 2020-4-2 11:13

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5#
 楼主| 发表于 2020-4-2 11:13 | 只看该作者
yihafewu 发表于 2020-3-13 13:14
  e6 b9 o( q# ]: C楼主在原理图里设置了几个差分对,每个差分对都有两个网络,但是在导入PCB前,PCB里是没有这些网络的,
7 V; w3 S, n+ l ...

* H. L+ K& R0 I1 Y4 Q# cEDA软件背后逻辑研究这么透,厉害👍
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