印制板设计要求

丁军林

一、印制板设计要求
. A& A. t) r, `* D+ y  E
1、正确
+ o! \( n2 Q4 }
这是印制板设计最基本、最重要的要求，准确实现电原理图的连接关系，避免出现“短路”和“断路”这两个简单而致命的错误。这一基本要求在手工设计和用简单CAD软件设计的PCB中并不容易做到，一般的产品都要经过两轮以上试制修改，功能较强的CAD软件则有检验功能，可以保证电气连接的正确性。
" e7 b4 L4 p/ I
/ S# @3 ~& b! m/ c8 U2 [; q& Z2、可靠
: c9 ?6 d; C+ F& y; m2 Y, p( D" y& U
$ T/ m; Z+ V7 C这是PCB 设计中较高一层的要求。连接正确的电路板不一定可靠性好，例如板材选择不合理，板厚及安装固定不正确，元器件布局布线不当等都可能导致PCB不能可靠地工作，早期失效甚至根本不能正确工作。再如多层板和单、双面板相比，设计时要容易得多，但就可靠而言却不如单、双面板。从可靠性的角度讲，结构越简单，使用面越小，板子层数越少，可靠性越高。
  U3 T/ h0 K* ]! i+ F+ e
3、合理
- x6 Y. ^0 K2 B6 X: ?8 K" H3 }. j
这是PCB 设计中更深一层，更不容易达到的要求。一个印制板组件，从印制板的制造、检验、装配、调试到整机装配、调试，直到使用维修，无不与印制板的合理与否息息相关，例如板子形状选得不好加工困难，引线孔太小装配困难，没留试点高度困难，板外连接选择不当维修困难等等。每一个困难都可能导致成本增加，工时延长。而每一个造成困难的原因都源于设计者的失误。没有绝对合理的设计，只有不断合理化的过程。它需要设计者的责任心和严谨的作风，以及实践中为断总结、提高的经验。
& E) m* Y1 S& ]5 ]
$ r( _) T9 E3 c! T4 l  O; t# m* [4、经济
7 ]$ z) D. d; y' t
5 O2 m. L, g0 y5 ~" J这是一个不难达到、又不易达到，但必须达到的目标。说“不难”，板材选低价，板子尺寸尽量小，连接用直焊导线，表面涂覆用最便宜的，选择价格最低的加工厂等等，印制板制造价格就会下降。但是不要忘记，这些廉价的选择可能造成工艺性，可靠性变差，使制造费用、维修费用上升，总体经济性不一定分理处，因此说“不易”。“必须”则是市场竞争的原则。竞争是无情的，一个原理先进，技术高新的产品可能因为经济性原因夭折。

体会：
$ c' x: `5 Z' z4 C2 n
1、要有合理的走向：如输入/输出，交流/直流，强/弱信号，高频/低频，高压/低压等，它们的走向应该是呈线形的(或分离)，不得相互交融。其目的是防止相互干扰。最好的走向是按直线，但一般不易实现，最不利的走向是环形，所幸的是可以设隔离带来改善。对于是直流，小信号，低电压PCB设计的要求可以低些。所以“合理”是相对的。
' r: a9 \9 R$ H% p  j
, j8 u! e4 l( v$ S) [+ }2、选择好接地点：小小的接地点不知有多少工程技术人员对它做过多少论述，足见其重要性。一般情况下要求共点地，如：前向放大器的多条地线应汇合后再与干线地相连等等。现实中，因受各种限制很难完全办到，但应尽力遵循。这个问题在实际中是相当灵活的。每个人都有自己的一套解决方案。如能针对具体的电路板来解释就容易理解。
! z6 P% l: `3 k- U/ G( F  x
: |# ]) C5 c0 R: m7 F- S' k% I3、合理布置电源滤波/退耦电容：一般在原理图中仅画出若干电源滤波/退耦电容，但未指出它们各自应接于何处。其实这些电容是为开关器件(门电路)或其它需要滤波/退耦的部件而设置的，布置这些电容就应尽量靠近这些元部件，离得太远就没有作用了。有趣的是，当电源滤波/退耦电容布置的合理时，接地点的问题就显得不那么明显。
, O, e" ]9 @1 X7 y9 R6 v1 K
4、线条有讲究：有条件做宽的线决不做细；高压及高频线应园滑，不得有尖锐的倒角，拐弯也不得采用直角。地线应尽量宽，最好使用大面积敷铜，这对接地点问题有相当大的改善。

6 P$ e$ Z+ D- K) X. T8 X; W5、有些问题虽然发生在后期制作中，但却是PCB设计中带来的，它们是：过线孔太多，沉铜工艺稍有不慎就会埋下隐患。所以，设计中应尽量减少过线孔。同向并行的线条密度太大，焊接时很容易连成一片。所以，线密度应视焊接工艺的水平来确定。    焊点的距离太小，不利于人工焊接，只能以降低工效来解决焊接质量。否则将留下隐患。所以，焊点的最小距离的确定应综合考虑焊接人员的素质和工效。焊盘或过线孔尺寸太小，或焊盘尺寸与钻孔尺寸配合不当。前者对人工钻孔不利，后者对数控钻孔不利。容易将焊盘钻成“c”形，重则钻掉焊盘。导线太细，而大面积的未布线区又没有设置敷铜，容易造成腐蚀不均匀。即当未布线区腐蚀完后，细导线很有可能腐蚀过头，或似断非断，或完全断。所以，设置敷铜的作用不仅仅是增大地线面积和抗干扰。

7 x3 A3 R. h! H& h; P$ g9 ?
  _3 i* {- W0 ]" \# U) K$ x; Y
二、protel 打印设置

% ~5 x! I& E5 E; N! XSCH的打印设置较简单，在Margins的Top Bottom Left Right内全填上0然后点击Refresh,这样就能最大范围的占用页面，使打印出的SCH图更大些。

0 G2 u0 m2 B9 `0 ^- S8 OPCB的设置：打开File>Setup Printer…进行打印前的设置。
5 m) G  X; [- p7 i2 B( T
3 Y- L' g; a" {( ~2 x6 M在弹出的Printer Setup菜单中，要先选择您的打印机：最先几个是默认的打印机，后面两个是我们安装了的打印机，（我的机子上是这样）两个中一个后缀为Final，一个是Composite，前一个的意思是打印机一次只打印一个层（不管您选了几个层，只是分几次打印而已），后一个是一次打印所有你选中的层面，根据需要自己选择！下一步：点击下方的Options按钮，进行属性设置。假设我们选final然后进入Options进行设置，进入后的选项一般不用动，Scale为打印比例，默认的为1:1，如果想满页打印，就将那个小框打上钩，哦！右边的Show Hole蛮重要，选中他就可以把电路板上的孔打印出来（做光刻板就要选这个，有帮助），好了，点击Setup进行纸张大小设置就完成了打印机 Options。还没完呢！麻烦把！回到选打印机属性的对话框，选择Layers，进行打印层的设置，进去以后，看见了吧！是不是很熟悉呢！根据自己需要选择吧。

, d5 I. R/ h( o, ^, f% u

- F# `; a. @- j" Y6 J. L2 G三、常用的PCB库文件

1.\library\pcb\connectors目录下的元件数据库所含的元件库含有绝大部分接插件元件的PCB封装

1）.D type connectors.ddb,含有并口，串口类接口元件的封装
' B. M. ?9 Q% p5 l
2）.headers.ddb:含有各种插头元件的封装
7 Z$ a$ t# r0 }) l+ U/ c, B% Z
' f0 H& o# a1 U% f5 e. d2.\library\pcb\generic footprints目录下的数据库所含的元件库含有绝大部分的普通元件的PCB封状
. S4 F+ p* m$ \' b) k0 e
1）.general ic.ddb,含有CFP，DIP，JEDECA，LCC，DFP，ILEAD，SOCKET，PLCC系列以及表面贴装电阻，电容等元件封装
5 B5 y8 |/ ?# U2 D/ n4 ~/ Y
5 P8 g7 q: j0 ]1 |2 t2）.international rectifiers.ddb,含有IR公司的整流桥，二极管等常用元件的封装

3）.Miscellaneous.ddb,含有电阻，电容，二极管等的封装
" c, e0 L& |  |4 o# t* a
4）.PGA.ddb,含有PGA封装
0 a5 I. T; n2 U: t8 Y7 r
5）.Transformers.ddb,含有变压器元件的封装

2 L4 }0 b; }2 a- j. o# S6）.Transistors.ddb含有晶体管元件的封装

9 u5 `8 V. h: v7 L  k3.\library\pcb\IPC footprints目录下的元件数据库所含的元件库中有绝大部分的表面帖装元件的封装

3 V* @* Y: H% U$ t

& ~+ a+ o; f- t, X' c, y四、PCB及电路抗干扰措施                                                         
- r! l' p2 y4 g- o# {
印制电路板的抗干扰设计与具体电路有着密切的关系，这里仅就PCB抗干扰设计的几项常用措施做一些说明。
4 x6 C, z9 a' b2 |7 R. G' y( ^
, |5 d8 c2 Q' Z8 `* [* b: s1.电源线设计

    根据印制线路板电流的大小，尽量加租电源线宽度，减少环路电阻。同时、使电源线、地线的走向和数据传递的方向一致，这样有助于增强抗噪声能力。                                                              
, R6 ?4 B6 [" n0 p! H2 J
2.地线设计的原则
/ p* `+ G& X% w* i+ U0 m1 _+ e8 q. w
! S3 {2 d3 r  Q0 [    (1)数字地与模拟地分开。若线路板上既有逻辑电路又有线性电路，应使它们尽量分开。低频电路的地应尽量采用单点并联接地，实际布线有困难时可部分串联后再并联接地。高频电路宜采用多点串联接地，地线应短而租，高频元件周围尽量用栅格状大面积地箔。                        
% {  Z( K8 O5 H0 R2 M( @0 D2 g
5 W2 s4 G9 M9 U% ?: ^/ R    (2)接地线应尽量加粗。若接地线用很纫的线条，则接地电位随电流的变化而变化，使抗噪性能降低。因此应将接地线加粗，使它能通过三倍于印制板上的允许电流。如有可能，接地线应在2~3mm以上。                                                                              

(3)接地线构成闭环路。只由数字电路组成的印制板，其接地电路布成团环路大多能提高抗噪声能力。
! h* c0 n1 S: b0 f
3.退藕电容配置
! w; p( t' v' @1 Z/ p1 T! B2 K5 {
    PCB设计的常规做法之一是在印制板的各个关键部位配置适当的退藕电容。退藕电容的一般配置原则是：
, V0 Z9 }2 \8 I
(1)电源输入端跨接10~100uf的电解电容器。如有可能，接100uF以上的更好。

(2)原则上每个集成电路芯片都应布置一个0.01pF的瓷片电容，如遇印制板空隙不够，可每4~8个芯片布置一个1~10pF的钽电容。
: {; ]7 [' _: T" W3 v% r
$ }' j! [6 f( u3 H5 C- x6 z8 F7 Z    (3)对于抗噪能力弱、关断时电源变化大的器件，如RAM、ROM存储器件，应在芯片的电源线和地线之间直接接入退藕电容。

3 G8 }4 D) C- T2 r- y0 h( Q% |    (4)电容引线不能太长，尤其是高频旁路电容不能有引线。

(5)在印制板中有接触器、继电器、按钮等元件时．操作它们时均会产生较大火花放电，必须采用RC电路来吸收放电电流。一般R取1~2K，C取2.2~47UF。

( c7 j, l4 N8 }/ @: q. W& J. b3 W! {(6) CMOS的输入阻抗很高，且易受感应，因此在使用时对不用端要接地或接正电源。
0 w" M( b$ d* z2 o7 {( e# a

$ m8 g' }5 P! H4 V2 V! J6 D
五、PCB布线原则
9 N" |& e7 Y( f& g& x, L  H
( j. k: n" O" K' f+ L  z   在PCB设计中，布线是完成产品设计的重要步骤，可以说前面的准备工作都是为它而做的，在整个PCB中，以布线的设计过程限定最高，技巧最细、工作量最大。PCB布线有单面布线、 双面布线及多层布线。布线的方式也有两种：自动布线及交互式布线，在自动布线之前，可以用交互式预先对要求比较严格的线进行布线，输入端与输出端的边线应避免相邻平行， 以免产生反射干扰。必要时应加地线隔离，两相邻层的布线要互相垂直，平行容易产生寄生耦合。
0 s+ o. _; l! L4 ~3 H% B* M
  k/ t% F. \. R7 W5 \    自动布线的布通率，依赖于良好的布局，布线规则可以预先设定， 包括走线的弯曲次数、导通孔的数目、步进的数目等。一般先进行探索式布经线，快速地把短线连通，然后进行迷宫式布线，先把要布的连线进行全局的布线路径优化，它可以根据需要断开已布的线。 并试着重新再布线，以改进总体效果。
, X6 k# E2 ^( p% A9 H
( \! J% v1 A4 H$ {/ t* z* V    对目前高密度的PCB设计已感觉到贯通孔不太适应了， 它浪费了许多宝贵的布线通道，为解决这一矛盾，出现了盲孔和埋孔技术，它不仅完成了导通孔的作用，还省出许多布线通道使布线过程完成得更加方便，更加流畅，更为完善，PCB 板的设计过程是一个复杂而又简单的过程，要想很好地掌握它，还需广大电子工程设计人员去自已体会，才能得到其中的真谛。
) c/ Q+ ?3 l( [
1 电源、地线的处理

6 \8 z3 D' L2 \

    既使在整个PCB板中的布线完成得都很好，但由于电源、 地线的考虑不周到而引起的干扰，会使产品的性能下降，有时甚至影响到产品的成功率。所以对电源、地线的布线要认真对待，把电源、地线所产生的噪音干扰降到最低限度，以保证产品的质量。

    对每个从事电子产品设计的工程人员来说都明白地线与电源线之间噪音所产生的原因，现只对降低式抑制噪音作以表述：

众所周知的是在电源、地线之间加上去耦电容。

7 B5 F: n+ F( N9 A2 d) P3 f9 _尽量加宽电源、地线宽度，最好是地线比电源线宽，它们的关系是：地线＞电源线＞信号线，通常信号线宽为：0.2～0.3mm,最经细宽度可达0.05～0.07mm,电源线为1.2～2.5 mm

对数字电路的PCB可用宽的地导线组成一个回路, 即构成一个地网来使用(模拟电路的地不能这样使用)
) a# Z  s% Y  o. j
用大面积铜层作地线用,在印制板上把没被用上的地方都与地相连接作为地线用。或是做成多层板，电源，地线各占用一层。
1 N) V, i# _& g/ H! v7 M
; S8 O) v; P, y/ P& r2 数字电路与模拟电路的共地处理

* J+ e! X7 N( d3 F    现在有许多PCB不再是单一功能电路（数字或模拟电路），而是由数字电路和模拟电路混合构成的。因此在布线时就需要考虑它们之间互相干扰问题，特别是地线上的噪音干扰。
& F- `( @- t+ p' I6 }5 [( u4 b
' R6 D& M9 U& y( e. l3 L数字电路的频率高，模拟电路的敏感度强，对信号线来说，高频的信号线尽可能远离敏感的模拟电路器件，对地线来说，整人PCB 对外界只有一个结点，所以必须在PCB内部进行处理数、模共地的问题，而在板内部数字地和模拟地实际上是分开的它们之间互不相连，只是在PCB与外界连接的接口处（如插头等）。数字地与模拟地有一点短接，请注意，只有一个连接点。也有在PCB上不共地的，这由系统设计来决定。

6 ]% R) k5 ?4 i7 b8 N3 信号线布在电（地）层上

1 Z3 I6 q& Q* U: u9 m6 c    在多层印制板布线时，由于在信号线层没有布完的线剩下已经不多，再多加层数就会造成浪费也会给生产增加一定的工作量，成本也相应增加了，为解决这个矛盾，可以考虑在电（地）层上进行布线。首先应考虑用电源层，其次才是地层。因为最好是保留地层的完整性。

& \& k0 D9 ?' Y4 大面积导体中连接腿的处理

' f% E" d$ }( E5 E    在大面积的接地（电）中，常用元器件的腿与其连接，对连接腿的处理需要进行综合的考虑，就电气性能而言，元件腿的焊盘与铜面满接为好，但对元件的焊接装配就存在一些不良隐患如：①焊接需要大功率加热器。②容易造成虚焊点。所以兼顾电气性能与工艺需要，做成十字花焊盘，称之为热隔离（heat shield）俗称热焊盘（Thermal），这样，可使在焊接时因截面过分散热而产生虚焊点的可能性大大减少。多层板的接电（地）层腿的处理相同。

5 布线中网络系统的作用
" g' \6 l6 X5 [% W
! S4 S. U) v$ q7 S# M- d    在许多CAD系统中，布线是依据网络系统决定的。网格过密，通路虽然有所增加，但步进太小，图场的数据量过大，这必然对设备的存贮空间有更高的要求，同时也对象计算机类电子产品的运算速度有极大的影响。而有些通路是无效的，如被元件腿的焊盘占用的或被安装孔、定们孔所占用的等。网格过疏，通路太少对布通率的影响极大。所以要有一个疏密合理的网格系统来支持布线的进行。
1 ^( D5 O4 w2 {8 I( G: C( w; |. ^7 k
5 G& Y0 r" [9 [    标准元器件两腿之间的距离为0.1英寸(2.54mm),所以网格系统的基础一般就定为0.1英寸(2.54 mm)或小于0.1英寸的整倍数，如：0.05英寸、0.025英寸、0.02英寸等。

6 设计规则检查（DRC）

    布线设计完成后，需认真检查布线设计是否符合设计者所制定的规则，同时也需确认所制定的规则是否符合印制板生产工艺的需求，一般检查有如下几个方面：
0 o7 D" B) m- Z# {1 V" P' I
线与线，线与元件焊盘，线与贯通孔，元件焊盘与贯通孔，贯通孔与贯通孔之间的距离是否合理，是否满足生产要求。

- ?- Q- z0 Q+ |+ o; w5 H电源线和地线的宽度是否合适，电源与地线之间是否紧耦合（低的波阻抗）？在PCB中是否还有能让地线加宽的地方。
* Q5 x) T) ?7 r3 |2 M
1 }3 n. S2 b, ]; T5 F4 a2 X对于关键的信号线是否采取了最佳措施，如长度最短，加保护线，输入线及输出线被明显地分开。
  S! G- M4 Q& A2 X+ M/ q* F4 I) t
模拟电路和数字电路部分，是否有各自独立的地线。

5 F4 O1 u8 ?, ]1 t2 j! F0 B& c后加在PCB中的图形（如图标、注标）是否会造成信号短路。
/ C! A0 @1 H5 r" z4 c
对一些不理想的线形进行修改。
% x  m  ^6 {# h$ H
在PCB上是否加有工艺线？阻焊是否符合生产工艺的要求，阻焊尺寸是否合适，字符标志是否压在器件焊盘上，以免影响电装质量。
7 e  S, {: F8 v# I& r
多层板中的电源地层的外框边缘是否缩小，如电源地层的铜箔露出板外容易造成短路。  
* m- e+ }1 z! B0 Y( N; A1 v


3 N$ _6 ?& T7 C5 Y
% N. r! `0 j2 I+ e7 z. ^

6 r' V' `% u; y% m; g$ B) E##############################################################################################
( ?6 c, |' t# J+ K1 z3 E. g9 P3 w

" C, [; E" t& B
六、关于滤波  

$ X. x* m) g" n! i6 E( `' j6 L5 h    滤波技术是抑制干扰的一种有效措施，尤其是在对付开关电源EMI信号的传导干扰和某些辐射干扰方面，具有明显的效果。
$ _0 @8 m/ Z8 _
% e# W) A: `8 }- w/ e    任何电源线上传导干扰信号，均可用差模和共模干扰信号来表示。

( {% Z- W, E# w9 I    差模干扰在两导线之间传输，属于对称性干扰；共模干扰在导线与地(机壳)之间传输，属于非对称性干扰。在一般情况下，差模干扰幅度小、频率低、所造成的干扰较小，共模干扰幅度大、频率高，还可以通过导线产生辐射，所造成的干扰较大。因此，欲削弱传导干扰，把EMI信号控制在有关EMC标准规定的极限电平以下。除抑制干扰源以外，最有效的方法就是在开关源输入和输出电路中加装EMI滤波器。一般设备的工作频率约为10～50 kHz。EMC很多标准规定的传导干扰电平的极限值都是从10 kHz算起。对开关电源产生的高频段EMI信号，只要选择相应的去耦电路或网络结构较为简单的EMI滤波器，就不难满足符合EMC标准的滤波效果。



1 .1瞬态干扰

    是指交流电网上出现的浪涌电压、振铃电压、火花放电等瞬间干扰信号，其特点是作用时间极短，但电压幅度高、瞬态能量大。瞬态干扰会造成单片开关电源输出电压的波动；当瞬态电压叠加在整流滤波后的直流输入电压ＶＩ上，使ＶＩ超过内部功率开关管的漏－源击穿电压Ｖ（ＢＲ）ＤＳ时，还会损坏ＴＯＰＳｗｉｔｃｈ芯片，因此必须采用抑制措施。通常，静电放电（ESD）和电快速瞬变脉冲群（EFT）对数字电路的危害甚于其对模拟电路的影响。静电放电在5 — 200MHz的频率范围内产生强烈的射频辐射。此辐射能量的峰值经常出现在35MHz — 45MHz之间发生自激振荡。许多I/O电缆的谐振频率也通常在这个频率范围内，结果，电缆中便串入了大量的静电放电辐射能量。当电缆暴露在4 — 8kV静电放电环境中时，I/O电缆终端负载上可以测量到的感应电压可达到600V。这个电压远远超出了典型数字的门限电压值0.4V。典型的感应脉冲持续时间大约为400纳秒。将I/O电缆屏蔽起来，且将其两端接地，使内部信号引线全部处于屏蔽层内，可以将干扰减小60 — 70dB，负载上的感应电压只有0.3V或更低。电快速瞬变脉冲群也产生相当强的辐射发射，从而耦合到电缆和机壳线路。电源线滤波器可以对电源进行保护。线 — 地之间的共模电容是抑制这种瞬态干扰的有效器件，它使干扰旁路到机壳，而远离内部电路。当这个电容的容量受到泄漏电流的限制而不能太大时，共模扼流圈必须提供更大的保护作用。这通常要求使用专门的带中心抽头的共模扼流圈，中心抽头通过一只电容（容量由泄漏电流决定）连接到机壳。共模扼流圈通常绕在高导磁率铁氧体芯上，其典型电感值为15 ～ 20mH。
6 v5 f# c! A4 [2 P  m8 V

2 D/ A) G! I* e1 G& Q$ l% A
# z9 r5 X8 {# A- D+ z# \' T1.2传导的抑制
& d$ q# Y; q. T+ ?$ |- p9 t% r
    往往单纯采用屏蔽不能提供完整的电磁干扰防护，因为设备或系统上的电缆才是最有效的干扰接收与发射天线。许多设备单台做电磁兼容实验时都没有问题，但当两台设备连接起来以后，就不满足电磁兼容的要求了，这就是电缆起了接收和辐射天线的作用。唯一的措施就是加滤波器，切断电磁干扰沿信号线或电源线传播的路径，与屏蔽共同够成完善的电磁干扰防护，无论是抑制干扰源、消除耦合或提高接收电路的抗能力，都可以采用滤波技术。针对不同的干扰，应采取不同的抑制技术，由简单的线路清理，至单个元件的干扰抑制器、滤波器和变压器，再至比较复杂的稳压器和净化电源，以及价格昂贵而性能完善的不间断电源，下面分别作简要叙述。
  H% A) j% c: @6 R9 L

$ \+ \; o! L* _8 n
. y$ g: D/ {# J+ A5 Z1.3 专用线路

1 z7 I0 f7 Z( r. N3 I% G3 Y    只要通过对供电线路的简单清理就可以取得一定的干扰抑制效果。如在三相供电线路中认定一相作为干扰敏感设备的供电电源；以另一相作为外部设备的供电电源；再以一相作为常用测试仪器或其他辅助设备的供电电源。这样的处理可避免设备间的一些相互干扰，也有利于三相平衡。值得一提的是在现代电子设备系统中，由于配电线路中非线性负载的使用，造成线路中谐波电流的存在，而零序分量谐波在中线里不能相互抵消，反而是叠加，因此过于纤细的中线会造成线路阻抗的增加，干扰也将增加。同时过细的中线还会造成中线过热。

" W6 h. O1 w9 T9 j- O3 G4 R
1 K: C4 U- r3 R+ A! w
- e2 {8 h' _; |  k& w3 g( ^. a% h1.4 瞬变干扰抑制器
; r5 }' K$ g  U+ H  u% z; x9 I4 [
# G/ W! r; m6 {# a4 p/ H8 U: }属瞬变干扰抑制器的有气体放电管、金属氧化物压敏电阻、硅瞬变吸收二极管和固体放电管等多种。其中金属氧化物压敏电阻和硅瞬变吸收二极管的工作有点象普通的稳压管，是箝位型的干扰吸收器件；而气体放电管和固体放电管是能量转移型干扰吸收器件（以气体放电管为例，当出现在放电管两端的电压超过放电管的着火电压时，管内的气体发生电离，在两电极间产生电弧。由于电弧的压降很低，使大部分瞬变能量得以转移，从而保护设备免遭瞬变电压破坏）。瞬变干扰抑制器与被保护设备并联使用。
3 Z4 f3 C+ S/ z' G% ~: ~% @
1.5气体放电管

) C3 _6 D+ }, ]气体放电管也称避雷管，目前常用于程控交换机上。避雷管具有很强的浪涌吸收能力，很高的绝缘电阻和很小的寄生电容，对正常工作的设备不会带来任何有害影响。但它对浪涌的起弧响应，与对直流电压的起弧响应之间存在很大差异。例如90V气体放电管对直流的起弧电压就是90V，而对5kV/μs的浪涌起弧电压最大值可能达到1000V。这表明气体放电管对浪涌电压的响应速度较低。故它比较适合作为线路和设备的一次保护。此外，气体放电管的电压档次很少。
7 a; q% j1 z% [0 w" n1 o( Z
, M# n* |9 `5 J0 E% {) a) y- o1.6金属氧化物压敏电阻

    由于价廉，压敏电阻是目前广泛应用的瞬变干扰吸收器件。描述压敏电阻性能的主要参数是压敏电阻的标称电压和通流容量即浪涌电流吸收能力。前者是使用者经常易弄混淆的一个参数。压敏电阻标称电压是指在恒流条件下（外径为7mm以下的压敏电阻取0.1mA；7mm以上的取1mA）出现在压敏电阻两端的电压降。由于压敏电阻有较大的动态电阻，在规定形状的冲击电流下（通常是8/20μs的标准冲击电流）出现在压敏电阻两端的电压（亦称是最大限制电压）大约是压敏电阻标称电压的1.8～2倍（此值也称残压比）。这就要求使用者在选择压敏电阻时事先有所估计，对确有可能遇到较大冲击电流的场合，应选择使用外形尺寸较大的器件（压敏电阻的电流吸收能力正比于器件的通流面积，耐受电压正比于器件厚度，而吸收能量正比于器件体积）。使用压敏电阻要注意它的固有电容。根据外形尺寸和标称电压的不同，电容量在数千至数百pF之间，这意味着压敏电阻不适宜在高频场合下使用，比较适合于在工频场合，如作为晶闸管和电源进线处作保护用。特别要注意的是，压敏电阻对瞬变干扰吸收时的高速性能（达ns)级，故安装压敏电阻必须注意其引线的感抗作用，过长的引线会引入由于引线电感产生的感应电压（在示波器上，感应电压呈尖刺状）。引线越长，感应电压也越大。为取得满意的干扰抑制效果，应尽量缩短其引线。关于压敏电阻的电压选择，要考虑被保护线路可能有的电压波动（一般取1.2～1.4倍）。如果是交流电路，还要注意电压有效值与峰值之间的关系。所以对 220V线路，所选压敏电阻的标称电压应当是220×1.4×1.4≈430V。此外，就压敏电阻的电流吸收能力来说，1kA（对8/20μs的电流波）用在晶闸管保护上，3kA用在电器设备的浪涌吸收上；5kA用在雷击及电子设备的过压吸收上；10kA用在雷击保护上。压敏电阻的电压档次较多，适合作设备的一次或二次保护。
/ S/ j: c. O: o  ]

' `' @, U/ _$ _
% ~  ?+ q5 N- n. l* }- \3 u* p' s1.7硅瞬变电压吸收二极管（TVS管）

硅瞬变电压吸收二极管具有极快的响应时间（亚纳秒级）和相当高的浪涌吸收能力，及极多的电压档次。可用于保护设备或电路免受静电、电感性负载切换时产生的瞬变电压，以及感应雷所产生的过电压。 TVS管有单方向（单个二极管）和双方向（两个背对背连接的二极管）两种，它们的主要参数是击穿电压、漏电流和电容。使用中TVS管的击穿电压要比被保护电路工作电压高10％左右，以防止因线路工作电压接近TVS击穿电压，使TVS漏电流影响电路正常工作；也避免因环境温度变化导致TVS管击穿电压落入线路正常工作电压的范围。 TVS管有多种封装形式，如轴向引线产品可用在电源馈线上；双列直插的和表面贴装的适合于在印刷板上作为逻辑电路、I/O总线及数据总线的保护。 TVS管在使用中应注意的事项： ·对瞬变电压的吸收功率（峰值）与瞬变电压脉冲宽度间的关系。手册给的只是特定脉宽下的吸收功率（峰值），而实际线路中的脉冲宽度则变化莫测，事前要有估计。对宽脉冲应降额使用。 ·对小电流负载的保护，可有意识地在线路中增加限流电阻，只要限流电阻的阻值适当，不会影响线路的正常工作，但限流电阻对干扰所产生的电流却会大大减小。这就有可能选用峰值功率较小的TVS管来对小电流负载线路进行保护。 ·对重复出现的瞬变电压的抑制，尤其值得注意的是TVS管的稳态平均功率是否在安全范围之内。 ·作为半导体器件的TVS管，要注意环境温度升高时的降额使用问题。 ·特别要注意TVS管的引线长短，以及它与被保护线路的相对距离。 ·当没有合适电压的TVS管供采用时，允许用多个TVS管串联使用。串联管的最大电流决定于所采用管中电流吸收能力最小的一个。而峰值吸收功率等于这个电流与串联管电压之和的乘积。 ·TVS管的结电容是影响它在高速线路中使用的关键因素，在这种情况下，一般用一个TVS管与一个快恢复二极管以背对背的方式连接，由于快恢复二极管有较小的结电容，因而二者串联的等效电容也较小，可满足高频使用的要求。 ·固体放电管 固体放电管是一种较新的瞬变干扰吸收器件，具有响应速度较快（10～20ns级）、吸收电流较大、动作电压稳定和使用寿命长等特点。固体放电管与气体放电管同属能量转移型。图2.2为其伏安特性。当外界干扰低于触发电压时，管子呈截止状。一旦干扰超出触发电压时，伏安特性发生转折，进入负阻区，此时电流极大，而导通电阻极小，使干扰能量得以转移。随着干扰减小，通过放电管电流的回落，当放电管的通过电流低于维持电流时，放电管就迅速走出低阻区，而回到高阻态，完成一次放电过程。固体放电管的一个优点是它的短路失效模式（器件失效时，两电极间呈短路状），为不少应用场合所必须，已在国内外得到广泛应用。固体放电管的电压档次较少，比较适合于作网络、通信设备，乃至部件一级的保护。

. f+ J1 s+ ^+ d5 V2 P$ c+ z! U3 @% v
* `* r/ S; }6 l2 b0 r. W
+ ^$ ^: q1 @. q$ u1 ?( s七、PCB使用技巧
: I$ Z4 a. Y" [3 x7 E9 L7 }( |  w
1、元器件标号自动产生或已有的元器件标号取消重来
: T$ M3 J. x( _; d) @: @, g* I
    Tools工具|Annotate…注释
, t+ C) B& L- q' j
All Part：为所有元器件产生标号
) c2 R7 y$ p' W# T
- W. E) m. I  h1 A  Y3 U& x        Reset Designators：撤除所有元器件标号
% m$ c/ K9 X' n4 k0 o2 `* P; D$ Z
) z' U0 ?2 J# y) W* G
& g1 \' Y5 @7 j1 A- w/ [
7 K& X$ {( k- o0 @2、单面板设置：

; E. U& ]3 v& \5 i( R   Design设计|Rules…规则|Routing layers
8 g4 w2 m9 S7 b9 d! K/ I% s5 o
Toplayer设为NotUsed
4 ]0 t( Y! ^$ z2 V! A  T3 q
: x5 U" y5 {8 M  w6 zBottomlayer设为Any
: V: m/ m* U5 d3 N( w: k& u, a+ p


7 x0 N# Q2 I% f$ h/ Q3 v( u% F3、自动布线前设定好电源线加粗
0 d6 \, }: K6 p' L
4 p: f+ y, |: Q   Design设计|Rules…规则|Width Constraint
0 H$ d" y* g6 E/ B. M. n: S
   增加：NET,选择网络名VCC GND，线宽设粗
" x4 M, r$ P- U. N0 [2 H
4 P+ n: U2 a3 X: S

4、PCB封装更新，只要在原封装上右键弹出窗口内的footprint改为新的封装号
% u1 \) q: h3 ]( `/ [1 U! W
2 C  f8 Q6 T" d1 l+ o0 d. a
6 ?5 @) I( W6 {# U7 o5 B
" I4 Y( {7 S; h5、100mil=2.54mm;1mil=1/1000英寸
1 Y: s/ ?& w! j

1 L: S) {+ i8 Z/ H# A1 j* C, Z) z9 [
( ^3 U4 A4 v+ a4 z, x& G6、快捷键"M"，下拉菜单内的Dram Track End 拖拉端点＝＝＝＝拉PCB内连线的一端点处继续连线。
5 A  M7 \5 l! m( I( ]# p6 |


7、定位孔的放置
3 c/ G4 Y; K0 p/ ]" i7 |" i$ G
    在KeepOutLayer层（禁止布线层）中画一个圆，Place|Arc(圆心弧)center,然后调整其半径和位置
, o) p3 r9 A  {; Y! p7 B


, i8 Y1 p. a# @- \& Z2 M8 _8、设置图纸参数

& b4 W8 L$ Y$ g3 m5 w3 X& o9 hDesign|Options|Sheet Options
7 b( _) c1 f, N% K9 U
; s: o3 W  P7 j$ p6 W/ _. O(1)设置图纸尺寸：Standard Sytle选择

, l7 o8 Y9 p% B9 E2 N0 ]0 q- N(2)设定图纸方向：Orientation选项----Landscape(小平方向)----Portrait(垂直方向)

(3)设置图纸标题栏(Title BlocK):选择Standard为标准型，ANSI为美国国家协会标准型
3 S$ p/ R# A3 n  a$ M. F
' U/ }) }9 d0 S! S7 k. r0 ~(4)设置显示参考边框Show Reference Zones

4 e8 j, V" `* @' V: w4 T0 M% a(5)设置显示图纸边框Show Border
+ q1 X' m: i. J7 \$ X: g- F( U
* ]5 f/ `% m: }  b" g0 W0 a(6)设置显示图纸模板图形Show Template Graphics
/ H; [/ S7 C' ]. C0 ^+ {
+ l/ \1 W5 X" c* o(7)设置图纸栅格Grids

% k2 W3 X$ ]1 r0 F3 z( ~9 T    锁定栅格Snap On,可视栅格设定Visible

(8)设置自动寻找电器节点



( M1 r# y) v8 h6 G& S0 ?10、元件旋转：

Space键：被选中元件逆时针旋转90

在PCB中反转器件(如数码管)，选中原正向器件，在拖动或选中状态下，

    X键：使元件左右对调（水平面）；   Y键：使元件上下对调（垂直面）
% l2 f0 ~5 ]. Y6 w: T' T+ b
, _( |; i1 B- g1 Q! c

9 P% n  ^/ U" W3 W/ @6 t11、元件属性：
$ x0 q0 ]3 p8 ]
    Lib Ref:元件库中的型号，不允件修改

/ \; B& W- ^8 `! n) N  `' i0 p0 r    Footprint:元件的封装形式

: B. o1 U1 B) P    Designator:元件序号如U1
! x/ |& E% Y+ R7 ]8 A" h
' |1 d/ w$ T$ I    Part type：元件型号（如芯片名AT89C52 或电阻阻值10K等等）（在原理图中是这样，在PCB中此项换为Comment）
% c$ }& c2 y" L  V! X

) r2 I4 c- e1 h4 P  P+ J
; J) H4 h8 B- L% d0 E: _12、生成元件列表(即元器件清单)Reports|Bill of Material



13、原理图电气法则测试(Electrical Rules Check)即ERC

* S2 |- @1 ?& s: ^9 ]    是利用电路设计软件对用户设计好的电路进行测试，以便能够检查出人为的错误或疏忽。

8 e( ]! g/ Z! u% T1 Z/ f) t    原理图绘制窗中Tools工具|ERC…电气规则检查
: _( ]/ _5 u9 G; n6 N* K8 }6 {5 I2 n
    ERC对话框各选项定义：

! l& F7 k" w  n" c. Y4 m: t. ?Multiple net names on net:检测“同一网络命名多个网络名称”的错误

" \- b: H9 Q0 c: e7 b, PUnconnected net labels:“未实际连接的网络标号”的警告性检查
5 [0 E+ M% ?9 [$ U1 Q4 Y
( v0 ]: y. {9 O' M5 k& pUnconnected power objects:“未实际连接的电源图件”的警告性检查

$ e/ q+ w1 b2 L0 C; a/ u+ dDuplicate sheet mnmbets:检测“电路图编号重号”

Duplicate component designator:“元件编号重号”
' f' P5 @9 Q  B
bus label format errors:“总线标号格式错误”
1 ~7 L: V2 q8 F& H" p' [
Floating input pins:“输入引脚浮接”

! t! |  g2 C9 r1 t, d/ \, {Suppress warnings:“检测项将忽略所有的警告性检测项，不会显示具有警告性错误的测试报告”

Create report file:“执行完测试后程序是否自动将测试结果存在报告文件中”

3 y) p: A% B. I/ ]' UAdd error markers:是否会自动在错误位置放置错误符号

8 I: v5 @0 `! |1 t+ ?% VDescend into sheet parts:将测试结果分解到每个原理图中，针对层次原理图而言
* F6 i$ K( q4 t) t: }- b
Sheets to Netlist:选择所要进行测试的原理图文件的范围

Net Identifier Scope:选择网络识别器的范围
. g6 U9 O: ]2 J


14、系统原带库Miscellanous Devices.ddb中的DIODE(二级管)封装应该改，也就把管脚说明

) ~( P; u9 H( L' W    1(A) 2(K)改为A(A) K(K)
9 X5 p/ r" i7 ]1 ?# D
这样画PCB导入网络表才不会有错误：Note Not Found
8 l% q7 o8 z0 y4 K6 c5 B


15、PCB布线的原则如下

: S; S1 k) a& h, a' m6 ?5 n# Y    (1)输入输出端用的导线应尽量避免相邻平行。最好加线间地线，以免发生反馈藕合。

/ b1 K3 I# o* g    (2)印制摄导线的最小宽度主要由导线与绝缘基扳间的粘附强度和流过它们的电流值决定。

9 m7 N1 m2 s% M' \5 J! e( a    当铜箔厚度为0.05mm、宽度为1~15mm时．通过2A的电流，温度不会高于3℃，因此导线宽度为1.5mm（60mil）可满足要求。对于集成电路，尤其是数字电路，通常选0.02~0.3mm(0.8~12mil)导线宽度。当然，只要允许，还是尽可能用宽线．尤其是电源线和地线。导线的最小间距主要由最坏情况下的线间绝缘电阻和击穿电压决定。对于集成电路，尤其是数字电路，只要工艺允许，可使间距小至5~8mm。
: D! o5 x: b; b* r
    (3)印制导线拐弯处一般取圆弧形，而直角或夹角在高频电路中会影响电气性能。此外，尽量避免使用大面积铜箔，否则．长时间受热时，易发生铜箔膨胀和脱落现象。必须用大面积铜箔时，最好用栅格状.这样有利于排除铜箔与基板间粘合剂受热产生的挥发性气体。

(4)焊盘：焊盘中心孔要比器件引线直径稍大一些。焊盘太大易形成虚焊。焊盘外径D一般不小于(d+1.2)mm，其中d为引线孔径。对高密度的数字电路，焊盘最小直径可取(d+1.0)mm。

' h9 l: u9 R' m1 a% a

  Y% V+ V$ h' g4 [0 M9 I16、工作层面类型说明

⑴、信号层（Signal Layers）,有16个信号层，TopLayer BottomLayer MidLayer1-14。
. E4 K0 ?/ R( |- _2 \0 r' k1 O6 w
. h% s5 }4 _, v4 g⑵、内部电源/接地层（Internal Planes）,有4个电源/接地层Planel1-4。

⑶、机械层（Mechanical Layers）,有四个机械层。
: v2 E) h1 }' }8 c" i( E4 d
5 M2 m0 j# P+ A⑷、钻孔位置层（Drill Layers）,主要用于绘制钻孔图及钻孔的位置，共包括Drill Guide 和Drill drawing两层。
% D6 A3 W6 F! `2 |: y
% F: i( b9 e2 j. a# ^: ^- P# x⑸、助焊层（Solder Mask）,有TopSolderMask和BottomSolderMask两层，手工上锡。
1 j& ?7 j7 N- S% H
⑹、锡膏防护层（Paste Mask）有TopPaste和BottomPaster两层。

⑺、丝印层（Silkscreen）,有TopOverLayer和BottomOverLayer两层，主要用于绘制元件的外形轮廓。

⑻、其它工作层面（Other）：

7 J/ _$ E- J, H# ~    KeepOutLayer:禁止布线层，用于绘制印制板外边界及定位孔等镂空部分。
  G# i3 G% o$ g; y( P; C
    MultiLayer:多层
0 `# w1 S4 j, D' J7 E2 \1 C
    Connect:连接层

* ~8 x% X) V8 Q5 S4 D9 V" `    DRCErrorRC错误层
3 ]6 ^, H' z  m% `+ n
. s; l' W# {! d; t5 j/ A    VisibleGrid:可视栅格层
+ T8 J- [% V) C
    Pad Holes:焊盘层。
' L6 ?" M  v) w! ~: n! }' z& x
    Via Holes:过孔层。
7 E$ k8 p# Q4 u$ Y- m
& @+ x/ a6 H2 N8 v& p2 _/ }17、PCB自动布线前的设置
/ g) f' l. p5 `
4 [/ W+ M  i1 x1 N  h    ⑴Design|Rules……
- N6 j/ ?- L' ]$ a1 C) X& X3 u
8 r, \# @( g2 p+ \0 R: o" k    ⑵Auto Route|Setup……
! d% p& Q9 Q& p
! F# y5 V3 c! u& ?$ u  g    Lock All Pro-Route:锁定所有自动布线前手工预布的连线。

PCB工

分享了。。。。