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周燕刘伟 (河南省平顶山煤业集团铁路运输电务段河南省平顶山 467000)
3 _- D1 ?! _5 j[摘 要]基于嵌入式系统发展的需要,提出TMS320VC5402 DSP与AT89C51单片机通信的三种设计方案。利用TMS320VC5402的多通道缦冲串口MCBSP分别实现TMS320VC5402与AT89C51的SCI和SPI串行通信，以及通过TMS320VC5402的8位增强主机接口HP1一8实现TMS320VC5402与AT89C5I并行通信。4 J0 p5 z* D, ]
[关键词]单片机DSP MCBSP HPI" Y* v% Q8 T$ [0 R+ @% w
[中图分类号]TP [文章标识码]A [文章编号]1009- -914x(2009) 04 (b) -0243-02
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1串行通信设计与实现
& U6 Z# I% P: D- i) c+ N1.1 SCI串行通信设计
i: J8 I1 s* J X. h1.1.1多通道缦冲串行口McBSP原理
) A: J, b& |$ B A/ fTMS320VC5402(简称VC5402)提供了2个支持高速、全双工、带绶冲、多种数据格式等优点的多通道缦冲串行口McBSP. MCESP分为数据通路和控制通路。①数据通路负责完成数据的收发。CPU或DMAC能够向数据发送寄存器DXR写入数据，DXR中的数据通过发送移位寄存器XSR输出到DX引脚。DR引脚接收数据到接收移位寄存器RSR,再复制到接收缦冲寄存器RBR,最后复制到数据接收寄存器DRR.这两种数据多级缓冲方式使得数据搬移和片外数据通信能够同时进行。②控制通路负责内部时钟产生,帧同步信号产生，信号控制和多通道选择。另外.还具有向CPU发送中断信号和向DMAC发送同步事件的功能。
' v8 o! k7 J/ s; v2 F* ]$ `, Z1.1.2 SCI串行接口设计
* K- b) q4 e$ [1 F设置VC5402的McRSP输出时钟和帧同步信号由内部采样率发生器产生，内部数据时钟CLKG和帧同步信号FSG驱动发送时钟CLKX和帧同步FSX(CLKXM=l, FSXM=l, FSGM=1),输入时钟也由内部采样率发生器产生，内部数据时钟CLKG驱动接收时钟CLKR(CLKRM=1),同时由CPU时钟驱动采样率发生器(CLKSM=1)。考虑到AT89C51(简称C51)串口发送数据帧中第I位为起始位，因此可以利用该位驱动输人帧同步信号FSR,岗时委重忽略帧同步信号标志为1.其中FSG帧同步脉冲宽度=(FWID+1).CLKG，FSG帧同步脉冲周期=(FPER+1). CLKG;采样率发生器分频系数(采样率=波特事)=FIN / (CLKGDV+1)。6 X" \0 g" s4 J% \& u
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发表于 2020-2-5 09:30
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