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关于亚稳态和同步,请高手讲解,附资料-cypress

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发表于 2009-11-25 11:36 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 zxli36 于 2009-11-25 11:38 编辑
" {0 [) Z' l" D( V, Q7 ]3 A1 i! T# _8 p7 }4 P3 H; y
一个关于亚稳态的资料,不知道以前有没有人发过。9 j, V* @9 t% d% r. Z9 C) J: M# [
请高手讲一下对芯片外部的异步信号进芯片时实际都是怎么处理的。
0 Y6 }) A. [  k. [) j标准的处理方式是进行双D缓冲,但感觉太花时间了,如果时间急,可能来不及,因为把处罚信号同步好了以后需要处理的信号可能已经过去了。
* r1 U8 S# G( s+ ~: E问高手是怎样处理的,如果有具体例子就更好了,谢谢。% T# ~6 w4 l6 I2 q0 K
或者,是不是要用多个时钟区?那么,如果触发信号的沿很缓慢会有什么影响?6 N  [  N! B0 f$ ]/ R9 _2 P) \
我是对一些会产生寄存器写的信号进行标准的双D缓冲,只会产生读效果的信号就没有处理,不知道对不对。

are_your_plds_metastable____an1211_12.pdf

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