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楼主: sheen
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导入网络表问题

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该用户从未签到

16#
 楼主| 发表于 2008-3-18 15:01 | 只看该作者
原帖由 kxx27 于 2008-3-18 14:42 发表
* @( G, I  d# B9 y可能是你的原理图或BRD档有问题根本就没办法导,先检查一下吧。记得这个问题在本论坛里有讨论过,请楼主仔细找找相关贴子也许有收获。
( t0 j$ h, e, F7 R: E

4 H* m1 s/ i* E; [1 H* g7 f( I现在可以了,刚才是我的路径没设置好,但是现在通过你刚才说的那种方法打开的PCB里面却什么东东也没有,是不是我的" U0 ^. x3 @; r3 K. d
PCB封装库没有加载进去?

该用户从未签到

17#
发表于 2008-3-18 15:07 | 只看该作者
封装要自己再拖进来的,你看下file-viewlog
1 w, U% |* H/ T$ `若没有错误,就说明已经导入了
" K9 K* ?- H# s; R3 t7 Bplace-manually里可以手工摆放元件

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18#
 楼主| 发表于 2008-3-18 15:15 | 只看该作者
哎,是不是用习惯了PADS再学这个感觉很难啊,感觉和以前的思路大不一样,有没有初学者有同样的感受啊

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19#
发表于 2008-3-18 15:18 | 只看该作者
我一上来学的就是这个,感觉也头大.
1 _2 B. n% e# C+ ^) B  f才学了一个月,就让 我画六层板.差不多要崩溃了

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20#
发表于 2008-3-19 20:35 | 只看该作者
记得大约在10年前在生成网表的选项上是选取telisis格式就可以生成tel文件了。
  • TA的每日心情
    开心
    2019-12-3 15:20
  • 签到天数: 3 天

    [LV.2]偶尔看看I

    21#
    发表于 2008-3-19 22:29 | 只看该作者
    tel是allegro最简单的一种网表格式,包含的信息量最少,优点就是简单易用,缺点就是很难和第三方软件接口,而用那三个文件的格式就很容易跟其它软件包括cadence自家的软件交互。

    该用户从未签到

    22#
    发表于 2008-11-13 19:53 | 只看该作者

    tel????

    需要设置什么才可以生成tel文件?

    该用户从未签到

    23#
    发表于 2008-11-13 19:54 | 只看该作者
    我看到的是txt文件!

    该用户从未签到

    24#
    发表于 2008-11-14 08:04 | 只看该作者
    3楼的说的对,就是那样倒,倒进去是看不到零件的,再点Place-Quickplace,摆放零件就看见了

    该用户从未签到

    25#
    发表于 2008-11-14 08:06 | 只看该作者
    Cadence导出的文件就是有那三个,分别对应了零件的封装形式等

    该用户从未签到

    26#
    发表于 2009-6-23 18:15 | 只看该作者
    我也没搞明白呀,烦

    该用户从未签到

    27#
    发表于 2009-7-9 12:40 | 只看该作者
    26# zwp98
    6 L) w# }" b/ Y; J$ N导进去什么都没有,用viewlog查看提示以下错误,是怎么回事啊?
    9 j# h% S$ H3 q5 c: W# a! m' R
    7 P2 X$ a# v8 U( e- ^* ?Cadence Design Systems, Inc. netrev 15.5 Thu Jul 09 11:25:57 2009
    , `& [" ?% g! L( e$ ](C) Copyright 2002 Cadence Design Systems, Inc.
    . ~. w" X' S( }3 p+ u; g0 Q! f------ Directives ------- E# r; I' q$ y+ p1 ^9 K
    RIPUP_ETCH FALSE;
    - W7 C4 Z6 S$ F  ^% E) bRIPUP_SYMBOLS ALWAYS;
    ) l  @9 h/ i! V, I* V. \# rMISSING SYMBOL AS ERROR FALSE;, u" A  C$ u0 D' e+ O  V0 \% ^
    SCHEMATIC_DIRECTORY 'C:/Documents and Settings/Administrator/桌面/现场信息记录仪资料09.4.19/Project';# Q4 a7 K* H, }' i: g
    BOARD_DIRECTORY '';/ Z8 u2 F, \- m( O
    OLD_BOARD_NAME 'C:/Documents and Settings/Administrator/桌面/现场信息记录仪资料09.4.19/Project/cmos原理图/allegro/mt9d111.brd';4 o6 M# L9 I& V" y/ Z3 u+ ?
    NEW_BOARD_NAME 'C:/Documents and Settings/Administrator/桌面/现场信息记录仪资料09.4.19/Project/cmos原理图/allegro/mt9d111.brd';
    $ G5 `8 c  E9 y9 f: KCmdLine: netrev -$ -5 -i C:/Documents and Settings/Administrator/桌面/现场信息记录仪资料09.4.19/Project -y 1 C:/Documents and Settings/Administrator/桌面/现场信息记录仪资料09.4.19/Project/cmos原理图/allegro/#Taaaaaa03240.tmp
    ( `$ B; C" g" l" v4 s------ Preparing to read pst files ------
    3 |7 }) M6 g! R" I
    ; ]7 R- _1 H& N: e, @3 K#1   ERROR(24) File not found% S) s! @/ X. [
         Packager files not found- o% N' d. H- H- S" v) a1 v
    #2   ERROR(102) Run stopped because errors were detected
      U1 p8 c, z5 X5 |2 Tnetrev run on Jul 9 11:25:57 2009
    % N, i( @8 R% o   COMPILE 'logic'
    & [& h4 w. _0 l% i- |& d   CHECK_PIN_NAMES OFF3 t  E2 A* C7 r! `! t* A/ K" M; p8 U
       CROSS_REFERENCE OFF
    * D1 p$ n1 V+ K9 S" C   FEEDBACK OFF+ h1 g& ]3 W9 g2 q  ?
       INCREMENTAL OFF
    ' v+ ?6 ?4 `& `3 k# ]   INTERFACE_TYPE PHYSICAL; z# f  o( j( h4 E( A
       MAX_ERRORS 500) p6 p  N# D) Q8 L8 Q
       MERGE_MINIMUM 5  F; g5 c4 t1 _9 Q9 a0 e/ ?: M1 W4 w
       NET_NAME_CHARS '#%&()*+-./:=>?@[]^_`|'
    " ~0 P5 I1 L: \1 ~" N$ W5 O" E8 K   NET_NAME_LENGTH 24# N8 w6 G6 m. q% F% J
       OVERSIGHTS ON& ?3 e0 w1 ^/ I  ^
       REPLACE_CHECK OFF
    ! a7 b. N" Y, D$ I' x   SINGLE_NODE_NETS ON
    9 E/ c; X( o" M! `+ H   SPLIT_MINIMUM 0
    5 i4 I3 i0 e1 C$ K- W+ z' L  b. h   SUPPRESS   20' C) D( M4 {+ i' T8 g. ~0 _2 Z
       WARNINGS ON
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    7 ?/ d+ S4 m9 D& J+ F( A No oversight detected; l# E( f( g/ |
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    $ x# }( R4 [; U3 p- R9 X5 Relapsed time  0:00:00
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