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多层板每一层都要铺地吗

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  • TA的每日心情
    开心
    2019-11-20 15:17
  • 签到天数: 1 天

    [LV.1]初来乍到

    跳转到指定楼层
    1#
    发表于 2019-11-21 17:59 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    x
    画了一块6层板  除了第二层和最后一层是地平面  其他都没有铺铜 都是信号和电源。有必要
    : V, A0 ]2 W. ]每一层都铺上地吗。不铺好像没有看见过 见过的都铺了
    / D" d9 T6 U0 d: C0 `

    该用户从未签到

    推荐
    发表于 2019-11-22 09:50 | 只看该作者
    需要的,对EMC有帮助
  • TA的每日心情
    开心
    2019-11-20 15:17
  • 签到天数: 1 天

    [LV.1]初来乍到

    推荐
     楼主| 发表于 2019-11-22 09:53 | 只看该作者
    本帖最后由 klevin 于 2019-11-22 15:09 编辑 4 @) u9 J: b5 G9 F
    Kileo 发表于 2019-11-21 20:26
    " s2 o( m& H! E铺铜是为了给信号提供最小的返回路径,作为信号的参考层,有利于保证阻抗的一致性。楼主能不能把叠层设计放 ...
    ; A" q) K5 U5 a* V0 T; Q
    没有电源平面 其他层都布了线了 层叠 top gnd signal signal signal bottom

    该用户从未签到

    推荐
    发表于 2019-11-21 20:26 | 只看该作者
    铺铜是为了给信号提供最小的返回路径,作为信号的参考层,有利于保证阻抗的一致性。楼主能不能把叠层设计放出来看下呢,第二层和最后一层是地平面,不知道电源平面是哪些层,总感觉有的信号没有参考平面

    点评

    没有电源平面 其他层都布了线了  详情 回复 发表于 2019-11-22 09:53
    头像被屏蔽
  • TA的每日心情
    开心
    2025-1-23 15:05
  • 签到天数: 17 天

    [LV.4]偶尔看看III

    4#
    发表于 2019-11-22 05:09 | 只看该作者
    提示: 作者被禁止或删除 内容自动屏蔽

    该用户从未签到

    5#
    发表于 2019-11-22 08:00 | 只看该作者
    第二层和最后一层是地平面,那么第五层和顶层也必须是满满的铜,以保持层叠平衡,所以这两层需要铺。
  • TA的每日心情
    慵懒
    2022-12-6 15:22
  • 签到天数: 8 天

    [LV.3]偶尔看看II

    6#
    发表于 2019-11-22 09:44 | 只看该作者
    空白处一般都要铺地,否则在制板的时候会出现不平整的情况,不好压板

    点评

    零碎也是要铺的,可以打地孔连接起来。  详情 回复 发表于 2019-11-22 10:22
    主要是我都布了线 铺地的话会比较零碎  发表于 2019-11-22 10:18

    该用户从未签到

    9#
    发表于 2019-11-22 10:17 | 只看该作者
    1、铺铜和地相连,这样可以减少回路面积;,保持信号完整性,给高频数字信号一个完整回流路径。. g! K0 j5 Z, D# B- g8 d* a
    2、对于大面积地或电源铺铜,会起到屏蔽作用,起到防护作用。7 g! l$ q! U- g3 X
    3、对于pcb工艺要求,保证层压不变形。
  • TA的每日心情
    慵懒
    2022-12-6 15:22
  • 签到天数: 8 天

    [LV.3]偶尔看看II

    10#
    发表于 2019-11-22 10:22 | 只看该作者
    weiimi 发表于 2019-11-22 09:44
    , T) w- I) B- O+ e+ @  d- r! y空白处一般都要铺地,否则在制板的时候会出现不平整的情况,不好压板
    + l+ G" b( n; D! t+ d
    零碎也是要铺的,可以打地孔连接起来。
    # M( e$ T% r5 o+ P2 Z6 R1 P& h

    点评

    铺铜是一个窄带会有天线效应吗  详情 回复 发表于 2019-11-22 11:08
  • TA的每日心情
    慵懒
    2022-12-6 15:22
  • 签到天数: 8 天

    [LV.3]偶尔看看II

    11#
    发表于 2019-11-22 11:11 | 只看该作者
    会,要加过孔,如果加不了,尽量把窄一点的铜皮修一下,调整走线间距

    点评

    那要是这样说是不是铺了反而更加麻烦  详情 回复 发表于 2019-11-22 13:07
  • TA的每日心情
    开心
    2019-11-20 15:17
  • 签到天数: 1 天

    [LV.1]初来乍到

    12#
     楼主| 发表于 2019-11-22 13:07 | 只看该作者
    weiimi 发表于 2019-11-22 11:11/ z/ i. U# Y& W0 _
    会,要加过孔,如果加不了,尽量把窄一点的铜皮修一下,调整走线间距

    5 N8 E8 b$ U" z那要是这样的话是不是铺了反而麻烦

    点评

    没有不麻烦的  详情 回复 发表于 2019-11-22 14:08
  • TA的每日心情
    慵懒
    2022-12-6 15:22
  • 签到天数: 8 天

    [LV.3]偶尔看看II

    13#
    发表于 2019-11-22 14:08 | 只看该作者
    klevin 发表于 2019-11-22 13:07
    5 k. Q, @8 C) x( H5 n7 u1 H# \那要是这样的话是不是铺了反而麻烦

    7 S. ?. z5 V: h5 l  E9 [" ?3 `没有不麻烦的; X+ \- U( d7 d* V( l1 K, }

    该用户从未签到

    14#
    发表于 2019-11-22 19:37 | 只看该作者
    klevin 发表于 2019-11-22 09:53:460 v; t1 {$ v& o. n3 M! {+ @
    本帖最后由 klevin 于 2019-11-22 15:09 编辑 ) x& w0 L, R1 r. c  s

    3 H# f/ v+ Y3 @4 l7 _- q[quote]Kileo 发表于 2019-11-21 20:26
    + r2 X9 E* |6 x, [$ x/ E4 V$ h# Y铺铜是为了给信号提供最小的返回路径,作为信号的参考层,有利于保证阻抗的一致性。楼主能不能把叠层设计放 ...
    7 B+ y* d4 S* D9 E5 C) E; v3 Q. o
    没有电源平面 其他层都布了线了 层叠 top gnd signal signal signal bottom[/quote]
    " [! V! K' a1 _/ r3 {0 F% x6 B2 d3 ]" y. M* N
    楼主,一般pcb的层叠设计要保证对称性,否则生产时容易发生翘曲现象,不利于后期的量产。top gnd signal signal signal bottom你这种层叠设计很容易发生翘曲的,还有中间三个信号层很容易出现信号串扰的问题,建议优化下叠层设计。可以把L5和bottom层互换,这样能保证层叠设计的对称性,但这样也未必是最佳的叠层设计,楼主可以根据自己的实际项目优化层叠。
      ?" x1 l5 W6 V6 P1 t9 u5 G
      A+ w$ L- M& J! t1 k. K至于楼主咨询的是否每一层都要铺地铜,这个要具体问题具体分析,一般铺铜可以起到屏蔽信号的作用,对EMC有好处。/ b! F1 I' l: Y# ]4 n0 w

    ) j# H; ~# Z2 _( i8 c6 I2 {

    “来自电巢APP”

    点评

    好的 已经将第五层改为GND层 多余的线布在了第六层  详情 回复 发表于 2019-11-25 14:25
    主要是这样 我bottom放了不少去耦电容 为了防止接地不理想 我在bottom层直接铺了地 基本没布线 所以有一部分线就放到了第五层  发表于 2019-11-25 09:06
  • TA的每日心情
    开心
    2019-11-20 15:17
  • 签到天数: 1 天

    [LV.1]初来乍到

    15#
     楼主| 发表于 2019-11-25 14:25 | 只看该作者
    Kileo 发表于 2019-11-22 19:376 [- q4 U3 @) l1 a$ x
    没有电源平面 其他层都布了线了 层叠 top gnd signal signal signal bottom

    * A  m5 ^, k5 v1 n, F可以  已经将第五层改为GND层  多余的线布在了第六层 ) P, G3 F: v6 r' P1 n
    4 ]0 E6 E0 S# S9 d
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