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AD14制作封装警告有额外的引脚

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zanggg
  • TA的每日心情
    开心
    2023-5-10 15:19

    • 签到天数: 120 天

    [LV.7]常住居民III
    跳转到指定楼层
    1#
    发表于 2019-10-14 16:39 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    x
    做了一个封装，警告说有额外的引脚[Warning]        数字逻辑.SchLib        Compiler        Extra Pin SN74LVC1G66DBV-1 in Normal of part SN74LVC1G66DBV
      L7 F9 {" C2 Z! V仔细看了下，原理图封装文件里没有额外的引脚，PCB封装文件里也没有多余的引脚' k! U7 |1 w8 s* z0 j' K( O
    求教这个警告怎么消除。
    7 x# Y' S5 T( b  J

    微信图片_20191014163358.png (90.19 KB, 下载次数: 0)

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    EDA365微信号及QQ群号！
    yxlk

    该用户从未签到
    2#
    发表于 2019-10-14 18:38 | 只看该作者
    是有悬空的吗

    点评

    zanggg
    你说的悬空是什么意思？  详情 回复 发表于 2019-10-14 19:06

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    zanggg
  • TA的每日心情
    开心
    2023-5-10 15:19

    • 签到天数: 120 天

    [LV.7]常住居民III
    3#
     楼主| 发表于 2019-10-14 19:06 | 只看该作者
    yxlk 发表于 2019-10-14 18:38  d3 [3 P  X: X6 p* Q4 y" c
    是有悬空的吗
    ) |9 M2 b$ _/ P* [1 c* _/ W
    你说的悬空是什么意思？

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    fox_gale
  • TA的每日心情
    奋斗
    2025-7-22 15:16

    • 签到天数: 1241 天

    [LV.10]以坛为家III
    4#
    发表于 2019-10-15 07:28 | 只看该作者
    你是不是在原来好几路运放的封装上改来的？看警告是有part 你查一下

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    yihafewu

    该用户从未签到
    5#
    发表于 2019-10-15 10:42 | 只看该作者
    % Q- I) c, U. z' a
    点击mode，把下面除了normal外的其他都删了（点击右侧的减号进行删除）。
    - s! B3 A( l, W: a* I保存，更新当前封装到原理图，即可。
    7 R4 @" S2 ~' p1 D) s! q  Y: h& B0 W8 V

    点评

    zanggg
    谢谢，你的方法可行，早上我找到问题了，发现是封装不同模式下的pin脚号和名称对不上。修改后就正常了。  详情 回复 发表于 2019-10-15 12:17

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    zanggg
  • TA的每日心情
    开心
    2023-5-10 15:19

    • 签到天数: 120 天

    [LV.7]常住居民III
    6#
     楼主| 发表于 2019-10-15 12:17 | 只看该作者
    yihafewu 发表于 2019-10-15 10:42. z. M3 w: D; N
    点击mode，把下面除了normal外的其他都删了（点击右侧的减号进行删除）。% I$ i! Z" g0 D- O
    保存，更新当前封装到原理图， ...
    " s) ~6 j1 l8 e+ k+ b9 B
    谢谢，你的方法可行，早上我找到问题了，发现是封装不同模式下的pin脚号和名称对不上。修改后就正常了。
    ) @, G& ^/ r7 H' O6 Z4 f4 k1 B9 K

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