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本帖最后由 天夜魅 于 2019-9-3 15:15 编辑
7 q- U0 h1 C9 Z& V& f1 @ E4 z) F: j. N9 w# _# c& Z
本人FPGA初学者一枚，近期在做项目时，出现以下情况，希望各路大神能够解惑谢谢！！！
1 b4 p0 Y" G( p, h& i7 F+ i: }
, `5 Y z& c( _% v4 c本次主要制作一个16个并排的LED跑马灯：
- q2 d+ c8 t. V. ?/ _, w1，异步复位，复位时为全亮。
: N5 E$ T) k2 [; N2,4种模式（pat）00——左循环，01——右循环，10——交叉闪烁，11——全亮全灭闪烁* t! ]; X; y6 M$ Z. _( \
3,4个阶段的速度等级。& Q& W! Z! j$ g6 a- f. G
) j+ \! R* y |1 k出现问题：; G, a0 u/ z) ^: q& @& l
图片出不来了，问题在一楼
7 S6 h1 Y: ?( w* u![]()
/ A& L' ?, j1 A* e' F Q* P( D+ X3 X" \8 I
0 o. v( Y \' `3 ~' u- F# _FGPA代码如下：0 M- Z1 I8 C8 u
1，主模块：+ M6 [' n. r' W4 K: S
) f, F7 e% i2 I% @ f
module more_light(rst,clk,pat,spe,light);
* N, X! [0 _4 G/ c- e ' x; r- b' z8 r6 O. l! D
input rst,clk;
% v3 W5 ]- U: a9 { input [1:0] pat; |% X& n! L- M u' {- G
input [1:0] spe;# Z" ?5 s- t+ X9 g/ g' G y9 I5 J
output [15:0]light;
1 Y7 D; m) o& _, N5 }) [# T reg [15:0]light;
. A" K7 h4 M; q* |& p' i //wire andout1,andout2,andout3,andout4;/ v& l: v& u5 I! _
wire out1,out2,out3,out4;
, _* E9 b/ Z8 D; h2 X( O
( g7 a8 J& i- ? 5 M- L. O( N$ K3 z; L9 {: I
/*and u1(!pat[1],!pat[0],andout1);
/ \0 s' N: \; X$ o, A5 ] and u2(!pat[1],pat[0],andout2);4 L4 R) f1 k7 E+ [& O" G
and u3(pat[1],!pat[0],andout3);# }/ h8 o( |- F3 p1 z/ t
and u4(pat[1],pat[0],andout4);*/
* [( }9 r+ E) O /*assign andout1=(~pat[1])&(~pat[0]);
2 ^$ y* [2 [2 H7 C" f" d assign andout2=(~pat[1])&(pat[0]);4 _1 ]& _& j# X2 @, ?6 Q0 _
assign andout3=(pat[1])&(~pat[0]);. X2 B1 r/ K" F: W. z5 w
assign andout4=(pat[1])&(pat[0]);*/! P( P0 S y! K& m& D2 D
! r# E4 w2 \9 L1 }" o. {8 Q
shift_reg1 u5(.rst(rst),.clk(clk),.out(out1));. j0 }' A% n: R" P; X: u4 V0 f
shift_reg2 u6(.rst(rst),.clk(clk),.out(out2));
8 J9 R4 W) T- @3 n% C& X shift_reg3 u7(.rst(rst),.clk(clk),.out(out3));
' ^' B$ P k' U7 ] Y //shift_reg4 u8(.rst(andout4),.clk(clk),.out(out4)); , F7 l, g9 ^. E9 m. u
5 _ {+ t e i( O& }1 I$ X+ T
always @(rst,pat,spe)
! U9 s7 K0 \7 v+ G if(!rst)2 t( y( z- q- p) j4 Y' r3 E) ^$ A
light <= 16'b1111_1111_1111_1111;# N. i4 m; x* p2 z0 q3 Z% C
else
% g \+ u9 X* L+ E if(pat==2'b00)
9 F" ? W/ z2 W case(spe)
/ N8 a+ R e8 v% {' a) o 2'b00: #10 light=out1;
* b8 x' U+ E/ q$ ^* _$ l 2'b01: #20 light=out1;& D D; l! x5 p. S: X7 d
2'b10: #40 light=out1;3 f' K5 d) k7 u& z
2'b11: #80 light=out1;5 n$ }3 {1 G8 [- E4 s
endcase. O' Y/ Q% [2 p W* w T
else
/ G- B9 [0 E, u# d8 A2 ~ if(pat==2'b01)
# \. L) k0 Y0 n case(spe)
. N& c" y) o+ { 2'b00: #10 light=out2;5 L6 S( q6 F3 d4 S
2'b01: #20 light=out2;, v# h' u$ H S5 I* n0 h( R) H# I
2'b10: #40 light=out2;
4 c' V4 d }$ H6 ] 2'b11: #80 light=out2;
: L$ \. d, v5 E; ^0 T' e endcase
# p2 Y* s8 B) |8 d" H7 i: A, u else
* \ s2 o0 K' b if(pat==2'b10) . I8 u6 j: z' j; C
case(spe)4 l& w7 G& u+ ? x% N# A+ G
2'b00: #10 light=out3;
2 J# q# a. X) l, P 2'b01: #20 light=out3;
& U4 j( _" H0 C 2'b10: #40 light=out3;
5 _* n2 V! H$ ? f! ^# x: ~ 2'b11: #80 light=out3;& v, x, ]) z+ a# S7 {
endcase, ^$ ?& A4 K e
else / e `% @! e+ V' M6 r( d4 |, X
if(pat==2'b11)
# C1 k1 q0 h. W0 h case(spe)
' O i. i1 P9 b( \+ N1 C" [2 R 2'b00: #10 light=~light;( _) l' k! }9 n
2'b01: #20 light=~light;0 I. f7 i k# Q. r P* a1 t
2'b10: #40 light=~light;
4 b# J+ D3 u$ P2 c; t, m- d$ S0 j 2'b11: #80 light=~light;
! K% S' c4 y$ h. f r endcase8 k1 w0 |3 ]# S/ e
7 b9 I7 F% {) y! |endmodule
8 w4 I" ~% K( S4 }8 f0 u0 z, m! d. e; i O. W! a
7 ]; t m. J6 E# d* p8 V
( ?/ a+ \+ w# P( x& A
2分模块：1 V3 U3 [; w* C) ] g- j
1.1
! w) U8 v; z' e* @/ u
& d. T* K& k& |/ H% w! E1 pmodule shift_reg1(rst,clk,out);6 F' w i3 b8 n/ w
, d: o) n1 n0 E# n% n, I
input rst,clk;
' A$ ]2 f+ V: m7 X output [15:0]out;, y6 i1 q! R+ U3 d. g
reg [15:0]out;" F; Q& I" S1 r: O, {1 H
7 H/ \6 P. J+ m" @ always @ (posedge clk,negedge rst)
( \; j$ n$ w7 {9 R. t* b * W2 E* t% {7 w
if (!rst)
+ e+ e6 n4 u, O0 C% G out=16'b0000_0000_0000_0001;' B" v7 U a5 H4 M/ u2 [
else
( R6 M/ O1 ~) u5 n out={out[14:0],out[15]};( d# E! m6 f, k' M$ O
7 V5 p9 u1 Y( @( D& L
endmodule
" N) D, G. N$ A" x4 V' i8 }7 H: c8 p" S' R
! |, o% A! S, I! D3 U' x
1.2, N% e+ {9 J" N8 q! O3 _ }' b
module shift_reg2(rst,clk,out);6 v: j" l' n1 L* E% z
2 {) }! l' x2 ?* K/ `% k1 S! v input rst,clk;
7 m5 j. h- X" h( j, f1 z+ i output [15:0]out;
! i- b4 {+ r# u, j4 i reg [15:0]out;
* q( ~ g' x9 U( P* a
0 a! j/ e& ^9 c8 v* F9 y always@(posedge clk,negedge rst)
+ Z, Q8 D. D" I/ j7 _6 { if (!rst)
4 \& b+ Q" i2 O a6 s Z% _ out=16'b1000_0000_0000_0000;
$ d1 z8 M8 E* }8 w, C else 9 L) T3 w: R |2 [
out={out[15:1],out[0]};0 N2 J. ?* M3 V- U8 K
$ r1 p- W0 q4 K9 j" h- l/ Vendmodule - q3 Q8 K0 \" j" C! Q$ N) m: K- F
- B! o1 `! k. e2 j3 C) l. r
" l8 j" h" h. U0 o* O0 t" t" o9 a1.3! m& u2 k$ o6 T4 z, D7 b0 _
module shift_reg3(rst,clk,out);' Z' }6 H7 v" Z! c
0 `5 n C; {0 w3 g
input rst,clk;9 N3 E5 K' F2 U5 G
output [15:0]out;$ o |6 N5 A D- J' e% ?
reg [15:0]out;
0 V, d, H+ {" m- y - k+ Q6 N3 \+ u4 k3 R* F1 w9 Z
always@(posedge clk,negedge rst)
J$ w z+ E( M" q/ J* @ if (!rst)
$ Q; X# W9 Q4 h4 p4 q. ` out=16'b1010_1010_1010_1010;; a" o k2 C" _& {& d- ~- o
else
# `' T, ?" I$ _6 V3 @" @8 T out={out[15:1],out[0]};9 E* p$ T; J* q/ u G
, T5 |+ W" g Z9 k- Wendmodule
3 G- F1 _/ {/ X* [) m& g& q% E
! Y p6 o* R! X5 p9 M
7 q6 n! m1 b$ h6 [# i
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发表于 2019-9-3 15:12
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