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FPGA-17-xilinx_zynq7000_EPP上一个简单实验(PS+PL)(上)

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发表于 2019-8-19 14:42 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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引言4 a. L; r1 H2 w/ C6 V

, Z# a) Y; e0 I4 H$ Y+ V' t
% x# e, {. g: M
前面两个实验,PL是传统的FPGA开发,PS是传统的嵌入式开发。
. F3 J! N- O7 R. ~" F1 E5 i4 B6 ^7 {6 B) V, t3 O

" D( P" \+ G0 r7 ~$ F% w8 E  Dzynq7000EPP是xilinx比较高端的FPGA开发板,XC7Z020内部集成了两个cortexa9的硬核,外部有1G的DDR3,所以单纯做FPGA太浪费了。但是单纯用PS资源,就没必要用FPGA了,所以只有将两者结合使用才能体现其价值所在。( Y6 V# \1 l# `4 o/ n( F
4 S$ n: t0 j+ O* Z

; U% m- W5 r& w9 T即,PS+PL。添加自己的一个IP到AXI总线上,然后通过SDK编码控制它的寄存器,这就是本小节的实验内容。3 j. `: `" @# F# Z

; Q7 ]/ Q4 T, P0 f3 l
7 V+ n7 A. P, w, b! u
% ~# Y- D$ i: n1 w, ^5 R

7 R: `! Z! M# o! \; f1 实验目的8 u* g( c$ q6 d; D' r1 I

5 k, c" p% I% U0 L3 b  X7 W
9 \9 o8 J9 b2 T! G$ `6 Z$ @* G
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发表于 2019-8-19 18:08 | 只看该作者
看看什么东东。
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