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EDA365电子论坛网»电子社区 › 研发技术版块 › FPGA|CPLD论坛 › xilinx FIFO 读写问题
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xilinx FIFO 读写问题

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xuzhiping

该用户从未签到
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1#
发表于 2009-6-18 18:05 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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大侠们好 求救一个问题，本人用xilinx xc3s1600芯片中加入了一个 异步FIFO IP核进去。S3C2440写入数据正常，芯片内部读数据和写数据也正常。就是S3C2440总线去读FIFO时，读回来的数据是错的一塌糊涂。从总线写入/读出数据的时钟是65M，FPGA内部读写时钟是3.25M。仿真是对的（见附件）。求救大家了是什么问题？ 谢谢了！！！！

仿真波形.rar

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bugs

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2#
发表于 2009-6-24 10:16 | 只看该作者
You read/write signal has to been ONLY 1 clock cycle wide.

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cgh996

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3#
发表于 2010-10-9 15:25 | 只看该作者
这个问题我也遇到

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IO357
  • TA的每日心情
    奋斗
    2019-11-21 15:17

    • 签到天数: 1 天

    [LV.1]初来乍到
    4#
    发表于 2011-2-10 18:23 | 只看该作者
    可能有潜伏周期
    ! n4 |) Y9 s3 I! m* e1 ^+ A3 W% A

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    Jansen

    该用户从未签到
    5#
    发表于 2011-5-6 00:20 | 只看该作者
    改成两个周期读写一次，看看7 j4 {% ]8 ]3 e

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