找回密码
 注册
关于网站域名变更的通知
查看: 294|回复: 6
打印 上一主题 下一主题

FPGA_CPLD选型与设计优化

[复制链接]

该用户从未签到

跳转到指定楼层
1#
发表于 2019-7-23 10:59 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您登录!

您需要 登录 才可以下载或查看,没有帐号?注册

x
FPGA_cpld选型与设计优化

  F0 q1 m/ X0 T" a4 B! Q
+ B5 L. d- ]2 s6 w1 T/ t$ }6 d" D" w6 c$ U. x7 [. B  D
对FPGA/CPLD器件的结构与性能进行分析与对比,阐述了电子系统设计中FPGA/CPLD使用基本规则,根据实际的设计目标、结构特性、有效的基准数据、基准化测试进行选型。在系统速度、资源利用率、可靠性等方面结合项目设计对系统工作性能进行优化,给出了FPGA/CPLD的设计开发流程和资源共享、逻辑优化、串行化、流水线设计,关键路径、寄存器配平、竞争冒险、适配优化等具体实现的优化方法。% G( n# W( N( ]- q! x+ Y* u
游客,如果您要查看本帖隐藏内容请回复

该用户从未签到

2#
发表于 2019-7-23 18:34 | 只看该作者
FPGA_CPLD选型与设计优化

该用户从未签到

5#
发表于 2022-7-11 09:45 | 只看该作者
goodnice,非常好!* b) O9 n( r4 B, D7 |
  • TA的每日心情
    难过
    2025-1-20 15:39
  • 签到天数: 100 天

    [LV.6]常住居民II

    7#
    发表于 2022-7-13 15:17 | 只看该作者
    aaaaaaaaaaaaaaaaa
    您需要登录后才可以回帖 登录 | 注册

    本版积分规则

    关闭

    推荐内容上一条 /1 下一条

    EDA365公众号

    关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号-1 )

    GMT+8, 2025-11-3 17:23 , Processed in 0.156250 second(s), 27 queries , Gzip On.

    深圳市墨知创新科技有限公司

    地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

    快速回复 返回顶部 返回列表