|
|
EDA365欢迎您登录!
您需要 登录 才可以下载或查看,没有帐号?注册
x
串行接口常用于芯片至芯片和电路板至电路板之间的数据传输。随着系统带宽不断增加至多吉比特范围,并行接口已经被高速串行链接,或SERDES (串化器/ 解串器)所取代。起初, SERDES 是独立的ASSP 或ASIC 器件。在过去几年中已经看到有内置SERDES 的FPGA 器件系列,但多见于高端FPGA芯片中,而且价格昂贵。$ p3 ]2 Q) o9 Z" M1 x: f+ C( b
5 k* a2 ]8 m' e! b- p$ t 本方案是以CME最新的低功耗系列FPGA的HR03为平台,实现8/10b的SerDes接口,包括SERDES收发单元,通过完全数字化的方法实现SERDES的CDR(Clock Data Recovery,时钟数据恢复),完成100~200Mhz的板间SERDES单通道通信,该SERDES接口方案具有成本低、灵活性高、研发周期短等特点。
1 q' R; E- ~- L; ]& G3 E, r" e- Q7 u) @ [! P# G, J6 ]7 d) n
1 硬件接口:+ B$ Z7 F& [( j3 ^" p/ l) S$ z' N
6 p$ |8 O5 C# D0 [
9 i! |& y. V, b$ a& B' p# z q7 c8 `3 Y; W/ S6 k) ?8 j
- k f0 i% K, w8 X1 l! }& ?7 i1 D1 {- V( Z- h" f
+ m* T8 \/ b, g6 w* t+ l ~
|
|