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FPGA vhdl语言 process for loop循环???

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1#
发表于 2019-7-10 15:47 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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process(a)0 s& b: ]# `7 v9 r1 x
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for i in 1 to 27 loop
/ z& o( C! o+ x* [& i当a变化一次 for循环执行几次?3 Y" v8 k3 _) W4 x6 z

该用户从未签到

2#
发表于 2019-7-10 17:54 | 只看该作者
不知道你后面的循环语句是什么,如果是和i比较的话,那就是1到27各比较一遍
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