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FPGA ------- SRIO IP核系统总览以及端口介绍(二)(I/O Port 含义介绍)

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发表于 2019-7-10 13:27 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 pulbieup 于 2019-7-10 13:29 编辑 ( u7 _% K( o+ |7 T0 Y4 l2 C
9 `8 H; I( [, q$ n2 s/ T# ?) o
上篇:FPGA ------- SRIO IP核系统总览以及端口介绍(一)(User InteRFaces 之 I/O Port)根据数据手册PG007,介绍到了逻辑层接口的IO口,今天想研究下,这些端口如何使用,结合实际问题来想想这个问题。
: ?: j3 d5 Q, c! s1 I
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- }5 |( r8 `1 x我们知道I / O端口可以配置为两种样式之一:Condensed I/O or Initiator/Target.
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  A# G' N7 L8 P1 I1 }5 B  v. W我们考虑使用Initiator/Target方式:* h# w* [# e2 W" d% S

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这种方式的端口信号分为ireq/iresp与treq/tresp这两对信号类型。
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