找回密码
 注册
关于网站域名变更的通知
查看: 556|回复: 3
打印 上一主题 下一主题

基于ARM 总线的接口实现

[复制链接]

该用户从未签到

跳转到指定楼层
1#
发表于 2019-7-9 15:46 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您登录!

您需要 登录 才可以下载或查看,没有帐号?注册

x
基于ARM 总线的接口实现
- b, x% \* ]- g7 ^! c$ \' n2 e6 k
+ g/ L+ b" A: `, M7 n: X
- O) y6 A1 I' f& o8 ^
从最简单的接口APB到复杂的 AXI 主机,芯片设计者可以将FPGA 引入到 APB、 AHB和 ARM 体系结构的AXI等各种总线中。随着网络、深度学习和人工智能(AI)、航空航天等应用系统的需求日益增加, 芯片(SoC)和微控制器(mcu)设计对系统的需求也发生了变化。 如今, 在主 CPU 核心处理通用任务时, 还会使用DSP 和 FPGA IP 块的芯片。 这些架构使得整体处理解决方案更加高效而灵活。" @1 ~% Z/ l' k6 s
: I" @& _- d9 s4 b! I, B$ M) E
; G' r! c- A% C8 Q4 t9 ~
特别是, 由于上述原因, 嵌入式FPGAs 与传统的 DSP 和 FPGA 不同, eFPGAs 可以设计成芯片, 作为可重构的 IP 块, 可以重新编程以处理不同的工作负载加速任务或管理不同的I/O (图10)。; b7 `" \6 H; U

6 E1 c. Z7 u) Z& P9 I" L
7 V) @5 y8 v, Y7 b" x

( o1 m5 _# q& X
1 ?9 Z2 F# @+ v8 a; `

! z1 W/ V1 M# h  N1 @8 h+ u& q% f图10 Flex Logix 的 EFLX eFPGA IP 作为可匹配的硬件加速块或重新编程的I/O 块在 MCU 和 SoC 设计中的实现7 G5 W# ~/ X3 k) V1 c
' W: d0 S! p4 m

; ?" G3 P% S+ v" ?5 |8 q例如, 对于基于 ARM 架构的芯片设计者来说, eFPGA可以与 APB、 AHB 或 AXI 处理器总线相连, 以利用这些优势。 然而, 考虑到大量的组合(主 / 从 AXI/AHB/APB外部接口逻辑或/与 eFPGA 实现的组合), 这些设计需要仔细考虑。( n9 _) G4 j; \! X5 }8 U

8 \: g( E$ n, \
" B* s' s( S# ~7 b* N  M- a
eFPGA 的I/O资源
6 J8 m* W- L. W1 x$ H0 w3 ]* B: X7 y8 b( b
游客,如果您要查看本帖隐藏内容请回复
0 N6 z6 d$ Q, _- w

9 G$ }9 y, K+ g2 q
/ L( I0 O% i0 O' F+ |1 c* b% U

该用户从未签到

2#
发表于 2019-7-9 17:13 | 只看该作者
研究一下,谢谢楼主分享

该用户从未签到

4#
发表于 2022-11-26 17:26 | 只看该作者
基于ARM 总线的接口实现
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

推荐内容上一条 /1 下一条

EDA365公众号

关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号-1 )

GMT+8, 2025-10-5 12:34 , Processed in 0.156250 second(s), 26 queries , Gzip On.

深圳市墨知创新科技有限公司

地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

快速回复 返回顶部 返回列表