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[仿真讨论] 差分线间距由什么因素确定?

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1#
发表于 2019-7-1 09:40 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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差分线间距由哪些因素决定呢。
' Q! ]6 n8 m- Y% u- ]" N8 @' O! g
9 T+ \* j  U+ [% g& }! B  @4 g1、BGA球栅间距所决定的布线通道宽度(BGA球栅间距减去过孔焊盘直径,还能走差分线);
2 f" C6 y+ U& r5 Q还是:
$ {4 u5 b6 H8 s0 d3 A* X/ H1 B2、PCB蚀刻精度决定最小间距。
  ]5 P) h$ |/ D# E/ J+ K- W  U7 u; n& I4 j0 P4 E

1 o7 S( {# U$ ]5 ~+ v: ]8 g3 _我的意思是,如果确定差模阻抗100欧,就不需要再去确定共模阻抗、偶模阻抗吧。  w3 O- k8 e" j+ ^9 Q- l8 }

6 T1 p" v, f8 \2 C而只是由工程上的物理实现能力决定差分线间距,对吗?1 v4 k# G+ a: P0 `+ D

该用户从未签到

3#
发表于 2019-7-1 11:09 | 只看该作者
你可以看看si9000 就知道怎么算了

该用户从未签到

5#
发表于 2019-7-1 11:30 | 只看该作者
怎么确定间距

点评

有一些经验值可参考,一般做紧耦合,间距小于2倍线宽  详情 回复 发表于 2019-7-1 16:59

该用户从未签到

6#
发表于 2019-7-1 14:48 | 只看该作者
有个问题请教一下,控差分阻抗的时候需要先控单线的50欧姆阻抗吗?之前算的时候一直没有注意单线阻抗,好像也没什么问题

点评

不需要,看阻抗要求,一般特殊信号或者速率高的信号线需要控制阻抗,之前的单线没问题,说明速率很低,直接计算差分线阻抗就可以了  详情 回复 发表于 2019-7-1 16:54
  • TA的每日心情
    慵懒
    2022-12-6 15:22
  • 签到天数: 8 天

    [LV.3]偶尔看看II

    7#
    发表于 2019-7-1 16:54 | 只看该作者
    xian2006 发表于 2019-7-1 14:48
    8 r+ Y4 t% N- N* I$ g3 j: Q有个问题请教一下,控差分阻抗的时候需要先控单线的50欧姆阻抗吗?之前算的时候一直没有注意单线阻抗,好像 ...

    : l$ ^7 w% x9 p2 G2 F' h$ G  ]不需要,看阻抗要求,一般特殊信号或者速率高的信号线需要控制阻抗,之前的单线没问题,说明速率很低,直接计算差分线阻抗就可以了
    8 Q% M3 T4 L% s; L& i+ U' b

    该用户从未签到

    8#
    发表于 2019-7-1 16:59 | 只看该作者
    高速线都应该按传输线控制阻抗!
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    2022-12-6 15:22
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    [LV.3]偶尔看看II

    9#
    发表于 2019-7-1 16:59 | 只看该作者
    zyxiaokiss 发表于 2019-7-1 11:30  u- x, G4 g: b0 o8 Z- F2 J
    怎么确定间距

    9 i5 f9 H: N" c- M有一些经验值可参考,一般做紧耦合,间距小于2倍线宽# M7 _6 Z2 a( o- l
  • TA的每日心情
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    2022-1-30 15:17
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    [LV.2]偶尔看看I

    12#
    发表于 2019-7-11 13:34 | 只看该作者
    主要由阻抗决定, 跟参考层的厚度,介质层材质有关

    该用户从未签到

    13#
    发表于 2019-7-18 15:22 | 只看该作者
    既然决定了走差分线,那差分间距的主要影响因素有PCB布线空间,还有一个耦合度的要求,有的协议上是有耦合度要求的,没有耦合度要求的一般也会选择差分间距小一点,抗干扰能力会强
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