请问在pads logic中怎么检查错误？

asusash · 发表于 2009-5-27 14:13

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请问在pads logic中怎么检查错误？就像在orcad中做DRC检查一样，检查原理图的错误或者网表的错误、、

jimmy · 发表于 2009-5-27 17:32

不用检查。logic画图不允许错误存在，有错误就不会让你进行下去的。

WDYAI · 发表于 2009-5-28 00:01

明白喽
很好！！！

kofkyok · 发表于 2010-11-24 22:29

明白了~~~~~~

wuguodong777 · 发表于 2011-4-21 10:30

还是没OrCAD好用，放心！

abtreasure · 发表于 2011-6-5 02:18

用了logic 几天，感觉很多设置很麻烦，还有封装啊、库啊、一大堆，导出网表还一堆错误，要去排除还要花很多时间。以前用ORCAD整原理图半天就搞定，用logic用两天还没有搞好

晨风 · 发表于 2011-6-5 16:04

好啊

chenrow · 发表于 2011-6-5 17:01

来学习的..

vf1983cs · 发表于 2011-6-5 23:33

习惯了就好~~~~

铁神 · 发表于 2011-9-3 13:51

都没有说到重点

铁神 · 发表于 2011-9-4 16:00

abtreasure 发表于 2011-6-5 02:18 + Y# D8 c: w' j
用了logic 几天，感觉很多设置很麻烦，还有封装啊、库啊、一大堆，导出网表还一堆错误，要去排除还要花很多 ...

你好，是怎么排除问题的啦，在下是新手，就是单独一个连接线画好之后都不能删掉

happymewnana · 发表于 2011-9-14 23:28

铁神发表于 2011-9-4 16:00
3 @& {, _3 A) [你好，是怎么排除问题的啦，在下是新手，就是单独一个连接线画好之后都不能删掉

可以删呀，你先选中菜单栏里的删除图标(红色XX)，再用鼠标点击你要删除的线就可以删除了呀！

happymewnana · 发表于 2011-9-14 23:29

ORCAD好用吗？

benking · 发表于 2011-9-15 08:53

abtreasure 发表于 2011-6-5 02:18
$ i: M7 Y! K( Y, C: R! ~* _# y& B用了logic 几天，感觉很多设置很麻烦，还有封装啊、库啊、一大堆，导出网表还一堆错误，要去排除还要花很多 ...

是不是自己不熟额。

dds0201 · 发表于 2013-9-28 15:06

学习了。多谢。

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