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[ADS仿真] IBIS模型咋描述芯片内部的逻辑关系呢

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1#
发表于 2019-5-24 11:07 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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IBIS模型只是描述了芯片的输入输出特性,那么芯片内部的逻辑关系咋描述啊??比如一个反相器的输出端口,IBIS模型里面只有输出特性,那么ADS里面的IBIS的Pin模型又为啥会有个输入啊,这个输入和输出的关系是什么样的?。 如图为DDR3的DQ0引脚,它的输入和输出仿真出来为啥不是反相的而是同相的,它的内部到底对输入做了什么样的运算。
) f  ~) c0 W$ w3 C. d4 A! U* c
  • TA的每日心情
    擦汗
    2024-7-30 15:24
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    [LV.4]偶尔看看III

    2#
    发表于 2019-5-24 13:20 | 只看该作者
    坐等大神解答

    该用户从未签到

    3#
     楼主| 发表于 2019-5-24 17:18 | 只看该作者
    坐等大佬出现                        

    该用户从未签到

    4#
     楼主| 发表于 2019-5-25 07:40 | 只看该作者
    大佬快出现吧                             

    该用户从未签到

    5#
     楼主| 发表于 2019-5-25 07:41 | 只看该作者
    这帖子是凉了吗

    该用户从未签到

    6#
     楼主| 发表于 2019-5-25 08:59 | 只看该作者
    大佬在哪里                 

    该用户从未签到

    7#
     楼主| 发表于 2019-5-26 19:47 | 只看该作者
    还没有大佬吗                  

    该用户从未签到

    8#
    发表于 2019-5-27 11:24 | 只看该作者
    这个是保密的,不会告知的。

    点评

    那为什么会有图中的输入引脚啊,从输入加波形输出就会得到波形,它做了怎样的运算  详情 回复 发表于 2019-5-27 14:56

    该用户从未签到

    9#
     楼主| 发表于 2019-5-27 14:56 | 只看该作者
    jackli198323 发表于 2019-5-27 11:24
    ' r5 ?5 o0 y& m- J, V0 m* g  N这个是保密的,不会告知的。

    * K* L% S' u  O那为什么会有图中的输入引脚啊,从输入加波形输出就会得到波形,它做了怎样的运算- U! j% C+ J& l* n# k- a+ N

    该用户从未签到

    10#
    发表于 2019-6-2 20:18 | 只看该作者
    输入就是给他个激励而已,如速率,波形特征等。ibis就是通过一系列的VT VI曲线描述buffer的行为,等效于一个黑盒子,激励输入,产生buffer输出

    点评

    其实作为ibis使用来说,你没必要关心它是不是反相的,你只需要关心它的输入输出特性即可。这里的输入跟输出也不是反相的意思,有相位差也是die和封装寄生导致。建议你看看《一步一步学会创建ibis模型》及其他ibis相  详情 回复 发表于 2019-6-2 20:47
    我能理解为输出就是按照输入的变化速率变化吗?但是不是反相关系。那这里仿真时输出会按照输入变化的原因是什么?它内部是咋处理的。因为IBISpin只有输出的IV曲线啊,没有输入的特性。  发表于 2019-6-2 20:32

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    11#
    发表于 2019-6-2 20:47 | 只看该作者
    banrx 发表于 2019-6-2 20:18$ Z5 }2 z) h1 k7 d  z0 ^- }, H+ |
    输入就是给他个激励而已,如速率,波形特征等。ibis就是通过一系列的VT VI曲线描述buffer的行为,等效于一 ...
    0 f: Z% l+ `7 n4 ^
    其实作为ibis使用来说,你没必要关心它是不是反相的,你只需要关心它的输入输出特性即可。这里的输入跟输出也不是反相的意思,有相位差也是die和封装寄生导致。建议你看看《一步一步学会创建ibis模型》及其他ibis相关的资料。
    3 Y' S  D6 q4 b% t5 L4 p2 @( \  ~

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    12#
    发表于 2019-8-9 22:11 | 只看该作者
    IBIS的定义,查询下就知道了,这个只是单纯的引脚输入输出模型,并不包括任何逻辑功能
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