TA的每日心情 | 开心 2019-11-19 15:19 |
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大神总结的Inout双向端口信号处理方法
: Y# R8 [! F* Y0 A$ L
8 S, A. f# d* p4 ]" [* B1 F
1 {. X% H3 k( o7 W4 G! b4 z5 B 如果Data_inout不是高阻态,则用作输出,无法做输入的,否则两者岂不有了冲突?
! Y) F' C* o+ Z3 F1 K' k2 F2 { Inout端口信号做输入时,观察例子中的输出Data_out_t就应该是高阻态的.
$ U+ X# E5 i: |8 r& V8 [ 见许多问这个问题的,总结一下大家的贴子,希望能对大家有点用处,如果有不对的地方,欢迎指出.
: f7 t b: r% E$ F8 T8 ^. d( ]4 T 芯片外部引脚很多都使用Inout类型的,为的是节省管腿。就是一个端口同时做输入和输出。 Inout在具体实现上一般用三态门来实现。三态门的第三个状态就是高阻''Z''。当Inout端口不输出时,将三态门置高阻。这样信号就不会因为两端同时输出而出错了,更详细的内容可以搜索一下三态门Tri-State的资料.
4 u) g' Q- h& w7 s4 Y 1 使用Inout类型数据,可以用如下写法:
- D9 \; h A. ]# n9 g# | Inout Data_inout;
" T& Z; }2 @ A% |6 d. C Input Data_in;
: Q0 \6 [6 n* U+ j) e Reg Data_reg;//Data_inout的映象寄存器
) J& ^& O3 n1 c) i: u( D! H- f Reg Link_data;& O* o5 ?+ [0 U; l7 K% \7 J; F" D
Assign Data_inout=Link_data?Data_reg:1''Bz;//Link_data控制三态门. Y" h- w f) U6 R; n' a( W( g, M% ?" r" n
//对于Data_reg,可以通过组合逻辑或者时序逻辑根据Data_in对其赋值.通过控制Link_data的高低电平,从而设置Data_inout是输出数据还是处于高阻态,如果处于高阻态,则此时当作输入端口使用.Link_data可以通过相关电路来控制.1 ^# H* E @. h, o# \1 X# `3 I
2 编写测试模块时,对于Inout类型的端口,需要定义成Wire类型变量,而其它输入端口都定义成Reg类型,这两者是有区别的.$ i7 j$ a8 q% D9 q# r m; ]
当上面例子中的Data_inout用作输入时,需要赋值给Data_inout,其余情况可以断开.此时可以用Assign语句实现:Assign Data_inout=Link?Data_in_t:1''Bz;其中的Link ,Data_in_t是Reg类型变量,在测试模块中赋值.: M9 J6 B5 V: H6 Y' t" e, ^5 z, V
另外,可以设置一个输出端口观察Data_inout用作输出的情况:
- P+ Y( d% Z& Q7 Q6 `5 I$ \- ] Wire Data_out;
% G9 _; r4 T9 h Assign Data_out_t=(!Link)?Data_inout:1''Bz;
3 k. {+ |6 h" _ |
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