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关于verilog 调用函数时多维位宽接口

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  • TA的每日心情
    擦汗
    2019-11-19 15:26
  • 签到天数: 1 天

    [LV.1]初来乍到

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    1#
    发表于 2019-5-22 18:23 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    x
    我已经有一个函数,output为【15:0】的接口;
    * H1 G5 J/ d6 h9 T8 X* e现在想对它多次调用,比如调用n次,输出接口依次为 a[1][15:0],a[2][15:0]......a[n][15:0]( O* n% w% K4 t
    请问这样是否可行?) F& ^3 ]8 y- `9 ]
    或者有什么类似的解决方案?
    : [1 t3 G' W7 C7 }最好给出示例代码。3 l( p( _2 j8 `3 V: ~
    谢谢~
    ! Y; ~9 j4 |8 w0 L, s
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