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FPGA 之 Select IO 篇(2)_IO 逻辑资源简介-------xilinx7系列

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发表于 2019-5-20 11:38 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 pulbieup 于 2019-5-20 13:08 编辑 # i2 c# g& m- i/ A1 R  _

. r3 s3 P3 B/ |% T$ O; q1 b
FPGA 之 Select IO 篇(2)_IO 逻辑资源简介xilinx7系列

- g$ d% c! w" Q! [" u* J8 e目录# N* _8 @+ Q- X, q
: C4 Z! N7 b& t( G; j
1, ILOGIC9 U, `2 u" W- d+ u& ?

: }, W9 k6 I4 W! N3 @: }2 g) ~$ k2, IDELAY
* t& O; d/ Q* O/ @3 V
5 i3 G: p7 Z+ e- C7 r0 \1 ~
3, IDELAYCTRL
' R- v) |8 b( \- L& d

4 ~: f* F* o. r# o, a& S4, ODELAY$ \1 b$ V, ~* `% m2 X: y5 V. c

6 T1 l0 W7 q+ g' i# O9 ?5, OLOGIC4 x) c( l1 X+ L1 {+ I+ T* [4 J4 H
" _# i  I! y* G0 g6 s
& L3 j& _7 I' W
  N& e( o3 H8 b, X# u
6 l0 {% {/ n3 T' r& A# x. ^2 O
       上篇咱们简单的说了I/O的电气特性,本篇咱们接着介绍I/O逻辑资源,先贴上两张图。图1为HPBANK的I/O模块,图2为HRBANK的I/O模块,两者区别在于后者无ODELAYE模块。                           & d1 H/ Q8 b$ B" [9 g
9 |+ z6 G( M, Q' v  t

; x5 P7 ^2 [# k1 Q4 d* p, x) h# L- k* p0 E/ ?$ ?& L$ o' j
图1:HP BANK I/O模块

- O  o0 ]' B* \5 d$ O; h1 X/ s& [4 p* \- I$ o' c) N/ ]7 M- W! p

  b  q6 @/ x! Z- \2 L' ^0 E: W3 x) L" E0 W, L& x; |. R$ b3 C) ~
图2:HR BANK I/O模块

7 T# m$ [" E" }# f! D! A
( M( W/ \8 @% H
% j% T  b$ o1 [/ H( [8 Z* _! c9 B+ _) ~3 z4 [- @4 v
I/O逻辑资源主要包含5部分:% ^9 j! [. W. b6 A
! s) l8 k/ n+ \1 X5 L
1, ILOGIC
* |3 ]  C" i8 `, K  P% F2 S# c$ [2 }5 @& m- d
ILOGIC即输入信号处理逻辑,紧挨着IOB,外界的输入信号最先经过的就是ILOGIC。ILOGIC是由许多的数据选择器和一个IDDR(input
/ o7 x2 r2 M) Q' ^# Z5 o) A4 g% [/ e( l$ `
Double data rate)触发器构成。该触发器既可以双沿捕获输入数据也可以拆分成普通单沿触发器。在HP BANK中,ILOGIC被称为ILOGICE2,在HR BANK中,ILOGIC被称为ILOGICE3。图3给出了ILOGICE3的示意图:
) m+ \7 _7 Y# q
$ J: y5 {1 z! v7 D, d6 \

; ~2 m8 l; n$ L) s/ L. [* J1 ~# }, }) u' \! i7 i+ s
图3:ILOGICE3示意图
! L. G6 Y. H$ }$ L

% ^7 [8 g4 N& ]: U  B
) z2 f' Q- o/ \; n6 h" y' |& d+ M3 w
游客,如果您要查看本帖隐藏内容请回复
, Y( ]% u6 ~. r  n& `3 _
: p& a  K- L* i5 _
为了方便咱们使用I/O逻辑资源,xilinx公司专门将本篇介绍的几种模块集中起来,构成了功能强大的源语ISERDESE2和OSERDESE2,咱们只需要调用源语,正确使用源语就能够完成高级的I/O逻辑设计了,下篇咱们就聊聊高级逻辑资源ISERDESE2和OSERDESE2吧!2 W4 O/ ]! y/ T% U- K$ R3 w

6 i7 f+ S; g( [! ?9 w& w) R" l" ?# K# ~! m
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