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本文是 邢翔瑞在学习FPGA时学到的相关知识与总结,希望可以帮助同行理解和掌握相关的FPGA知识。可以将本文档当作相应FPGA教程文档UG998的辅助文档学习。
* ~3 i7 d/ L- p! v" T) Y, e8 i' }' X7 ~' I# S
Xilinx原版教程文档参见XilinxDocumentation navigator 中对应UG998:Introduction to FPGA Design with Vivado High-Level Synthesis
" Q3 F$ g4 {. s) n, n6 c6 h4 x1 c
3 v* p- R# W3 v3 B1 o; t6 G0.简介:
4 ~4 @* @* F% T0 b( Z
9 u" I5 ?; n+ V ?( u3 mUG998文档主要介绍一些基础的关于FPGA和硬件设计相关的知识,例如什么是FPGA,硬件设计的基本概念,vivado软件的高层综合,以运算为中心的算法(Computation-Centric Algorithms),以控制为中心的算法(Control-CentricAlgorithms),软件验证和vivado HLS软件,多程序集成,应用的验证。用于初学者有一个初步的理念。
9 u! b" @; x; X" [, n
! s& }# _ ]% Q, s4 c, b. o目录
$ w! ?7 G6 G0 g" c' q
+ o* ~: S! Z& X/ D9 ^! A% V; R0 N5 B) I* e, ~
0.简介:
8 ^" g. ]. e" A: o: U
8 O, Z7 L1 E9 p F) U* q8 O; N6 i$ i* Y7 g" F0 W3 D3 W
Chapter 1: W B8 [1 _: X6 m/ @! h/ f9 s
: v5 h: N8 ?' q& [7 d+ n8 V( n5 P+ Q
1.1 Overview1 c0 L* j X+ W0 H
# e2 _3 Y" I% b. j6 ~( d
8 z1 _1 `! _( |2 o1 N
1.2 Programming Model
- |+ k! d, x' x# @3 e8 p: ?8 e% H# y; X* F8 y: ]
* t( }0 m8 ~7 e1 P$ fChapter2 什么是FPGA
2 [. [2 a: U" n! |$ h( a5 u3 R4 r) i& Y, z, i
: t1 L2 j. w/ ]# f2.1 LUT4 w8 f# w' f; U, ~0 Z. \8 B1 A0 O
3 _/ r+ q& ~2 J z* h0 `; y5 X' B, C, O
2.2 Flip-flop(FF)* R2 F& P- y1 o3 o4 P9 [
% {& p* C ]- G6 x b
|$ G% J4 i( m) K9 H2.3 DSP48 block
4 R6 @: u2 M8 |, D. p9 O$ C$ h4 S
9 m* F( ^# S( \# b6 z4 ?' w% i2 l x) K+ s
2.4 BRAM和其他存储设施! ^8 J7 V3 k. e& r- y$ g
& Q _" ]. u" \- B: g" i! v, q- L" S; V/ D
2.5 FPGA的并行架构与处理器的结构8 l9 ^) S! E6 F
( ]! V% o5 D/ J# Y' I
( M# |( v6 l1 P3 u0 S1 |
2.5.1 Scheduling
3 O' n8 B4 J" @/ d: p. d
& K: l/ } O) p1 c- F- H t- D1 A r% f6 ^& g
2.5.2 Pipeline, f3 d; E$ l2 _! Z8 \
" A4 l* ^/ \5 t# S( D
5 W w- p9 L! J6 G+ r! z; {6 @2.5.3 数据流(dataflow)
& n0 g0 u, |) W. w0 Z9 g
. |; c( F$ l4 L+ e6 P" d! T- x+ K' S2 B/ E2 T0 E
Chapter3 硬件设计的基本概念! i: Q/ r0 Z8 @) b5 F, P8 V3 L/ l
# Q! M$ P+ w" b; R, @5 {7 x6 C) P8 O0 R
3.1 时钟频率
8 F4 b4 l2 C" l# l1 Y6 u3 G) Z* M+ H; a' g) Z$ y+ ~ J' L _6 W( E' b( z; ]9 a
1 Q( G* x9 L5 k" p& X- R9 R3.2 时延(latency)与流水线(pipelining)
$ P+ l( @& G! S; s- s. m
/ b& P. s* a6 H- N0 ^8 t q5 W, J& L; S
3.3 吞吐速度(Throughput)2 \% R* g7 [+ ]* U7 Q8 j5 t; w
* F' ^/ b1 k7 i6 A" {3 ?, O' b/ S# G5 p( D$ [0 `( j" R
3.4 内存架构与布局6 A4 ?0 V& @0 d0 O
{0 ]. ^8 W! ?
( ^" u. C- a% m; V2 C6 X" L( \
4 F1 I# s. ?4 D5 D, M/ l0 q
. O7 F& c* o) e. b3 G0 b3 p3 N7 O8 X6 G6 I. _* U2 @- _+ H) T( \
; L i/ E2 }! e
! G* x: M4 r2 V r' V' |4 ]9 a. `1 A0 @: y" c* a
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