|
|
EDA365欢迎您登录！
您需要 登录 才可以下载或查看，没有帐号？注册
x
数字设计FPGA应用学习笔记
! L! e% C( Y' H! _$ S第一章 FPGA基础及电路设计
$ S0 C( ~# H: [ FPGA基础及7系列FPGA基本原理
: g% V1 \8 i7 K$ C7 a# P. _ F FPGA概述2 O7 c) Z( J' X& w) }
FPGA基本逻辑结构0 ^& r c' Y. X* u
7系列FPGA CLB
, C0 q% @. ~% N7 h# M 7系列FPGA IOB' C# [5 f1 c. L" i) D+ H; J
7系列FPGA及7a35tftg256-1特性
. T& _1 u/ _9 C4 {! Z9 U* c8 {/ L! z- f0 z) ?" B
FPGA电路设计
9 T( P- N6 ~5 P; m, M4 F9 G& }0 Y4 e4 P h: i# l
第一章 FPGA基础及电路设计
" y4 i4 r2 m5 f1 W. kFPGA基础及电路设计包含两个方面的内容，一个是FPGA基础及7系列FPGA基本原理，另外就是FPGA电路设计，FPG广泛应用于军事、医疗、工业、通信等领域，下面是两款实验板： 5 q# `/ a) _; K! B" M
) b% Z8 }9 H W! ]
, Y: O& W! g( ^8 K1 P
6 D) k* s" I$ n7 b: ]
7 |) B* H, K3 f6 e0 c* k* G3 `
$ w& c4 W0 I; c: r9 w8 ]8 NFPGA基础及7系列FPGA基本原理: ? ]6 A# U, U
FPGA概述
! n4 o- Q! w) w/ N2 Y, ?FPGA（Field－Programmable Gate Array），即现场可编程门阵列，它是在PAL、GAL、cpld等可编程器件的基础上进一步发展的产物。它是作为专用集成电路（ASIC）领域中的一种半定制电路而出现的，既解决了定制电路的不足，又克服了原有可编程器件门电路数有限的缺点。 4 d" p2 f7 F4 S
FPGA的应用面非常广泛，这里主要介绍Xilinx Artix-7系列芯片： , _1 X R2 }; r& H, I4 X* C
Xilinx Artix-7 系列器件以28纳米高性能低功耗 ，尤其适合于可满足航空电子和通信等领域的尺寸、重量、功耗和成本敏感型市场需求。提供大量的可供开发者直接使用的IP核，是市场的主流。 * u0 B+ Y9 x9 m) c' S! B
下图是开发软件VIVADO的截图，可以看到一些IP核，用户也可以自己设计IP核 $ ?; l! i3 l1 x1 n. D; Y/ ~
, d1 H% I4 t2 W) j
& ?. \1 z+ u; y系统设计师可以根据需要通过可编辑的连接把FPGA内部的逻辑块连接起来，就好像一个电路试验板被放在了一个芯片里。 ' }% d X, w+ g4 H- B5 a1 r; I
一个出厂后的成品FPGA的逻辑块和连接可以按照设计者的设计而改变，所以FPGA可以完成所需要的逻辑功能。
3 p; M+ \, [0 R. K下图是一个Verilog HDL语言的一个实例，Verilog HDL语言就是对电路功能的一个描述，通过具体分析可以看到具体实现的电路，就可以将这个电路下载到FPGA里面，让FPGA实现我们描述的功能
# ~) }! h4 R- n) w
2 s( N7 J4 E' O3 N
1 g) e3 S) A$ l0 P) q3 g S- t: I" mFPGA基本逻辑结构
* U, `+ r$ L3 C: _% M, ~& L. {; I7 f* C
现场可编程门阵列FPGA是可编程器件，与传统可编程器件如PAL、GAL、CPLD等相比，FPGA有不同的结构，FPGA是利用小型查找表、小的RAM来实现组合逻辑，每个查找表连接到一个D触发器的输入端，触发器再来驱动其他逻辑电路或IO，由此构成即可实现组合逻辑功能和时序逻辑功能的基本逻辑单元模块，这些模块间利用金属连线连接或连接到IO输入输出模块，通过向内部静态存储单元加载编程数据，就可以实现组合逻辑，再通过与触发器配合，就可以实现时序逻辑，这些都是可编程的，最终决定了FPGA的所有功能实现。对FPGA的配置信息被保存在配置存储器中，并在上电和复位的瞬间对FPGA进行配置。
" o7 k- P) B! b7 ^3 d% h* O下面是一款Xilinx Artix-7 xc7a35t的芯片，封装型号为ftg256，在VIVADO下可以看到他的封装是16*16的256个管脚
& l% X5 @1 |" b* @" f5 x
8 z3 i, P/ u. v% d% N" V* ?( u. t3 Y" u
# [8 A) S& u2 i: Y' P
# ]& T. ~" S9 {0 I7 f6 G( e! R8 V i/ o& z! l0 \2 L
4 Y: R) w: O+ A! \( d5 d- h
放大之后可以看到逻辑单元和相应的管脚信息
& m; M1 B0 }/ J0 X1 f( r* Q$ a
& M9 @/ d y5 f* r$ {: B1 X& b/ M2 M+ X5 S) G. m
( @) K3 }7 O- |/ }
每个CLB由两个Slice组成，Xilinx FPGA采用了阵列逻辑单元LCA（Logic Cell Array）概念，内部包括可配置逻辑模块CLB（Configurable Logic Block）、输入输出模块IOB（Input Output Block）和内部连线（Interconnect）三个部分。 - L5 d& ^+ W# n" U" R
9 U, W, E& O! k* I- i# I; ~* ^- W- S3 ~% S
& ~" K+ T, R; c8 G要掌握FPGA基本逻辑结构，就要掌握LUT是如何实现的，FPGA是通过查找表LUT实现逻辑函数的
' t9 n c3 d# J5 ?: l* b9 Y4 R% ~
% M( {& V. T% r2 v
" N. v2 N/ l5 c% V例1：用一个LUT实现如下函数
/ ^4 r: A& U1 J8 c& I
3 C4 k6 i- N, t( k7 `: Z" X: P8 V, p' e) N0 ?4 N* B, |) |
于是可以构建出如图所示的真值表
_; ^ |8 w) d) l4 U
* y3 j0 ^2 ]+ Q1 Y. n. l# r
+ c! S' x2 A6 D2 D& b8 x
5 Q4 T) u) ~2 c9 [: V3 g3 A% a# @" c1 a. w4 P8 p- i2 u
# M3 ^! K3 b# o* o+ J7系列FPGA CLB1 b3 l/ j8 C6 H4 Q l. t6 n0 s
Artix-7系列的FPGA，型号为xc7a35t，在Artix-7中处于中端。它包含 5200个SLICE,其中3600个SLICEL，1600个SLICEM。每个SLICE包含4个6输入查找表LUT，共有20800个查找表。Artix-7A35T可以分配400Kb的分布式RAM,200Kb的移位寄存器，41,600个触发器。
( S& G7 I( m. P% B j. X3 ~& d' \
9 d1 \5 h0 D7 U# Y8 R5 K
通过查找表LUT实现逻辑函数，7系列的FPGA，每个查找表LUT都有6输入和两个独立输出。
; n0 a3 @" T( F$ |. K& X当实现6输入逻辑函数时，A1-A6为输入，O6为输出 ,当实现两个小于等于5输入的逻辑函数时，A1-A5为输入，O6为输出，A6拉高。 ) x Q9 @4 p( l+ f7 A
; A+ U+ A/ v0 K4 b; b1 v# c在图中我们可以看到，每个CB由两个SLICE组成
/ C5 H/ n6 Q+ X4 @0 {: H
; G* s. V; I8 |: ~. ^
每个SLICE包含4个LUT及8个存储元件及其他组合逻辑
2 _! \. f- X/ {4 c, r0 L
) H3 t' J- y6 o. X4 s# v( R1 ~
每一个SLICE具有8个存储元件，右边的4个可以配置为锁存器或触发器，左边的4个只能配置为触发器。其中右侧的4个存储元件的输入通过多路开关选择，可以使用对应的查找表输出，或者外部的输入。 - e B, o5 D- K: I: C
另外的四个之鞥呢配置为D触发器。这4个D触发器的输入可以是查找表LUT的输出，也可以是外部的输入。 + l7 {9 |( R. l) s
额外的规定是，当右边的存储元件被配置为锁存器，这4个触发器不能被使用
. Y8 @/ R7 f& r
7 U! l5 ]4 \+ ~SLICE在FPGA 7系列体系结构分为两类：能够实现补码运算、移位寄存器、存储器功能的SLICE，成为SLICEM。它的功能相对较为复杂 4 D8 y* Q; j4 U$ }" W
) W. K* w: K& f6 Z& U
而查找表只能实现基本逻辑函数的，成为SLICEL，逻辑结构相对比较简单
- W8 T( w: T+ u2 W5 X7 A2 ~% h
2 ~ W2 b0 w, E3 y' S- l
通常采用全功能SLICEM结合简单功能的SLICEL配合使用，使芯片在保持能力和性能的同时，实现低功耗和低成本。
& W; J5 D( E. X9 w3 S3 ~( t# t7 |& a! [: B. h1 i$ G# f1 K4 i
\4 X* ^ L3 T9 r1 s: k& B$ F
7系列FPGA IOB. }% F+ h7 a% y+ o7 `3 e
CLB能够实现FPGA的功能，但是要和外界进行数据传输，就必须要有和外界电平兼容的IO接口IOB（Input Output Block）,IOB的数量主要取决于芯片引脚的数量，通常对IOB的配置可以配置FPGA引脚的电气特性，甚至可以配置上拉和下拉模式，可以达到与大多数电平的兼容。 % _' d; F* {& Q4 r
7系列FPGA具有多个IOBANK(可以理解为IO的分组)，每个BANK具有50个IOB, 具体的 BANK的数量取决于FPGA的尺寸和封装。 - v% S2 y0 r) U& s
4 q* e% r/ p" v" CXC7K325T具有10个I/O BANK，xc7a35tftg256-1因为有256个管脚，具有4个IO BANK。分别是BANK14、BANK15、BANK34和BANK35，其中BANK34只有部分管脚是可用的。 " ^+ k4 m1 \% Z" z
- n% l: e8 o# M8 H I7 b. d
在下入中我们可以看到IOB的具体信息 8 O) ]4 s" i' ?: b6 T* z/ p
- k$ b6 P; c* p* }$ n
IO管脚可以配置多种输入输出标准，当配置为单端模式，例如按键输入、LED驱动等，可以设置为LVCMOS,、LVTTL、HSTL、 PCI、 SSTL电平标准。 # Q0 d# k% H+ h u G" k
当选择差分输入输出模式（2个IO管脚差分输入或输出），可以设置为LVD,、Mini_LVDS、 RSDS、PPDS、BLVDS,以及差分 HSTL和 SSTL标准。
4 U4 F- D L" F3 n4 ?8 G% ` f7 [7系列的FPGA管脚还分为高效管脚HP(high-peRFormance)和宽范围HR（high-range）管脚
' i, w( M, ~; {9 xT信号用于控制输入输出三态DCITERMDISABLE设置DCI功能无效DIFFI_IN用于设置是否采用差分模式。在大多数的7系列FPGA器件中，在每一个BANK的最后两个管脚是仅单端模式的,其他的管脚都可以配置为单端或差分模式。 / C8 w. k- y* F) |5 ^
( v6 r( n, }8 o$ a* H
( M' K5 l) u% |6 h# F; Y
) K7 w2 r) g8 _
7 P/ Q* x4 U; z5 k9 b, p+ O7系列FPGA及7a35tftg256-1特性
) x& Y7 R, |8 Y8 p& R3 m; P- 改进的高效6输入查找表技术，可配置为分布存储器。
- 内置先入先出逻辑的36 Kb双端口块内存用于片内数据缓存。
- 高效的SelectIO技术，支持DDR3接口，采样率高达1866 Mb/s。
- 内置串行千兆位收发器（multi-gigabit transceivers），收发频率从600 Mb/s到最高的6.6 Gb/s ，直到28.05 Gb/s。
- 用户可配置的模拟输入接口(XADC),，具有双12-bit 1MSPS 模数转换器，并带有内部温度、电压传感器。
- 具有DSP 专用SLICE ， 带有 25 x 18 乘法器， 48位进位累加器。
- 时钟管理块 (CMT)及结合锁相环PLL和混合模式时钟管理器MMCM，具有高精度和低抖动优点，可实现分频和倍频、相位移动等功能。
- 集成PCIE接口模块。
- 大量的可配置选项。
- 28 nm高效低功耗、低内核电压、低成本设计。
; q. u, T; e6 q" c* j! Y8 [
$ ]. y, m) J5 F0 i0 G. {$ K: H3 n( h" h 速度等级 * O9 @) Z, |1 ^1 G) l
Artix-7 FPGA可选- 3、- 2、- 1、- 1l，和-2l速度等级，其中-3等级具有最高的性能。 & E- R: G; V+ A h/ x" J* V
Artix-7 FPGA主要操作在1.0V内核电压，器件xc7a35tftg256-1具有-1的速度等级。
k2 \4 N# C% P0 _. h 电压 7 D3 W1 Z0 N$ y+ k
7a35tftg256的内核电压VCCINT电压最大1.1V，通常工作在1.0V。
% L, r3 R4 ~( ]3 {6 `- 辅助设备电压VCCAUX最高为2.0V，通常为1.8V。
- BRAM电压VCCBRAM电压最大1.1V,通常工作在1.0V。
- I/O端口电压VCCO最高为3.6V，通常为3.3V。
- 设计包含FPGA的电路板，需要设计不同的电压源。
0 ?) O; i1 s) Z* Z$ D. Q5 i/ H b
4 H) C' T) m8 p" S6 O$ I
: {8 y( E, M6 H5 `
( l3 ~; w1 Y$ h2 m, n8 u
8 }% s6 U7 K5 t ^* \$ WFPGA电路设计. o7 h3 I* ^* o# f9 c
基于Xilinx xc7a35tftg256-1的电路板为配合FPGA学习使用， 加上一台笔记本电脑就可以完成口袋实验室的搭建。掌握FPGA的基本电路设计，对于FPGA的功能设计与实现是必须的。例如进行约束时需要对应到管脚，要点亮LED就必须知道并在工程中描述接口关系。
' V$ ? C/ ^) I& m某宝上也有大量的实验开发板可以选择，根据个人喜好可以进行选择，这里不做推荐，避免广告嫌疑。
7 G I2 d ^) c9 r& x% O9 U0 \7 r6 y% P
7 e/ M4 s+ |* l0 M yxc7a35tftg256-1分为BANK14,BANK15,BANK35和BANK34四个BANK。不同的开发板对应不同的管脚，在开发板配套资料中会有相应的原理图，通过查看原理图可以找到相应的管脚
9 Y" y; j H8 h$ L1 U6 K+ K9 m
1 C7 `/ Y0 P# n) l下面列出一些开发板上比较常见的资源管脚分配：
$ z! o! Z& o- F- LED ; p m% |7 m4 G! a, a" u. L; { H
LED驱动电路非常简单，FPGA的输出I/O口的驱动能力足够驱动LED点亮
+ b) G& h& s* m$ r! r% U5 n
; A9 E9 g- B% g# X; P' | c" V1 x, E6 ]6 y$ J: K
/ ?" q! c: t8 r7 r% ~
# B3 }. R; M ]1 }2 S5 c* [- a, {
- 拨码开关 2 C& H8 p: o8 S1 Q8 e/ w+ o2 F L5 t
拨码开关（也叫DIP开关，拨动开关）是用来操作控制的地址开关
C4 Q3 E) b% r5 f/ o% n
) Z ^. w9 o$ n# ^! x+ S& Q6 U* g7 ?
" F" U e8 B! ] W% `1 @
- 按键 3 X2 X3 K/ j- s: O) r5 z4 _
按键是开发板必不可少的元件，不同的按键有不同的电气特性，根据电路图，当按键缺省状态时（未按下），对应管脚通过两个串联的10K欧姆电阻接地，获得低电平输入。当按键按下时，通过10K电阻接到电源，这时将得到高电平输入。 ) l+ J( u8 y+ B" L
4 c" \6 c& H9 f: v- f
% R; _9 W# ^/ f% \# v
( C" \; \2 ?: l0 |- J) E0 ]
- 数码管
% Q# G! D# V! I- e# i1 \. p数码管的选择分为连体数码管和分布数码管，共阳极和共阴极的区别，驱动的方式也分为含有3-8译码器和不含3-8译码器的区别，使用3-8译码器可以节省芯片管脚资源 3 s; Y5 V1 |3 k& \! n+ H
$ _! m4 G' G- E. U. Q
+ d5 X/ w! T0 O+ v下面是电路板七段数码管驱动电路及管脚分配图
1 L4 F0 `- k. L7 r8 _% ~
3 i6 E8 |! Z8 Y' }2 P( L
+ c' T7 |) Z/ ]! {( }" ^. h2 s
& D) W, _, V# Z, @- VGA驱动! [4 f4 C2 A' s- j' e' h
. V0 R! B4 F# _. J2 _
% @- k6 _. N) G, i* M% ]
2 D! p# K, X' u% \+ j0 u& y- 串口驱动 ]7 F5 U. T1 x4 T V( u
' j/ K, W6 s2 L% A
* R+ D+ E: k* ?; ?! B: |6 `4 ?( d& }$ P
- XADC 3 z2 G2 M( F; H* k8 m P
5 s- ^% u& v% A. Y; Q- q) i
$ @9 M6 g$ D3 e' ?" m: S" {" l4 m
* d- u }; _* D9 }8 f, j% A
% |7 o# N% j- `1 [4 T5 z0 V' A6 y
9 C9 J @) D! ]; o
' a6 j5 i2 T) M& ?# R! i' f( u
|
|
/1 
发表于 2019-5-8 14:09
收藏
淘帖
支持！
反对！