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学习FPGA有必要写SDRAM控制器吗?

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发表于 2019-5-6 10:04 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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在学习FPGA的过程中,注意是在学习过程中,联系FPGA的使用技巧,强烈建议尝试设计一个SDRAM控制器,不要使用IP核。# v# A5 S' p; r) A+ w4 V& s( D

3 M. a! _4 o- {" d. |学习SDRAM控制器设计,能让你掌握很多知识。
, y  W9 b- A1 x8 ]$ e: G2 c2 V
0 ]7 ]8 o. Z7 s: V4 e4 k8 K0 w$ X& p  O& ^" j/ [7 t( U! {
更好的使用状态机去精准控制时序。
) k2 k6 P! C3 A  Z0 l, E7 O$ V, _* _2 P8 Q+ a# d0 i8 k( M" `
学会高速设计中必要的技能,也就是时序约束方法,timing report的阅读方法,查找时序问题的基本技巧,复位方案和时钟方案的合理设计,如何优化代码提升系统最高工作时钟,以及testbench的写法。* n, Y/ N1 o3 m/ h+ s

) S$ j. e6 u5 ~3 F) c" {* o7 p: [3 N8 F* c
写sdram控制器还是能锻炼不少典型技能的,值得去花时间思考尝试,性价比是可取的。
9 l! }# s$ a! `: ?" [
; v4 y  F- M3 [6 i- `( @设计流程:' h, f7 B1 W2 B. g+ }
8 O4 |" @$ Y, N
看文档。6 I/ Z: I+ U4 Z! V! U
7 R; D. D1 g" J# `7 |3 I
实现sdram控制器的逻辑。很多公开的教程都有指导怎样实现基本功能的,方式不一,可以参考;之后再自行思考如何改进性能。
+ [# o3 P5 R9 U2 K
$ K' ~  n& a. z. u写测试模块,配合仿真模型,验证所写逻辑是否正确,写进去能读出如预期,此阶段不追求速度。% X+ X4 ]# N. c; \- Y) \8 H# R

  q7 }: ]& ?1 h# d3 G/ i/ [) [频率觉得不够,加流水,切组合链,并行化等等,改进逻辑提高速度。
8 B4 _( ]7 z& D6 E" k: w6 M; W7 z/ t3 p) w+ \* P& s% x
研究时序约束,并做进一步优化,让它能在板子上跑起来。' `% c8 n7 I8 \: q2 R" p0 ~2 {
: ~" ?0 {; H" M( v
sdram控制器这时应该能用了。
& B9 p9 l. n. d0 l. I
+ H8 C4 U. ?) |3 [7 u
* ]' `; t- G. U& o9 T版权所有权归卿萃科技 杭州FPGA事业部,转载请注明出处
* Q+ f- x- H% L
2 P9 T9 V3 W  |5 S& r: X0 W, F作者:杭州卿萃科技ALIFPGA$ t' F4 v" F) T: k$ D
  V0 x: a  y4 x) x& Y2 J
原文地址:杭州卿萃科技FPGA极客空间4 J, o% s0 B/ J) I
( v  V, U; a" t6 d6 o

* J) e: d  O5 l9 Y
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