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 quartus ii chip planner使用请教大神,非常感谢!

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发表于 2019-4-26 14:29 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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最近学习使用chip panner时有一些疑问,各位论坛大神多多指教undefined
! K6 W5 G! N3 v1 v, G  B: B2 N我设计了一个异步复位的D触发器,综合的电路如下:
5 f6 Q. S: B0 F( h+ {; p# J
) B+ q0 ?. t) y( A布局布线后使用chip planner查看芯片内部
( M! A: T- S" ^8 \' A
8 y" _) n7 i+ L* ?
! K2 }8 @3 C0 g3 ~# L . f+ J/ h5 f( p( U9 J
4 V* B" V, D- Z+ X- O/ I
D触发器的输入端应该是输入信号取反,可是图3红圈中的与门怎么解释怎么得到非门?还有SCLR不接应该是高电平还是低电平?
0 G+ [% U: v1 Q1 q

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发表于 2019-4-26 18:45 | 只看该作者
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