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本帖最后由 uqHZau 于 2019-4-24 18:15 编辑 ' p0 h$ S& k- }
$ ?; I0 }7 U6 W9 p x+ m数字电路:
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4 T7 X! n2 e5 p _这是大学里的基本课程 ,涵盖了一般数字电路的组合电路、时序电路、寄存器传输、储存器以及可编程逻辑电路(FPGA 就是其中一种),还有比较好的添加了计算机的指令集结构、处理器设计等计算机方面的内容,整个课程就很系统的介绍了硬件电路系统的整体框架。
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语言学习:, p4 b' s' Q3 p% A0 @- Z0 z
) f& x0 d; b* O8 Q/ f初学 FPGA 的话,时序和组合部分内容看的差不多后,就可以学 Verilog/VHDL,弄懂其语言所表示的数字电路结构很重要,如计数器,编/译码器,寄存器电路,阻塞与非阻塞,还有状态机的跳转,模块的例化,信号的延时等等,这些内容在进行数字电路设计的时,在心中有个大概的框图,或者把这些电路模型画出来,从模块图-寄存器传输级-基本逻辑门依次画出,因为要清楚所设计的语句是否真达到了想要的电路结构,功能时序等,相关的书中都有可以参考综合出来的电路。在Moselsim环境下进行代码练习,可以写测试文件,看波形,是否达到了所要的结果。
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3 W2 G" `" W _电路烧入:! d" z: l% S/ m; N
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经过前两个阶段的初步学习,接下来将写好的 Verilog 代码通过 ISE 或者 QuartusII 烧入板子(一般是 Xilinx or Altera的开发板)。正常来说这个阶段问题会比较多,会明显感觉到硬件描述语言与 C 语言的差别,它需要你自己去认真考虑分析电路的时序情况,这时候自己要反复总结Verilog语言后面所代表的电路结构,以及它不像 C 一样是一条语句一条语句的顺序执行,而是并发执行的,所以一般在进行比较复杂的功能实现时,要先划分好各个模块的功能,即采用 Top - down 的方法,再进行 Coding。- \8 u1 m& z7 L+ b T$ ~/ I9 r
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作者:杭州卿萃科技ALIFPGA
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来源:CSDN + m( P$ w) H5 A3 ]% i6 D; m
原文:https://blog.csdn.net/woshifennu1234/article/details/80667786
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