找回密码
 注册
关于网站域名变更的通知
查看: 276|回复: 1
打印 上一主题 下一主题

初学FPGA一些建议

[复制链接]

该用户从未签到

跳转到指定楼层
1#
发表于 2019-4-24 13:54 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您登录!

您需要 登录 才可以下载或查看,没有帐号?注册

x
本帖最后由 uqHZau 于 2019-4-24 18:15 编辑 ' p0 h$ S& k- }

$ ?; I0 }7 U6 W9 p  x+ m数字电路:
. M$ {2 t1 b3 U* W  u( I
4 T7 X! n2 e5 p  _这是大学里的基本课程 ,涵盖了一般数字电路的组合电路、时序电路、寄存器传输、储存器以及可编程逻辑电路(FPGA 就是其中一种),还有比较好的添加了计算机的指令集结构、处理器设计等计算机方面的内容,整个课程就很系统的介绍了硬件电路系统的整体框架。
2 a/ L, O) n5 o2 f& Z+ J$ m$ F. Y  R8 u
语言学习:, p4 b' s' Q3 p% A0 @- Z0 z

) f& x0 d; b* O8 Q/ f初学 FPGA 的话,时序和组合部分内容看的差不多后,就可以学 Verilog/VHDL,弄懂其语言所表示的数字电路结构很重要,如计数器,编/译码器,寄存器电路,阻塞与非阻塞,还有状态机的跳转,模块的例化,信号的延时等等,这些内容在进行数字电路设计的时,在心中有个大概的框图,或者把这些电路模型画出来,从模块图-寄存器传输级-基本逻辑门依次画出,因为要清楚所设计的语句是否真达到了想要的电路结构,功能时序等,相关的书中都有可以参考综合出来的电路。在Moselsim环境下进行代码练习,可以写测试文件,看波形,是否达到了所要的结果。
+ {; g1 A1 N/ Z6 C
3 W2 G" `" W  _电路烧入:! d" z: l% S/ m; N
4 e: X' C- S+ j& f4 t$ d
经过前两个阶段的初步学习,接下来将写好的 Verilog 代码通过 ISE 或者 QuartusII 烧入板子(一般是 Xilinx or Altera的开发板)。正常来说这个阶段问题会比较多,会明显感觉到硬件描述语言与 C 语言的差别,它需要你自己去认真考虑分析电路的时序情况,这时候自己要反复总结Verilog语言后面所代表的电路结构,以及它不像 C 一样是一条语句一条语句的顺序执行,而是并发执行的,所以一般在进行比较复杂的功能实现时,要先划分好各个模块的功能,即采用 Top - down 的方法,再进行 Coding。- \8 u1 m& z7 L+ b  T$ ~/ I9 r
4 B' j4 ]9 O( {) p( I8 Z
      版权所有权归卿萃科技 杭州FPGA事业部,转载请注明出处) r' M$ Y$ T% |
) F' |* H5 X; q
作者:杭州卿萃科技ALIFPGA
, R  r9 p" q; c2 }5 f3 b# u  y# |
原文地址:杭州卿萃科技FPGA极客空间 微信公众号
6 D* @7 z7 N- I, ?; n2 J--------------------- 9 C8 `, p0 P2 |; X2 T1 ]! X4 O
作者:ALIFPGA ! ?% }& X8 k# J
来源:CSDN + m( P$ w) H5 A3 ]% i6 D; m
原文:https://blog.csdn.net/woshifennu1234/article/details/80667786
+ l3 U! t, k: e* x2 @- i' Z& p# N. h版权声明:本文为博主原创文章,转载请附上博文链接!
# G# R. g4 i( {' ^" x
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

推荐内容上一条 /1 下一条

EDA365公众号

关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号-1 )

GMT+8, 2025-8-2 02:33 , Processed in 0.125000 second(s), 23 queries , Gzip On.

深圳市墨知创新科技有限公司

地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

快速回复 返回顶部 返回列表