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[Cadence Sigrity] 电源完整性仿真中关于VRM的疑惑

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该用户从未签到

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1#
发表于 2019-4-14 16:36 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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最近在学习电源完整性仿真,用的是sigrity2015。在做PI分析时要设置VRM。而我学习这段时间以来一直对VRM的设置不是很理解。困惑来源如下所述:% N) J3 V+ ?0 w4 l% u
1.听说电源模块的VRM模型厂商基本是不对外提供的(我没实际问过我们公司常用的电源模块的厂商)5 f( ^1 U& R/ @  T. r
2.由于没有准确的模型,所以在做PI仿真时对VRM有两种处理方式。一种是禁用VRM,进行开路仿真;另一种是自己根据经验设置一个VRM模型然后再进行相应的电源完整性仿真分析。
- G0 W# ~" J4 ~! \" _我的困惑是:' M; g  @, z" X  C- W* V
1.如果禁用VRM,进行开路仿真,这仿真结果和板子的实际情况是否相差太多?毕竟芯片获得的电压与电压模块的相应速度等是密切相关的,那这种仿真结果的参考意义在哪儿?- |" u  F7 Y) s( A1 z
2.如果自己根据经验设置一个VRM模型,那同样,仿真结果与板子实际情况是否相符,相符程度如何评判?这仿真结果满足指标就代表我板子能满足预期吗?
1 F4 M) {, d% D2 Y* \0 w) I) V$ s
: N, }. u# ~6 ~( ~/ C' A" C仿真中该如何合适的处理VRM啊,请各位大侠指点一二) P. B. l; r% F

该用户从未签到

4#
发表于 2019-4-15 20:40 | 只看该作者
电源的噪声源有两个:一个是VRM,一个是芯片内部晶体管反转产生的噪声。& v% A, J/ ?; o$ P* s& W2 N
你用sigrity仿真的阻抗曲线是用来评估芯片内部噪声的。所以这个仿真并不关心VRM的集总参数,反而将VRM断开排除VRM的影响会更好。当你关注VRM本身的噪声传导到芯片后的影响时,VRM的参数的准确性才很重要,这也是业界的难题。6 g  R' J8 g- y) w" z& h$ p% b
工程实践上通常是用sigrity评估芯片内部噪声,留足余量,同时VRM layout设计要合理,这样一般不会出什么问题。
% N- D% m7 c1 w+ r6 H

该用户从未签到

8#
发表于 2019-6-20 16:36 | 只看该作者
VRM手动设置就好了。找到输出Pin,回流Pin
  • TA的每日心情
    开心
    2020-3-17 15:01
  • 签到天数: 1 天

    [LV.1]初来乍到

    10#
    发表于 2019-10-24 12:10 | 只看该作者
    在PowerSI中仿真电源地网络阻抗参数时,如果VRM管脚的电阻模型没有定义,通常就会看到低频段的阻抗特征曲线呈现开路特性。实际电路中,VRM作为直流电源在交流频域里表现为低阻,因此通常在仿真电源地网络的阻抗参数时,一般选用毫欧级的电阻来等效VRM模型。
  • TA的每日心情
    奋斗
    2019-11-19 16:19
  • 签到天数: 1 天

    [LV.1]初来乍到

    12#
    发表于 2019-11-7 14:49 | 只看该作者
    简单说 你仿真是想看电源去耦电容对整个电源路径的影响(Z的影响),是无源的 不需要设置VRM
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