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Verilog中{}的应用

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Allevi
  • TA的每日心情
    开心
    2019-11-19 15:19

    • 签到天数: 1 天

    [LV.1]初来乍到
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    1#
    发表于 2019-3-15 07:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    Verilog中{}的应用8 V2 l( P# q, z) s. t2 U. V
    将花括号中罗列的数据依次拼接起来。; E5 r/ }1 C* }/ F+ e
    & @8 ~( x4 B" Z
    比如：d_out={d_in[7],~d_in[6:0]+1'b1}；# h0 x- m$ L, l
    2 R  e8 ?1 M; L) ~- M
    即是将d_in的最高位和d_in的低7位取反加一拼接起来，拼接之后d_out为8位
    9 C% d/ T" o; V  x. e

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