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VHDL结构体

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发表于 2019-3-14 09:53 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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VHDL结构体
6 ~/ t; x% B5 e2 p

7 W0 s% w+ D- E  W! X用来描述设计的内部结构和逻辑功能。$ e$ [$ c8 G3 y/ k0 N7 {

- @& b) ]; T8 L# ]" R! Q& H基本结构4 p* j2 k0 v5 u3 e
( j' G. p8 p, }- j
ARCHITECTURE<J结构体名>OF<实体名> IS7 I" k1 l" M* l- ?
0 }  F7 q% ^( @0 o( g
[结构体说明部分]
4 ^8 T5 B& [& R) V& n9 p
. |" W* Y* n: m/ vBEGIN
2 A+ @: e+ {5 |, z; K0 [  `% }$ N6 X% I8 |# m; A$ k
<并行处理语句>
0 B- K1 k7 [2 u
3 \/ i- u& H- P0 A0 n$ ^END  [ARCHTECTURE<结构体名>];
: k! ]2 q) i8 K5 ?% M3 {) ~# _2 k8 O& f4 ]# L
; m0 Y! a0 C. Z+ S
其中ARCHITECTURE、BEGIN、END  等称为保留字1 ^5 Q' i) C2 j5 m% B

& ^; O8 e1 h! Q7 f& S7 s结构体说明部分:用于对结构体需要使用的信号、常数、数据类型和函数进行定义和说明。# a8 c7 M3 y6 s: h

! V+ z! B) ~$ z" d功能描述语句:  描述了结构体的主要功能。9 i! e6 p$ i( P2 W
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