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请教,非层次原理图,如何能检查出port缺失?

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1#
发表于 2019-3-13 21:13 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    非层次原理图中,某页图只画了一个port,另一页图没有画对应的port,编译工程没有报错。今天看了project设置好一会,没找到解决办法。所以来请教各位同学,是否只有层次原理图才能检查出这种错误?1 Z% L. V0 P) h( [3 W( Y
2 ]! @, Y8 ?" Y/ r) y
    谢谢~~~
5 p' z3 m( K; s

该用户从未签到

2#
发表于 2019-3-14 09:23 | 只看该作者
是的,通过放置sheet entry,并进行连通,软件才知道子图的这两个Port是需要连起来的。
2 W& }8 b* p( z: c6 E在软件Net Identifier Scope默认为Automatic的前提下:5 {" X+ K/ J5 K* j
对于没有主图的情况,软件会按flat设计处理:不同子图有相同Port,那么会自动连接;若某个子图少了Port,软件也不会认为有错。
! F+ F- p9 _8 g8 A; `- L+ \对于有主图的情况,软件会按Hierarchical设计:若在主图的“子图一”里设置了sheet entry,而“子图一”里没有相同名字的Port,编译时就会报错。- ~' ^4 ?6 J+ z) `- k
如下是一个使用sheet entry的例子:+ d& @4 x' J: f6 {6 B

& P; b, x( }6 [
; }) {7 R$ l1 o5 E6 L" s

该用户从未签到

3#
 楼主| 发表于 2019-3-14 13:41 | 只看该作者
OK。那看来必须建层次图才行了。。谢谢~~
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