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FPGA配置模式

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发表于 2019-3-12 13:24 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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FPGA配置模式

3 o4 V, ^2 }0 o% b2 H% ?# S. N5 G4 i7 z: n% W& S
FPGA有多种配置模式:* u* X6 ?3 s- Q# O: F% o
并行主模式为一片FPGA加一片EPROM的方式;: W! V4 X  K2 R
主从模式可以支持一片PROM编程多片FPGA;
' t# n6 \+ ~8 T串行模式可以采用串行PROM编程FPGA;* v3 C" E9 Q0 H
外设模式可以将FPGA作为微处理器的外设,由微处理器对其编程。  + b. C  E+ n% D. q: H5 g
如何实现快速的时序收敛、降低功耗和成本、优化时钟管理并降低FPGA与PCB并行设计的复杂性等问题,一直是采用FPGA的系统设计工程师需要考虑的关键问题。% M6 |8 f/ H7 w' D. s
如今,随着FPGA向更高密度、更大容量、更低功耗和集成更多IP的方向发展,系统设计工程师在从这些优异性能获益的同时,不得不面对由于FPGA前所未有的性能和能力水平而带来的新的设计挑战。  
2 Z' H8 w# a* I. g, O) {9 U- z5 g2 q例如,领先FPGA厂商Xilinx最近推出的Virtex-5系列采用65nm工艺,可提供高达33万个逻辑单元、1,200个I/O和大量硬IP块。超大容量和密度使复杂的布线变得更加不可预测,由此带来更严重的时序收敛问题。此外,针对不同应用而集成的更多数量的逻辑功能、DSP嵌入式处理和接口模块,也让时钟管理和电压分配问题变得更加困难。  幸运地是,FPGA厂商、EDA工具供应商正在通力合作解决65nm FPGA独特的设计挑战。不久以前,Synplicity与Xilinx宣布成立超大容量时序收敛联合工作小组,旨在最大程度地帮助系统设计工程师以更快、更高效的方式应用65nm FPGA器件。设计软件供应商Magma推出的综合工具Blast FPGA能帮助建立优化的布局,加快时序的收敛。  最近FPGA的配置方式已经多元化!
$ E) P8 y$ _' K! v0 v) y
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