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转——一位资深大神的十年FPGA开发设计经验总结

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发表于 2019-3-12 10:36 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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转——一位资深大神的十年FPGA开发设计经验总结
0 o2 r/ Z& k( p
6 i: T$ S0 j- i: t! v: _6 D
大学时代第一次接触FPGA至今已有10多年的时间,至今记得当初第一次在EDA实验平台上完成数字秒表、抢答器、密码锁等实验时那个兴奋劲。当时由于没有接触到HDL硬件描述语言,设计都是在MAX+plus II原理图环境下用74系列逻辑器件搭建起来的。% z$ t+ y* g2 _: R! r8 |$ P
8 V/ r- n+ S7 ], M+ b
9 R, V0 O* D7 a4 q# R* Z1 o, h
后来读研究生,工作陆陆续续也用过Quartus II、FoundaTIon、ISE、Libero,并且学习了verilogHDL语言,学习的过程中也慢慢体会到verilog的妙用,原来一小段语言就能完成复杂的原理图设计,而且语言的移植性可操作性比原理图设计强很多。# o- A5 o/ _- O$ y8 V* }* s( o
* }2 i9 z$ J% W, N/ S
3 N3 T9 f' g8 l3 u7 `
在学习一门技术之前我们往往从它的编程语言入手,比如学习单片机时,我们往往从汇编或者C语言入门。所以不少开始接触FPGA的开发人员,往往是从VHDL或者Verilog开始入手学习的。但我个人认为,若能先结合《数字电路基础》系统学习各种74系列逻辑电路,深刻理解逻辑功能,对于学习HDL语言大有裨益,往往会起到事半功倍的效果。  I; f& Q$ ~5 `

1 ]& X8 I6 x: z- E; [- s4 h
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2#
发表于 2019-3-12 10:59 | 只看该作者
想要看隐藏内容你就要回复啊

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3#
发表于 2022-9-22 16:20 | 只看该作者
一位资深大神的十年FPGA开发设计经验总结
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