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转——一位资深大神的十年FPGA开发设计经验总结

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发表于 2019-3-12 10:36 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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转——一位资深大神的十年FPGA开发设计经验总结

1 `8 b- F1 v+ S+ _+ q* m" @. i
& S3 S) H/ W: ~5 I* }, C) j" ^) U1 Y大学时代第一次接触FPGA至今已有10多年的时间,至今记得当初第一次在EDA实验平台上完成数字秒表、抢答器、密码锁等实验时那个兴奋劲。当时由于没有接触到HDL硬件描述语言,设计都是在MAX+plus II原理图环境下用74系列逻辑器件搭建起来的。. o7 r+ N) h- Y$ |! |
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  `( S$ J+ d( v$ x后来读研究生,工作陆陆续续也用过Quartus II、FoundaTIon、ISE、Libero,并且学习了verilogHDL语言,学习的过程中也慢慢体会到verilog的妙用,原来一小段语言就能完成复杂的原理图设计,而且语言的移植性可操作性比原理图设计强很多。
3 I) J: c) g. n0 n- P7 t  a
( F( l, H7 @$ Q- f6 S9 j
6 G. ^/ A' R( J% c* e在学习一门技术之前我们往往从它的编程语言入手,比如学习单片机时,我们往往从汇编或者C语言入门。所以不少开始接触FPGA的开发人员,往往是从VHDL或者Verilog开始入手学习的。但我个人认为,若能先结合《数字电路基础》系统学习各种74系列逻辑电路,深刻理解逻辑功能,对于学习HDL语言大有裨益,往往会起到事半功倍的效果。
* u- Y8 U' j& N; Y8 z1 ^* b* c1 _; ]2 d  B
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发表于 2019-3-12 10:59 | 只看该作者
想要看隐藏内容你就要回复啊

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发表于 2022-9-22 16:20 | 只看该作者
一位资深大神的十年FPGA开发设计经验总结
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